基于FPGA的新型數(shù)據(jù)位同步時鐘提取(CDR)實現(xiàn)方法
標簽： FPGA CDR 數(shù)據(jù) 位同步時鐘
上傳時間： 2013-08-28
上傳用戶：huyahui
VGA顯示的FPGA實現(xiàn)方法, VGA顯示的FPGA實現(xiàn)方法,
標簽： FPGA VGA 實現(xiàn)方法
上傳時間： 2013-08-30
上傳用戶：libinxny
文檔中給出了使用VHDL編寫的頻率的精確測量方法的代碼,同時還有cPLD與e2rom等的接口代碼
標簽： VHDL 編寫 精確測量 代碼
上傳用戶：1318695663
chipscope使用教程 以及 FPGA 在線調(diào)試的方法
標簽： chipscope FPGA 使用教程 在線調(diào)試
上傳用戶：daguda
提出了一種基于FPGA的高階高速F IR濾波器的設(shè)計與實現(xiàn)方法。通過一個169階的均方根\r\n升余弦滾降濾波器的設(shè)計,介紹了如何應(yīng)用流水線技術(shù)來設(shè)計高階高速F IR濾波器,并且對所設(shè)計的\r\nFIR濾波器性能、資源占用進行了分析。
標簽： FPGA 濾波器 實現(xiàn)方法
上傳時間： 2013-08-31
上傳用戶：小火車啦啦啦
本文：采用了FPGA方法來模擬高動態(tài)(Global Position System GPS)信號源中的C／A碼產(chǎn)生器。C／A碼在GPS中實現(xiàn)分址、衛(wèi)星信號粗捕和精碼(P碼)引導(dǎo)捕獲起著重要的作用，通過硬件描述語言VERILOG在ISE中實現(xiàn)電路生成，采用MODELSIM、SYNPLIFY工具分別進行仿真和綜合。
標簽： FPGA GPS 模擬 動態(tài)
上傳用戶：pwcsoft
FPGA設(shè)計常用的四種設(shè)計方法，對于整條把握設(shè)計有很大的指導(dǎo)作用
標簽： FPGA 設(shè)計方法
上傳用戶：simonpeng
cpld與單片機8051的通信的設(shè)計方法 以及cpld和單片機的端口對應(yīng)
標簽： cpld 8051 單片機 通信
上傳時間： 2013-09-01
上傳用戶：wettetw
本文詳細介紹了制作電路板的方法及步驟.\r\n實驗板的功能\r\n這個實驗板可以做如下實驗：\r\n1．可以進行運算器（加、減、乘和除法）、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實驗\r\n2．可以進行觸發(fā)器、寄存器、計數(shù)器和一般時序電路的實驗\r\n3．可以進行頻率計電路、時鐘電路、計時電路、交通燈等復(fù)雜數(shù)字系統(tǒng)的實驗\r\n4．加擴展板可以進行A/D、D/A、串行E2ROM和8031單片機等方面的實驗\r\n
標簽： CPLD 電路 實驗板
上傳用戶：吾學(xué)吾舞
摘要本文介紹了一種用CPLD設(shè)計GPS數(shù)字通道相關(guān)器中C／A碼產(chǎn)生囂的方法，詳細分析了設(shè)計原理并給出了相應(yīng)的仿真結(jié)果．這種設(shè)計方法已在我們研制的GPS，GLONASS兼容機中得到實際應(yīng)用。
標簽： CPLD GPS 數(shù)字
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