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FPGA <b>SoC</b>

基于ARM-FPGA的IRIG-B碼產(chǎn)生器的研制

基于ARM-FPGA的IRIG-B碼產(chǎn)生器的研制這是一份非常不錯的資料，歡迎下載，希望對您有幫助！

標(biāo)簽： arm fpga

上傳時間： 2021-12-30

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基于FPGA的SOC和IPCore驗證平臺

隨著半導(dǎo)體技術(shù)與數(shù)字集成電路(微處理器、存貯器以及標(biāo)準(zhǔn)邏輯門電路等)技術(shù)的迅速發(fā)展，特別是隨著計算機技術(shù)的發(fā)展，在工業(yè)生產(chǎn)和科學(xué)技術(shù)研究的各行各業(yè)中，人們利用PC機的強大處理功能代替?zhèn)鹘y(tǒng)儀器的某些部件，開發(fā)出各種測量儀器(虛擬儀器)，傳統(tǒng)儀器的數(shù)字邏輯部分多是采用分立集成電路(IC)組成，分立IC愈多，給系統(tǒng)的電路設(shè)計、調(diào)試及維護(hù)帶來諸多不便。而隨著EDA技術(shù)的飛速發(fā)展，大規(guī)模可編程邏輯芯片CPLD / FPGA應(yīng)運而生。這類芯片可以替代幾十甚至上百塊通用IC芯片，而且，因其可用硬件描述語言進(jìn)行芯片設(shè)計、支持在線編程和在系統(tǒng)編程等優(yōu)點而備受青睞。本課題主要是用FPGA實現(xiàn)一個驗證平臺。用于SOC及IPCore的驗證。用FPGA系統(tǒng)驗證板實現(xiàn)在實際硬件環(huán)境中的驗證可以彌補ASIC 設(shè)計流程中仿真的不足, 通過該驗證也可以加快ASIC設(shè)計且降低由于邏輯問題所造成ASIC 開發(fā)中的成本損耗。本文首先介紹了EDA技術(shù)的發(fā)展，然后介紹了FPGA，SOC,和IPCore的一些基本概念，分析了FPGA在現(xiàn)代集成電路設(shè)計領(lǐng)域的一些應(yīng)用。最后，具體設(shè)計了一塊用設(shè)計驗證的開發(fā)板，并討論了其設(shè)計結(jié)構(gòu)，流程及驗證方法。

標(biāo)簽： IPCore FPGA SOC

上傳時間： 2013-05-16

上傳用戶：bakdesec
~{JGR 8vQ IzWwR5SC5D2V?bD#DbO5M3~} ~{3v?b~} ~{Hk?b~} ~{2iQ/5H9&D~} ~{?IRTWw@)3d~} ~{TZ~}JDK1.4.2~{OB

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標(biāo)簽： IzWwR IRTWw JGR 8vQ

上傳時間： 2015-02-22

上傳用戶：ommshaggar
b to b 模式電子商務(wù)系統(tǒng)

b to b 模式電子商務(wù)系統(tǒng) ，c# 開發(fā) , B/S結(jié)構(gòu)

標(biāo)簽： to 模式電子商務(wù)系統(tǒng)

上傳時間： 2014-01-20

上傳用戶：hanli8870
a XOR b> a,然后a XOR b< b,and both a and b are dependent data

a XOR b> a,然后a XOR b< b,and both a and b are dependent data

標(biāo)簽： XOR and dependent both

上傳時間： 2014-01-27

上傳用戶：yxgi5
樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個節(jié)點內(nèi)元素個數(shù)在 [MIN,2*MIN] 之間, 但根節(jié)點元素個數(shù)為 [1,2*MIN] (2) 節(jié)點內(nèi)元素由小排到大, 元素不

樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個節(jié)點內(nèi)元素個數(shù)在 [MIN,2*MIN] 之間, 但根節(jié)點元素個數(shù)為 [1,2*MIN] (2) 節(jié)點內(nèi)元素由小排到大, 元素不重複 (3) 每個節(jié)點內(nèi)的指標(biāo)個數(shù)為元素個數(shù)加一 (4) 第 i 個指標(biāo)所指向的子節(jié)點內(nèi)的所有元素值皆小於父節(jié)點的第 i 個元素 (5) B 樹內(nèi)的所有末端節(jié)點深度一樣

標(biāo)簽： MIN 元素 tree

上傳時間： 2017-05-14

上傳用戶：日光微瀾
歐幾里德算法：輾轉(zhuǎn)求余　　原理: gcd(a,b)=gcd(b,a mod b)　　當(dāng)b為0時,兩數(shù)的最大公約數(shù)即為a　　getchar()會接受前一個scanf的回車符

歐幾里德算法：輾轉(zhuǎn)求余　　原理: gcd(a,b)=gcd(b,a mod b)　　當(dāng)b為0時,兩數(shù)的最大公約數(shù)即為a　　getchar()會接受前一個scanf的回車符

標(biāo)簽： gcd getchar scanf mod

上傳時間： 2014-01-10

上傳用戶：2467478207
數(shù)據(jù)結(jié)構(gòu)課程設(shè)計數(shù)據(jù)結(jié)構(gòu)B+樹 B+ tree Library

數(shù)據(jù)結(jié)構(gòu)課程設(shè)計數(shù)據(jù)結(jié)構(gòu)B+樹 B+ tree Library

標(biāo)簽： Library tree 數(shù)據(jù)結(jié)構(gòu) 樹

上傳時間： 2013-12-31

上傳用戶：semi1981
基于FPGA的SoC原型驗證的設(shè)計與實現(xiàn)

該文檔為基于FPGA的SoC原型驗證的設(shè)計與實現(xiàn)簡介文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………

標(biāo)簽： fpga soc

上傳時間： 2021-11-18

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Altera公司SoC FPGA 簡介

本文是關(guān)于Altera公司SoC FPGA 的用戶手冊（英文版）。文中主要介紹了什么是SoC FPGA、SoC FPGA相關(guān)知識介紹、為什么要使用SoC FPGA以及SoC FPGA都應(yīng)用到哪些方面。

標(biāo)簽： Altera FPGA SoC

上傳時間： 2013-10-14

上傳用戶：jrsoft

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FPGA <b>SoC</b>

基于ARM-FPGA的IRIG-B碼產(chǎn)生器的研制

基于FPGA的SOC和IPCore驗證平臺

~{JGR 8vQ IzWwR5SC5D2V?bD#DbO5M3~} ~{3v?b~} ~{Hk?b~} ~{2iQ/5H9&D~} ~{?IRTWw@)3d~} ~{TZ~}JDK1.4.2~{OB

b to b 模式電子商務(wù)系統(tǒng)

a XOR b> a,然后a XOR b< b,and both a and b are dependent data

樣板 B 樹 ( B - tree ) 規(guī)則 : (1) 每個節(jié)點內(nèi)元素個數(shù)在 [MIN,2MIN] 之間, 但根節(jié)點元素個數(shù)為 [1,2MIN] (2) 節(jié)點內(nèi)元素由小排到大, 元素不

歐幾里德算法：輾轉(zhuǎn)求余　　原理: gcd(a,b)=gcd(b,a mod b)　　當(dāng)b為0時,兩數(shù)的最大公約數(shù)即為a　　getchar()會接受前一個scanf的回車符

數(shù)據(jù)結(jié)構(gòu)課程設(shè)計數(shù)據(jù)結(jié)構(gòu)B+樹 B+ tree Library

基于FPGA的SoC原型驗證的設(shè)計與實現(xiàn)

Altera公司SoC FPGA 簡介