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FPGA應(yīng)用開發(fā)(fā)入門與典型實(shí)例

用神經(jīng)網(wǎng)絡訓練來逼近函數(shù):y=8+2*exp(1-x.^2).*cos(2*pi*x)

用神經(jīng)網(wǎng)絡訓練來逼近函數(shù):y=8+2*exp(1-x.^2).*cos(2*pi*x)

標簽： exp cos pi 神經(jīng)網(wǎng)絡

上傳時間： 2016-06-15

上傳用戶：GavinNeko
用FPGA實現(xiàn)的ADC采樣器

用FPGA實現(xiàn)的ADC采樣器，用VHDL編寫，8個模擬信號通道地址,8位數(shù)據(jù)輸出

標簽： FPGA ADC 采樣

上傳時間： 2014-01-10

上傳用戶：星仔
DSK6713 Speech.rar語音訊號處理應用範例程序

DSK6713 Speech.rar語音訊號處理應用範例程序

標簽： Speech 6713 DSK

上傳時間： 2013-12-17

上傳用戶：冇尾飛鉈
用VHDL語言在FPGA上實現(xiàn)浮點運算,大家共享

用VHDL語言在FPGA上實現(xiàn)浮點運算,大家共享

標簽： VHDL FPGA 語言浮點運算

上傳時間： 2013-12-24

上傳用戶：a6697238
基于FPGA的交通燈系統(tǒng)控制程序。用的是verilog.

基于FPGA的交通燈系統(tǒng)控制程序。用的是verilog.

標簽： verilog FPGA 交通燈系統(tǒng)控制

上傳時間： 2014-02-16

上傳用戶：hwl453472107
用MATLAB里的XILINX BLOCK, 支持FPGA算法, 實現(xiàn)開平方, 并且取整.當計算停止時, VALID為高電瓶.

用MATLAB里的XILINX BLOCK, 支持FPGA算法, 實現(xiàn)開平方, 并且取整.當計算停止時, VALID為高電瓶.

標簽： MATLAB XILINX BLOCK VALID

上傳時間： 2013-12-07

上傳用戶：xlcky
用MATLAB里的XILINX BLOCKS, 支持FPGA算法, 實現(xiàn)X_NEXT = ((n-1)x+ A/x(n-1)次)/n

用MATLAB里的XILINX BLOCKS, 支持FPGA算法, 實現(xiàn)X_NEXT = ((n-1)x+ A/x(n-1)次)/n

標簽： MATLAB BLOCKS XILINX X_NEXT

上傳時間： 2014-01-08

上傳用戶：chfanjiang
用MATLAB 里的XILINX BLOCKS編寫, 實現(xiàn)Fibonacci sequence算法, 當F為0時, 輸出為0 F為1時, 輸出為1 當F為N 時, 輸出為F的N-1 加上 F的N-2.

用MATLAB 里的XILINX BLOCKS編寫, 實現(xiàn)Fibonacci sequence算法, 當F為0時, 輸出為0 F為1時, 輸出為1 當F為N 時, 輸出為F的N-1 加上 F的N-2.

標簽： Fibonacci sequence MATLAB BLOCKS

上傳時間： 2013-11-26

上傳用戶：亞亞娟娟123
建立一個傳送和接收SMS訊息的應用程式。SMSTalk是一個對話方塊導向的、多執(zhí)行緒應用程式

建立一個傳送和接收SMS訊息的應用程式。SMSTalk是一個對話方塊導向的、多執(zhí)行緒應用程式，監(jiān)視SMS讀取佇列以及提供使用者一個方法來組合和傳送SMS訊息。

標簽： SMSTalk SMS 程式接收

上傳時間： 2016-06-24

上傳用戶：gundamwzc
用ISE中各種工具設計“運動計時表”.加深對FPGA/CPLD設計流程的理解

用ISE中各種工具設計“運動計時表”.加深對FPGA/CPLD設計流程的理解，體會ISE集成的各種設計工具的使用方法與技巧。

標簽： FPGA CPLD ISE 工具設計

上傳時間： 2016-06-28

上傳用戶：chens000

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FPGA應(yīng)用開發(fā)(fā)入門與典型實(shí)例

用神經(jīng)網(wǎng)絡訓練來逼近函數(shù):y=8+2exp(1-x.^2).cos(2pix)

用FPGA實現(xiàn)的ADC采樣器

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基于FPGA的交通燈系統(tǒng)控制程序。用的是verilog.

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用MATLAB里的XILINX BLOCKS, 支持FPGA算法, 實現(xiàn)X_NEXT = ((n-1)x+ A/x(n-1)次)/n

用MATLAB 里的XILINX BLOCKS編寫, 實現(xiàn)Fibonacci sequence算法, 當F為0時, 輸出為0 F為1時, 輸出為1 當F為N 時, 輸出為F的N-1 加上 F的N-2.

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