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高性能FPGA應(yīng)用領(lǐng)域及其研究

高性能FPGA應(yīng)用領(lǐng)域及其研究，F(xiàn)PGA的開發(fā)流程

標(biāo)簽： FPGA 性能應(yīng)用領(lǐng)域

上傳時(shí)間： 2013-08-10

上傳用戶：cc1915
fpga open door,最最基礎(chǔ)的入門介紹

fpga open door,最最基礎(chǔ)的入門介紹，針對(duì)首次接觸此類的新手\r\n

標(biāo)簽： fpga door open

上傳時(shí)間： 2013-08-10

上傳用戶：daijun20803
FPGA generalities and code

FPGA generalities and code

標(biāo)簽： generalities FPGA code and

上傳時(shí)間： 2013-08-10

上傳用戶：天空說我在
這個(gè)文檔介紹了目前絕大部分的FPGA/CPLD設(shè)計(jì)軟件

這個(gè)文檔介紹了目前絕大部分的FPGA/CPLD設(shè)計(jì)軟件，并對(duì)每個(gè)軟件做了簡(jiǎn)要的介紹。大家在學(xué)習(xí)前看看，對(duì)于設(shè)計(jì)軟件的選擇將有極大幫助。

標(biāo)簽： FPGA CPLD 文檔分

上傳時(shí)間： 2013-08-10

上傳用戶：cccole0605
利用FPGA實(shí)現(xiàn)DDS經(jīng)過編譯沒有錯(cuò)誤。編譯環(huán)境為QuartusII7.2

利用FPGA實(shí)現(xiàn)DDS經(jīng)過編譯沒有錯(cuò)誤。編譯環(huán)境為QuartusII7.2，該環(huán)境集成了IP核，可以提高開發(fā)效率。

標(biāo)簽： QuartusII FPGA DDS 7.2

上傳時(shí)間： 2013-08-10

上傳用戶：zhuyibin
FPGA學(xué)習(xí)資料

FPGA學(xué)習(xí)資料，包括EDA實(shí)驗(yàn)程序，以及一些小程序，如交通燈的設(shè)計(jì)

標(biāo)簽： FPGA

上傳時(shí)間： 2013-08-10

上傳用戶：windypsm
在Altera的FPGA開發(fā)板上運(yùn)行第一個(gè)FPGA程序

在Altera的FPGA開發(fā)板上運(yùn)行第一個(gè)FPGA程序，以后我還會(huì)陸續(xù)發(fā)布這方面的代碼

標(biāo)簽： FPGA Altera 開發(fā)板運(yùn)行

上傳時(shí)間： 2013-08-10

上傳用戶：windwolf2000
利用FPGA驅(qū)動(dòng)LED顯示

FPGA驅(qū)動(dòng)LED顯示:運(yùn)用硬件描述語(yǔ)言（如VHDL）設(shè)計(jì)一個(gè)顯示譯碼驅(qū)動(dòng)器，即將要顯示的字符譯成8段碼。由于FPGA有相當(dāng)多的引腳端資源，如果顯示的位數(shù)N較少，可以直接使用靜態(tài)顯示方式，即將每一個(gè)數(shù)碼管都分別連接到不同的8個(gè)引腳線上，共需要8×N條引腳線控制.

標(biāo)簽： FPGA LED 驅(qū)動(dòng)

上傳時(shí)間： 2013-08-10

上傳用戶：Amygdala
這是一個(gè)基于FPGA的加密/解密算法的簡(jiǎn)單介紹

這是一個(gè)基于FPGA的加密/解密算法的簡(jiǎn)單介紹，并闡述了它的好處。

標(biāo)簽： FPGA 加密解密算法

上傳時(shí)間： 2013-08-10

上傳用戶：懶龍1988
這是Actel 的FPGA的譯碼器的VHDL源代碼。

這是Actel 的FPGA的譯碼器的VHDL源代碼。

標(biāo)簽： Actel FPGA VHDL 譯碼器

上傳時(shí)間： 2013-08-10

上傳用戶：大灰狼123456