FPGA實現(xiàn)的直接數(shù)字頻率合成器，本文基于DDS的基本原理,利用Altera公司的FPGA芯片F(xiàn)LEX10系列器件完成了一個DDS系統(tǒng)的設(shè)計。
標(biāo)簽： FPGA 數(shù)字頻率合成器
上傳時間： 2013-08-06
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FPGA和嵌入式處理器實現(xiàn)低成本智能顯示模塊,并帶有部分源程序
標(biāo)簽： FPGA 嵌入式處理器 分 顯示模塊
上傳用戶：libinxny
是一些很好的FPGA設(shè)計實例，對初學(xué)者很好，我就是學(xué)這個入門的
標(biāo)簽： FPGA 設(shè)計實例
上傳用戶：zhangchu0807
FPGA 設(shè)計的四種常用思想與技巧，常用的FPGA技巧。
標(biāo)簽： FPGA
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從硬件和軟件兩方面建立了基于DSP和FPGA的軟件無線電平臺。重點研究了該實驗平臺多模式\\\\\\\\r\\\\\\\\n數(shù)字調(diào)制解調(diào)的硬件實現(xiàn)結(jié)構(gòu)、軟件實現(xiàn)結(jié)構(gòu)和不同模式之間的切換等，充分體現(xiàn)了軟件無線電系統(tǒng)的靈活性、\\\\\\\\r\\\\\\\\n開放性和兼容性等特點。
標(biāo)簽： FPGA DSP 軟件 硬件
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關(guān)于FPGA一本不錯的書，里面有FPGA的基礎(chǔ)知識，推薦給大家！FPGA學(xué)習(xí)資料
上傳用戶：凌云御清風(fēng)
可編程邏輯器件 pld/fpga,vhdl/verilog的相關(guān)學(xué)習(xí)資料，設(shè)計技巧，抓緊免費下載。
標(biāo)簽： verilog fpga vhdl pld
上傳用戶：李彥東
FFT處理器的FPGA設(shè)計方法，適合做信號處理的技術(shù)人員參考，用FPGA實現(xiàn)
標(biāo)簽： FPGA FFT 處理器 設(shè)計方法
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利用FPGA來實現(xiàn)一個簡單的醫(yī)療呼叫系統(tǒng)，使用語言VERILOG
標(biāo)簽： FPGA 呼叫系統(tǒng)
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華為設(shè)計FPGA的高級教程，對有一定基礎(chǔ)者有很大幫助
標(biāo)簽： FPGA 華為 教程
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