This is UART Receiver interface C code Tested on Sparton 3 xilinx FPGA.
標簽： interface Receiver Sparton Tested
上傳時間： 2017-07-24
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This is UART Transmitter interface C code Tested on Sparton 3 xilinx FPGA.
標簽： Transmitter interface Sparton Tested
上傳時間： 2014-01-25
上傳用戶：zxc23456789
基于FPGA CPLD設計與實現UART,一聽名字就知道，不用再說了吧，
標簽： FPGA CPLD UART
上傳時間： 2014-08-09
上傳用戶：czl10052678
FPGA實現接收UART數據，并將接收的數據發出去
標簽： fpga uart
上傳時間： 2015-05-21
上傳用戶：947000692ying
NIOS ii 應用實驗UART接口測試cycloen4e FPGA源碼 fpga quartu工程文件, Quartus軟件版本11.0, FPGA型號為CYCLONE4E系列中的EP4CE6E22C8,可以做為你的學習設計參考。
標簽： uart 接口 cycloen4e fpga
上傳時間： 2021-10-21
上傳用戶：shjgzh
該文檔為基于FPGA的UART設計的Verilog實現程序的簡介資料，講解的還不錯，感興趣的可以下載看看…………………………
標簽： fpga uart verilog
上傳時間： 2021-10-23
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該文檔為基于FPGA的UART設計的Verilog實現程序簡介文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………
上傳時間： 2021-11-27
上傳用戶：默默
該文檔為基于FPGA的UART設計實現及其驗證方法講解文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………
上傳時間： 2021-12-10
上傳用戶：jiabin
該文檔為基于FPGA的UART設計與實現講解文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………
上傳時間： 2022-01-31
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本論文在詳細研究MIL-STD-1553B數據總線協議以及參考國外芯片設計的基礎上，結合目前新興的EDA技術和大規模可編程技術，提出了一種全新的基于FPGA的1553B總線接口芯片的設計方法。 從專用芯片實現的具體功能出發，結合自頂向下的設計思想，給出了總線接口的總體設計方案，考慮到電路的具體實現對結構進行模塊細化。在介紹模擬收發器模塊的電路設計后，重點介紹了基于FPGA的BC、RT、MT三種類型終端設計，最終通過工作方式選擇信號以及其他控制信號將此三種終端結合起來以達到通用接口的功能。同時給出其設計邏輯框圖、算法流程圖、引腳說明以及部分模塊的仿真結果。為了資源的合理利用，對其中相當部分模塊進行復用。在設計過程中采用自頂向下、碼型轉換中的全數字鎖相環、通用異步收發器UART等關鍵技術。本設計使用VHDL描述，在此基礎之上采用專門的綜合軟件對設計進行了綜合優化，在FPGA芯片EP1K100上得以實現。通過驗證證明該設計能夠完成BC/RT/MT三種模式的工作，能處理多種消息格式的傳輸，并具有較強的檢錯能力。 最后設計了總線接口芯片測試系統，選擇TMS320LF2407作為主處理器，測試主要包括主處理器的自發自收驗證，加入RS232串口調試過程提高測試數據的直觀性。驗證的結果表明本文提出的設計方案是合理的。
標簽： 1553B FPGA 總線接口
上傳時間： 2013-06-04
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