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FiFO

FirstInputFirstOutput的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

異步FiFO設(shè)計(jì)文檔,有需要者可以看看.

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標(biāo)簽： FiFO 文檔

上傳時(shí)間： 2014-11-22

上傳用戶：thesk123
VHDL的ram和FiFO model code 包含眾多的廠家

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標(biāo)簽： model VHDL FiFO code

上傳時(shí)間： 2016-08-15

上傳用戶：wsf950131
UNIX/Linux環(huán)境下使用有名管道(FiFO)的例子。

UNIX/Linux環(huán)境下使用有名管道(FiFO)的例子。

標(biāo)簽： Linux UNIX FiFO 環(huán)境

上傳時(shí)間： 2014-01-26

上傳用戶：lx9076
FT245U169 FiFO Loopback This program transmits data through the FT245BM FiFO data bus to the MSP430

FT245U169 FiFO Loopback This program transmits data through the FT245BM FiFO data bus to the MSP430F169 on Port 4. The data is decremented and sent back out of Port 4 to to FiFO on the FT245BM. Use Hyperterminalto send and receive data. FiFO control lines are on Port2 (P2.0-P2.3).

標(biāo)簽： FiFO data 245 transmits

上傳時(shí)間： 2013-12-26

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FiFO.v verilog實(shí)現(xiàn)的先進(jìn)先出存儲(chǔ)器

FiFO.v verilog實(shí)現(xiàn)的先進(jìn)先出存儲(chǔ)器

標(biāo)簽： verilog FiFO 存儲(chǔ)器

上傳時(shí)間： 2016-08-25

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基于80C196KC微處理器的高速串行通訊、單片機(jī)將FiFO中的數(shù)據(jù)讀取出來后

基于80C196KC微處理器的高速串行通訊、單片機(jī)將FiFO中的數(shù)據(jù)讀取出來后，從串口發(fā)送出去等代碼

標(biāo)簽： C196 FiFO 196 80C

上傳時(shí)間： 2014-01-02

上傳用戶：comua
用宏的方法實(shí)現(xiàn)FiFO,純c語言實(shí)現(xiàn),大家可以試一試

用宏的方法實(shí)現(xiàn)FiFO,純c語言實(shí)現(xiàn),大家可以試一試

標(biāo)簽： FiFO c語言家

上傳時(shí)間： 2014-11-21

上傳用戶：dongqiangqiang
基于Verilog HDL的異步FiFO設(shè)計(jì)與實(shí)現(xiàn)

基于Verilog HDL的異步FiFO設(shè)計(jì)與實(shí)現(xiàn)

標(biāo)簽： Verilog FiFO HDL

上傳時(shí)間： 2013-12-19

上傳用戶：a3318966
《Verilog HDL 語言編程》異步FiFO設(shè)計(jì)（基于Verilog)

《Verilog HDL 語言編程》異步FiFO設(shè)計(jì)（基于Verilog)

標(biāo)簽： Verilog FiFO HDL 語言編程

上傳時(shí)間： 2016-08-30

上傳用戶：561596
一個(gè)異步FiFO的verilog實(shí)現(xiàn)論文

一個(gè)異步FiFO的verilog實(shí)現(xiàn)論文

標(biāo)簽： verilog FiFO 論文

上傳時(shí)間： 2014-01-27

上傳用戶：lanjisu111

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FiFO

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FT245U169 FiFO Loopback This program transmits data through the FT245BM FiFO data bus to the MSP430

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基于80C196KC微處理器的高速串行通訊、單片機(jī)將FiFO中的數(shù)據(jù)讀取出來后

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基于Verilog HDL的異步FiFO設(shè)計(jì)與實(shí)現(xiàn)

《Verilog HDL 語言編程》異步FiFO設(shè)計(jì)（基于Verilog)

一個(gè)異步FiFO的verilog實(shí)現(xiàn)論文