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HIGH-PERFORMANCE

  • MP15822A 28V 1.5MHz Step-Down Converter

    The MP1582 is a high frequency step-down switching regulator with integrated internalhigh-sid

    標簽: Converter Step-Down 15822A 15822

    上傳時間: 2013-06-13

    上傳用戶:skfreeman

  • A706高壓升壓驅動器帶有6通道恒電流調節器

    The A706 series is a high voltage Boost driver with 6 channels adjustable constant current regula

    標簽: A706 升壓驅動器 恒電流 調節器

    上傳時間: 2013-06-09

    上傳用戶:青春給了作業95

  • eSP268 USB 2.0 Camera Bridge Controller

    eSP268 is a USB 2.0 High-speed (HS) and Full-speed (FS) compatible PC cameracontro

    標簽: Controller Camera Bridge eSP

    上傳時間: 2013-06-06

    上傳用戶:ice_qi

  • 高溫超導磁阻電動機的理論研究與樣機設計

    高溫超導(High Temperature Superconductor,HTS)磁陰電動機與傳統磁陰電動機相比,能夠以更小的體積和重量實現更大的輸出功率、更高的功率因數和效率.國外有關超導磁阻電動機的研究目前還處于初級階段,國內在這一領域更為滯后.論文以普通磁阻電動機的電磁關系為基礎,結合超導材料特殊的電磁特性,初步提出了超導磁阻電動機電磁設計的一般原則;并嘗試進行了一臺額定功率為150W的內反應式HTS磁阻電動機的電磁設計.論文以實際設計的一臺內反應式HTS磁阻電動機樣機作為分析實例,基于第二類超導體臨界態Kim模型和電磁場的有限元方法,提出了一般HTS磁阻電動機的內部磁場及交、直軸同步電抗的分析與計算方法.并在此基礎上進一步研究了如何借助HTS磁阻電動機的電抗曲線分析HTS磁阻電動機的穩態工作特性.論文對常規磁阻電動機與HTS磁阻電動機進行了比較.計算結果表明,在電機尺寸、結構不變的前提下,超導磁阻電動機比常規磁阻電動機明顯地提高了電機X/X值,因而以更小的尺寸獲得了更大的輸出轉矩、更高的效率和功率因數,同時電機的穩定運行區間也有所增大.計算結果還表明,采用抗磁性更強的YBCO塊材作為交軸阻磁介質,能夠保證轉子在獲得較大的直、交軸磁阻差異的同時不必犧牲較大的極孤系數和氣隙寬度,從而氣隙磁密有較好的波形,電機具有較好的同步性能.論文也對幾種具有相同定子但轉子結構不同的HTS磁阻電動機做了比較,比較結果顯示,ALA式HTS磁阻電動機比內反應式HTS磁阻電動機具有更大的輸出轉矩;當輸出功率較大時,ALA結構的HTS磁阻電動機還比內反應結構具有更好的穩態工作特性.另外發現,thin-zebra ALA式HTS磁阻電動機的同步性能比thick-zebra ALA式HTS磁阻電動機更好.在進行內反應式HTS磁阻電動機的設計時,內反應槽既要盡量阻隔交軸磁通,又要分布的比較均勻,這樣才能既獲得足夠的直、交軸同步電抗比,又削弱轉矩脈動,從而最終改善電機的同步性能.

    標簽: 高溫超導 磁阻電動機

    上傳時間: 2013-04-24

    上傳用戶:水中浮云

  • Allegro pcb editor

    cadence allegro constraint manager high speed

    標簽: Allegro editor pcb

    上傳時間: 2013-07-21

    上傳用戶:ccsdebug

  • MOSFET

    高精度Mosfet設計指南,很不錯的資料-Mosfet design high-precision guide

    標簽: MOSFET

    上傳時間: 2013-05-25

    上傳用戶:wsh1985810

  • 基于ARM和Linux的超高頻讀寫器設計與實現

    UHF(Ultra High Frequency,超高頻)RFID(Radio Frequency Identification,射頻身份識別)技術是近幾年剛剛開始興起并得到迅速推廣應用的一門新技術。該技術已被廣泛應用于工業自動化、商業自動化、交通運輸控制管理等眾多領域。但是,基于超高頻頻段讀寫器的研制在我國尚處于起步階段,傳統的超高頻讀寫器都是在單片機的基礎上實現的,這類讀寫器很難實現復雜的多任務功能;隨著經濟的飛速發展,能夠與網絡互聯并且帶有操作系統的超高頻讀寫器越來越受人們的青睞與追求。針對這些問題,本文設計并實現了一種基于ARMS3C2410微處理器和Linux操作系統的超高頻讀寫器,主要內容有: (1)分析了射頻識別技術的發展歷程和前景,以嵌入式技術為研究背景,結合軟硬件開發平臺,給出了一種基于ARM和Linux的超高頻讀寫器設計思路,指出了選題研究的目的和意義。 (2)闡述了超高頻讀寫器的原理及其應用,分析了讀寫器和標簽之間進行數據傳輸時所用到的相關技術;在給出超高頻讀寫器主要技術性能指標及功能要求的基礎上給出了基于ARMS3C2410和Linux超高頻讀寫器系統的總體設計,同時對系統構建過程中所用到的軟硬件進行了器件選型。 (3)實現了超高頻讀寫器系統硬件電路的模塊設計,主要包括主控電路模塊、存儲電路模塊、電源模塊、以太網模塊、液晶顯示模塊以及射頻收發模塊;闡述了各模塊的組成原理與實現方法,完成了硬件電路的原理圖繪制及PCB制板。 (4)根據系統的軟件需求,構建了一個進行嵌入式開發所需的軟件平臺。建立了交叉編譯環境以及NFS開發調試環境;移植了系統啟動所需的引導程序bootloader;實現了嵌入式Linux操作系統內核、文件系統的配置與移植;給出了Linux系統下典型設備(觸摸屏、網絡接口、LCD)驅動程序的移植方法。 (5)結合實驗測試環境,對超高頻讀寫器輸出功率,讀寫器發送命令以及標簽應答波形進行了測試與分析;對讀寫器的整機性能進行了聯機測試,給出了讀寫器系統的實際運行效果圖,同時對測試結果進行了總結。 實際應用結果表明,基于ARMS3C2410微處理器和Linux操作系統的超高頻讀寫器能夠實現接入網絡的功能,其讀寫速度、識別率以及識別距離等技術性能指標均達到或優于設計標準要求,該讀寫器在與PC機連接的情況下能進行數據處理,樣機系統運行穩定可靠,達到了預期的設計目標。

    標簽: Linux ARM 超高頻 讀寫器

    上傳時間: 2013-07-25

    上傳用戶:saharawalker

  • JPEG2000算術編碼的研究與FPGA實現

    JPEG2000是由ISO/ITU-T組織下的IEC JTC1/SC29/WG1小組制定的下一代靜止圖像壓縮標準.與JPEG(Joint Photographic Experts Group)相比,JPEG2000能夠提供更好的數據壓縮比,并且提供了一些JPEG所不具有的功能[1].JPEG2000具有的多種特性使得它具有廣泛的應用前景.但是,JPEG2000是一個復雜編碼系統,目前為止的軟件實現方案的執行時間和所需的存儲量較大,若想將JPEG2000應用于實際中,有著較大的困難,而用硬件電路實現JPEG2000或者其中的某些模塊,必然能夠減少JPEG200的執行時間,因而具有重要的意義.本文首先簡單介紹了JPEG2000這一新的靜止圖像壓縮標準,然后對算術編碼的原理及實現算法進行了深入的研究,并重點探討了JPEG2000中算術編碼的硬件實現問題,給出了一種硬件最優化的算術編碼實現方案.最后使用硬件描述語言(Very High Speed Integrated Circuit Hardware Description Language,VHDL)在寄存器傳輸級(Register Transfer Level,RTL描述了該硬件最優化的算術編碼實現方案,并以Altera 20K200E FPGA為基礎,在Active-HDL環境中進行了功能仿真,在Quartus Ⅱ集成開發環境下完成了綜合以及后仿真,綜合得到的最高工作時鐘頻率達45.81MHz.在相同的輸入條件下,輸出結果表明,本文設計的硬件算術編碼器與實現JPEG2000的軟件:Jasper[2]中的算術編碼模塊相比,處理時間縮短了30﹪左右.因而本文的研究對于JPEG2000應用于數字監控系統等實際應用有著重要的意義.

    標簽: JPEG 2000 FPGA 算術編碼

    上傳時間: 2013-05-16

    上傳用戶:671145514

  • 80c51芯片中文資料

    80C51 8-bit microcontroller family 4K/128 OTP/ROM/ROMless low voltage 2.7V.5.5V, low power, high speed 33 MHz

    標簽: 80c51 芯片

    上傳時間: 2013-04-24

    上傳用戶:qweqweqwe

  • 基于FPGA的數字射頻存儲器設計

    數字射頻存儲器(Digital Radio FreqlJencyr:Memory DRFM)具有對射頻信號和微波信號的存儲、處理及傳輸能力,已成為現代雷達系統的重要部件。現代雷達普遍采用了諸如脈沖壓縮、相位編碼等更為復雜的信號處理技術,DRFM由于具有處理這些相干波形的能力,被越來越廣泛地應用于電子對抗領域作為射頻頻率源。目前,國內外對DRFM技術的研究還處于起步階段,DRFM部件在采樣率、采樣精度及存儲容量等方面,還不能滿足現代雷達信號處理的要求。 本文介紹了DRFM的量化類型、基本組成及其工作原理,在現有的研究基礎上提出了一種便于工程實現的設計方法,給出了基于現場可編程門陣列(Field Programmable Gate Array FPGA)實現的幅度量化DRFM設計方案。本方案的采樣率為1 GHz、采樣精度12位,具體實現是采用4個采樣率為250 MHz的ADC并行交替等效時間采樣以達到1 GHz的采樣率。單通道內采用數字正交采樣技術進行相干檢波,用于保存信號復包絡的所有信息。利用FPGA器件實現DRFM的控制器和多路采樣數據緩沖器,采用硬件描述語言(Very High Speed}lardware Description Language VHDL)實現了DRFM電路的FPGA設計和功能仿真、時序分析。方案中采用了大量的低壓差分信號(Low Voltage Differential Signaling LVDS)邏輯的芯片,從而大大降低了系統的功耗,提高了系統工作的可靠性。本文最后對采用的數字信號處理算法進行了仿真,仿真結果證明了設計方案的可行性。 本文提出的基于FPGA的多通道DRFM系統與基于專用FIFO存儲器的DRFM相比,具有更高的性能指標和優越性。

    標簽: FPGA 數字射頻 存儲器

    上傳時間: 2013-06-01

    上傳用戶:lanwei

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