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Ip核

Ip核就是知識產權核或知識產權模塊的意思,在EDA技術開發中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產業的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。IP主要分為軟IP、固IP和硬IP。軟IP是用Verilog/VHDL等硬件描述語言描述的功能塊,但是并不涉及用什么具體電路元件實現這些功能。固IP是完成了綜合的功能塊。硬IP提供設計的最終階段產品——掩膜。[1]
  • 基于FPGA的鋼絲繩漏磁無損檢測系統設計

    提出一種以現場可編程門陣列(FPGA)為硬件核心的鋼絲繩漏磁無損檢測系統設計方案,設計了外圍電路并對嵌入式IP軟核進行了配置,利用C語言和VHDL硬件描述語言編寫了檢測系統軟件程序。實驗表明該系統具有功耗低、運算能力強、精度高、便于攜帶等優點。

    標簽: FPGA 漏磁 無損檢測 系統設計

    上傳時間: 2013-11-17

    上傳用戶:taozhengxin

  • ISE_Ip核創建教程及DDR3_Ip核使用注意事項

    ISE_Ip核創建教程及DDR3_Ip核使用注意事項

    標簽: ISE_IP DDR ip 教程

    上傳時間: 2013-11-11

    上傳用戶:lmeeworm

  • Arria V系列 FPGA芯片白皮書(英文)

      Arria V系列 FPGA芯片基本描述   (1)28nm FPGA,在成本、功耗和性能上達到均衡;   (2)包括低功耗6G和10G串行收發器;   (3)總功耗比6G Arria II FPGA低40%;   (4)豐富的硬核IP模塊,提高了集成度   (5)目前市場上支持10.3125Gbps收發器技術、功耗最低的中端FPGA。

    標簽: Arria FPGA V系列 芯片

    上傳時間: 2013-10-26

    上傳用戶:wsq921779565

  • 基于FPGA的MIMO-OFDM基帶系統發射機的設計

    介紹了多入多出-正交頻分復用(MIMO-OFDM)系統,并分析了其發射機的實現原理。充分利用Altera公司Stratix系列現場可編程門陣列(FPGA)芯片和IP(知識產權)核,提出了一種切實可行的MIMO-OFDM基帶系統發射機的FPGA實現方法。重點論述了適合于FPGA實現的對角空時分層編碼(D-BLAST)的方法和實現原理以及各個主要模塊的工作原理。并給出了其在ModelSim環境下的仿真結果。結果表明,本設計具有設計簡單、快速、高效和實時性好等特點。

    標簽: MIMO-OFDM FPGA 基帶系統 發射機

    上傳時間: 2013-10-13

    上傳用戶:Aeray

  • 基于NiosII軟核處理器的步進電機接口設計

        NiosII軟核處理器是Altera公司開發,基于FPGA操作平臺使用的一款高速處理器,為了適應高速運動圖像采集,提出了一種基于NiosII軟核處理的步進電機接口設計,使用verilog HDL語言完成該接口設計,最后通過QuartusII軟件,給出了實驗仿真結果。

    標簽: NiosII 軟核處理器 步進電機 接口設計

    上傳時間: 2014-12-28

    上傳用戶:jiwy

  • wp379 AXI4即插即用IP

    In the past decade, the size and complexity of manyFPGA designs exceeds the time and resourcesavailable to most design teams, making the use andreuse of Intellectual Property (IP) imperative.However, integrating numerous IP blocks acquiredfrom both internal and external sources can be adaunting challenge that often extends, rather thanshortens, design time. As today's designs integrateincreasing amounts of functionality, it is vital thatdesigners have access to proven, up-to-date IP fromreliable sources.

    標簽: AXI4 379 wp 即插即用

    上傳時間: 2013-11-15

    上傳用戶:lyy1234

  • UG157 LogiCORE IP Initiator/Ta

    UG157 - LogiCORE™ IP Initiator/Target v3.1 for PCI™ 入門指南

    標簽: Initiator LogiCORE 157 UG

    上傳時間: 2013-11-06

    上傳用戶:ewtrwrtwe

  • 基于多核DSP的SDIF雷達信號分選算法實現

    針對實際應用中電子戰設備對雷達信號分選的實時性要求,在分析了序列差直方圖算法和多核DSP任務并行模式的基礎上,設計了基于TMS320C6678的八核DSP雷達信號分選電路,對密集的雷達信號進行分選。實驗結果表明:該電路可對常規雷達信號實現快速分選,并且分選效果良好,系統可靠性高。

    標簽: SDIF DSP 多核 雷達信號分選

    上傳時間: 2013-10-16

    上傳用戶:攏共湖塘

  • VS1003 網絡IP電話方案

    隨著多媒體時代的深入,各種令人眼花繚亂的視頻顯示技術迅猛發展,與此同時,層出不窮的新興應用也對產品音頻性能提出了更高的要求,比如用電腦直接撥打IP電話、進行視頻會議、儀器操作語音控制等場合都需要高質量的語音效果。在市場推動下,不僅傳統模擬與混合信號器件供應商繼續深耕不懈,一些新進入該領域的公司也推出多種創新性方案應對市場需求。本文提出了利用ARM7微控制器,uC/OS-II實時操作系統和DSP處理內核的音頻處理芯片的音頻處理方案。該方案能有效改善音質,提供清晰、自然的語音。 音頻方面LPC2214+VS1003

    標簽: 1003 VS IP電話 網絡

    上傳時間: 2013-10-14

    上傳用戶:1318695663

  • IP防護等級說明

    介紹IP等級的結構及用法

    標簽: IP防護等級

    上傳時間: 2013-11-08

    上傳用戶:huxiao341000

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