專輯類-網絡及電腦相關專輯-114冊-4.31G TCP-Ip技術大全-71.6M-PDF.zIp
標簽： TCP-Ip M-PDF 71.6 zIp
上傳時間： 2013-04-24
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專輯類-網絡及電腦相關專輯-114冊-4.31G TCP-Ip詳解.CISCO詳解-273M.zIp
標簽： TCP-Ip CISCO 273 zIp
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專輯類-網絡及電腦相關專輯-114冊-4.31G Ip地址管理與子網劃分-5.3M-PDF.zIp
標簽： M-PDF 5.3 zIp Ip地址
上傳時間： 2013-07-21
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專輯類-網絡及電腦相關專輯-114冊-4.31G 高級網絡操作系統(tǒng)及其應用——TCP~Ip協(xié)議與分組無線網-10.1M-PDF.pdf
標簽： M-PDF 10.1 TCP
上傳時間： 2013-06-22
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專輯類-網絡及電腦相關專輯-114冊-4.31G 移動Ip技術指南-7.7M-PDF.zIp
標簽： M-PDF 7.7 zIp 移動
上傳時間： 2013-06-17
上傳用戶：huyanju
隨著計算機及其外圍設備的發(fā)展，傳統(tǒng)的并行接口和串行接口在靈活性和接口擴展等方面存在的缺陷愈來愈不可回避，并逐漸成為計算機通信的瓶頸。在這種情況下，通用串行總線(Universal Serial Bus，USB)誕生了。USB由于具有傳輸速率高、價格便宜、使用方便、靈活性高、支持熱插拔、接口標準化和易于擴展等優(yōu)點，目前已經成為計算機外設接口的主流技術，在計算機外圍設備和消費類電子領域正獲得越來越多的應用。 @@ 本文基于USB2．0協(xié)議規(guī)范，設計了一款支持高速和全速傳輸的USB2．0設備控制器Ip核。文中著重介紹了這款設備控制器Ip核的設計和FPGA驗證工作，詳細研究并分析了USB2．0規(guī)范，根據規(guī)范提出了一種USB2．0設備控制器整體構架方案，描述了各個功能子模塊硬件電路的功能及實現。從可重用的角度出發(fā)，對設備控制器模塊進行優(yōu)化設計，增加多個靈活的配置選項，根據不同的應用對硬件進行配置，使其在滿足要求的情況下去除冗余電路，以減少占用面積和功耗，從而使其靈活地應用于各種USB系統(tǒng)。本文還研究了Ip核的驗證方法，并對所設計的USB2．0設備控制器建立了功能完備的ModelSim仿真驗證環(huán)境，搭建了FPGA硬件驗證平臺，設計了具有AHB接口的設備控制器和帶有8051的設備控制器，并分別在FPGA平臺上進行了功能驗證。 @@ 本文所設計的USB2．0設備控制器Ip核可配置性高，使用者可以自由配置所需端點的個數以及每個端點類型等，可以集成于多種USB系統(tǒng)中，適于各類USB設備的開發(fā)。本課題所取得的成果為USB2．0設備類的研究和開發(fā)積累了經驗，并為后來實驗室某項目測試芯片的USB數據采集提供了參考方案，也為未來USB3．0接口Ip核的開發(fā)和應用奠定了基礎。 @@關鍵詞USB2．0控制器；Ip核；FPGA；驗證
標簽： FPGA USB 20
上傳時間： 2013-06-30
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DDR2 SDRAM是目前內存市場上的主流內存。除了通用計算機系統(tǒng)外，大量的嵌入式系統(tǒng)也紛紛采用DDR2內存，越來越多的SoC系統(tǒng)芯片中會集成有DDR2接口模塊。因此，設計一款匹配DDR2的內存控制器將會具有良好的應用前景。 論文在研究了DDR2的JEDEC標準的基礎上，設計出DDR2控制器的整體架構，采用自項向下的設計方法和模塊化的思想，將DDR2控制器劃分為若干模塊，并使用Verilog HDL語言完成DDR2控制器Ip軟核中初始化模塊、配置模塊、執(zhí)行模塊和數據通道模塊的RTL級設計。根據在設計中遇到的問題，對DDR2控制器的整體架構進行改進與完善。在分析了Altera數字PHY的基本性能的基礎上，設計DDR2控制器與數字PHY的接口模塊。搭建DDR2控制器Ip軟核的仿真驗證平臺，針對設計的具體功能進行仿真驗證，并實現在Altera Stratix II GX90開發(fā)板上對DDR2存儲芯片基本讀/寫操作控制的FPGA功能演示。 論文設計的DDR2控制器的主要特點是： 1.支持數字PHY電路，不需要實際的硬件電路就完成DDR2控制器與DDR2存儲芯片之間的物理層接口，節(jié)約了設計成本，縮小了硬件電路的體積。 2.將配置口從初始化模塊中分離出來，簡化了具體操作。 3.支持多個DDR2存儲芯片，使得DDR2控制器的應用范圍更為廣闊。 4.支持DDR2的三項新技術，充分發(fā)揮DDR2內存的特性。 5.自動DDR2刷新控制，方便用戶對DDR2內存的控制。
標簽： DDR2 FPGA 控制器
上傳時間： 2013-06-10
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當前，片上系統(tǒng)(SOC)已成為系統(tǒng)實現的主流技術。流片風險與費用增加、上市時間壓力加大、產品功能愈加復雜等因素使得SOC產業(yè)逐漸劃分為Ip提供者、SOC設計服務者和芯片集成者三個層次。SOC設計已走向基于Ip集成的平臺設計階段，經過嚴格驗證質量可靠的Ip核成為SOC產業(yè)中的重要一環(huán)。 GPIB控制器芯片是組建自動測試系統(tǒng)的核心，在測試領域應用廣泛。本人通過查閱大量的技術資料，分析了集成電路在國內外發(fā)展的最新動態(tài)，提出了基于FPGA的自主知識產權的GPIB控制器Ip核的設計和實現。 本文首先討論了基于FPGA的GPIB控制器的背景意義，接著對FPGA開發(fā)所具備的基本知識作了簡要介紹。文中對GPIB總線進行了簡單的描述，根據芯片設計的主要思想，重點在于論述怎樣用FPGA來實現IEEE-488.2協(xié)議，并詳細闡述了GPIB控制器的十種接口功能及其狀態(tài)機的Ip核實現。同時，對數據通路也進行了較為細致的說明。在設計的時候采用基于模塊化設計思想，用VerilogHDL語言完成各模塊功能描述，通過Synplifv軟件的綜合，用Modelsim對設計進行了前、后仿真。最后利用生成的模塊符號采取類似畫電路圖的方法完成整個系統(tǒng)芯片的lP軟核設計，并用EDA工具下載到了FPGA上。 為了更好地驗證設計思想，借助EDA工具對GPIB控制器的工作狀態(tài)進行了軟件仿真，給出仿真結果，仿真波形驗證了GPIB控制器的工作符合預想。最后，本文對基于FPGA的GPIB控制器的Ip核設計過程進行了總結，展望了當前GPIB控制器設計的發(fā)展趨勢，指出了開展進一步研究需要做的工作。
標簽： FPGA GPIB 控制器
上傳時間： 2013-06-12
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當前，隨著電子技術的飛速發(fā)展，智能化系統(tǒng)中需要傳輸的數據量日益增大，要求數據傳送的速度也越來越快，傳統(tǒng)的數據傳輸方式已無法滿足目前的要求。在此前提下，采用高速數據傳輸技術成為必然，DMA(直接存儲器訪問)技術就是較理想的解決方案之一，能夠滿足信息處理實時性和準確性的要求。 本文以EDA工具、硬件描述語言和可編程邏輯器件(FPGA)為技術支撐，設計DMA控制器的總體結構。在通道檢測模塊中，解決了信號抗干擾和請求信號撤銷問題，并提出并行通道檢測算法；在優(yōu)先級管理模塊中提出了動態(tài)優(yōu)先級端口響應機制；在傳輸模塊中采用狀態(tài)機的設計思想設計多個通道的數據傳輸。通過各模塊問題的解決及新方法的采用，最終設計出基于FPGA的多通道DMA控制器的Ip軟核。實驗仿真結果表明，本控制器傳輸速度較快，主頻達100MHz以上，且工作穩(wěn)定。
標簽： FPGA DMA 多通道
上傳時間： 2013-05-16
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單片微型計算機(單片機)是將微處理器CPU、程序存儲器、數據存儲器、定時/計數器、輸入/輸出并行接口等集成在一起。由于單片機具有專門為嵌入式系統(tǒng)設計的體系結構與指令系統(tǒng)，所以它最能滿足嵌入式系統(tǒng)的應用要求。Intel公司生產的MCS-51系列單片機是我國目前應用最廣的單片機之一。 隨著可編程邏輯器件設計技術的發(fā)展，每個邏輯器件中門電路的數量越來越多，一個邏輯器件就可以完成本來要由很多分立邏輯器件和存儲芯片完成的功能。這樣做減少了系統(tǒng)的功耗和成本，提高了性能和可靠性。FPGA就是目前最受歡迎的可編程邏輯器件之一。Ip核是將一些在數字電路中常用但比較復雜的功能塊，設計成可修改參數的模塊，讓其他用戶可以直接調用這些模塊，這樣就大大減輕了工程師的負擔，避免重復勞動。隨著FPGA的規(guī)模越來越大，設計越來越復雜，使用Ip核是一個發(fā)展趨勢。 本課題結合FPGA與8051單片機的優(yōu)點，主要針對以下三個方面研究： (1)FPGA開發(fā)平臺的硬件實現選用Xilinx公司的XC3S500E-PQ208-4-C作為核心器件，采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作為片內程序存儲器，搭建FPGA的硬件開發(fā)平臺。 (2)用VHDL語言實現8051Ip核分析研究8051系列單片機內部各模塊結構以及各部分的連接關系，實現了基于FPGA的8051Ip核。主要包括如下幾個模塊：CPU模塊、片內數據存儲器模塊、定時/計數器模塊、并行端口模塊、串行端口模塊、中斷處理模塊、同步復位模塊等。 (3)基于FPGA的8051Ip核應用用所設計的8051Ip核，實現了對一個4×4鍵盤的監(jiān)測掃描、鍵盤確認、按鍵識別等應用。
標簽： FPGA 8051 單片機
上傳時間： 2013-06-21
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