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SIMATIC WinCC V6.0 SP3 增加了一些重要的系統功能，可通過工廠智能選件，實現過程可視化和過程優化：l 數據評估功能實現在線分析- 分析過程值歸檔的統計函數- 曲線線條寬度、工具提示以及對數形式表示都可自由組態- 消息順序列表可以按欄標題進行分類l WinCC/Web Navigator V6.1- 基本過程控件－支持 Web- 支持操作員消息 SIMATIC®WinCC®可以在Windows下為所有工業領域提供全面的SCADA功能，包括單用戶系統、配有冗余服務器的分布式多用戶系統，以及使用Web客戶機的跨現場解決方案。WinCC 的信息交換功能可實現跨公司的垂直集成。
上傳時間： 2013-11-13
上傳用戶：tiantwo
1．實驗要求 l 實驗目的： （1）進一步掌握指針、異常處理的使用； （2）掌握棧的操作的實現方法； （3）培養使用棧解決實際問題的能力 l 實驗內容：利用棧實現迷宮求解問題，具體要求如下： （1）可以使用遞歸或非遞歸兩種方法實現； （2）老鼠能夠記住自己的路，不會反復走重復的路徑； （3）可以自己任意設置起點； （4）必須要有異常處理，比如輸入參數錯誤時應拋出異常 2. 程序分析 2.1 存儲結構 該程序采用棧的順序存儲結構，利用一組地址連續的存儲單元依次存放老鼠在迷宮中的每一步路徑，由于棧的插入和刪除只能在棧頂實現，因此，每前進一步，表示該點的數組元素入棧，棧頂指針top+1；每后退一步，表示原來點的數組元素出棧，top-1。棧的操作示意如圖(a)所示： 圖(a) 棧的操作示意圖
上傳時間： 2013-11-08
上傳用戶：jasonheung
買的開發板上帶的52個應用于實物的程序，希望對大家有幫助
上傳時間： 2013-11-04
上傳用戶：xymbian
當許多編程人員從事這項工作但又不使用源代碼管理工具時，源代碼管理幾乎不可能進行。Visual SourceSafe是Visual Basic的企業版配備的一個工具，不過這個工具目的是為了保留一個內部應用版本，不向公眾發布（應當說明的是，M i c r o s o f t并沒有開發Visual SourceSafe，它是M i c r o s o f t公司買來的） 。雖然Visual SourceSafe有幫助文本可供參考，但該程序的一般運行情況和在生產環境中安裝 Visual SourceSafe的進程都沒有詳細的文字說明。另外，Visual SourceSafe像大多數M i c r o s o f t應用程序那樣經過了很好的修飾，它包含的許多功能特征和物理特征都不符合 Microsoft Wi n d o w s應用程序的標準。例如，Visual SourceSafe的三個組件之一（Visual SourceSafe Administrator）甚至連F i l e菜單都沒有。另外，許多程序的菜單項不是放在最合適的菜單上。在程序開發環境中實現Visual SourceSafe時存在的復雜性，加上它的非標準化外觀和文檔資料的不充分，使得許多人無法實現和使用 Visual SourceSafe。許多人甚至沒有試用 Vi s u a l S o u r c e S a f e的勇氣。我知道許多高水平技術人員無法啟動Visual SourceSafe并使之運行，其中有一位是管理控制系統項目師。盡管如此，Visual SourceSafe仍然不失為一個很好的工具，如果你花點時間將它安裝在你的小組工作環境中，你一定會為此而感到非常高興。在本章中我并不是為你提供一些指導原則來幫助你創建更好的代碼，我的目的是告訴你如何使用工具來大幅度減少管理大型項目和開發小組所需的資源量，這個工具能夠很容易處理在沒有某種集成式解決方案情況下幾乎無法處理的各種問題。
上傳時間： 2013-10-24
上傳用戶：lgd57115700
許多L i n u x操作系統的用戶是因為喜歡編程而選擇這個操作系統的，而另外的一些人通過學習更多與他們工作有關的知識，通過為他們的系統編譯自己下載來的源代碼，也逐步成長為跨越了初級水平的程序員。對編程了解得越深，就越能體會到它對自己的重要性，就更能掌握如何對之進行升級，因為終究會有一天，用戶自己下載的源代碼就會要求用戶使用它們。
上傳時間： 2014-05-04
上傳用戶：止絮那夏
創新、效能、卓越是ADI公司的文化支柱。作為業界公認的全球領先數據轉換和信號調理技術領先者，我們除了提供成千上萬種產品以外，還開發了全面的設計工具，以便客戶在整個設計階段都能輕松快捷地評估電路。
上傳時間： 2013-11-25
上傳用戶：kachleen
12864液晶時鐘顯示程序 LCD 地址變量 ;**************變量的定義***************** RS BIT P2.0 ;LCD數據/命令選擇端(H/L) RW BIT P2.1 ;LCD讀/寫選擇端(H/L) EP BIT P2.2 ;LCD使能控制 PSB EQU P2.3 RST EQU P2.5 PRE BIT P1.4 ;調整鍵(K1) ADJ BIT P1.5 ;調整鍵(K2) COMDAT EQU P0 LED EQU P0.3 YEAR DATA 18H ;年,月,日變量 MONTH DATA 19H DATE DATA 1AH WEEK DATA 1BH HOUR DATA 1CH ;時,分,秒,百分之一秒變量 MIN DATA 1DH SEC DATA 1EH SEC100 DATA 1FH STATE DATA 23H LEAP BIT STATE.1 ;是否閏年標志1--閏年，0--平年 KEY_S DATA 24H ;當前掃描鍵值 KEY_V DATA 25H ;上次掃描鍵值 DIS_BUF_U0 DATA 26H ;LCD第一排顯示緩沖區 DIS_BUF_U1 DATA 27H DIS_BUF_U2 DATA 28H DIS_BUF_U3 DATA 29H DIS_BUF_U4 DATA 2AH DIS_BUF_U5 DATA 2BH DIS_BUF_U6 DATA 2CH DIS_BUF_U7 DATA 2DH DIS_BUF_U8 DATA 2EH DIS_BUF_U9 DATA 2FH DIS_BUF_U10 DATA 30H DIS_BUF_U11 DATA 31H DIS_BUF_U12 DATA 32H DIS_BUF_U13 DATA 33H DIS_BUF_U14 DATA 34H DIS_BUF_U15 DATA 35H DIS_BUF_L0 DATA 36H ;LCD第三排顯示緩沖區 DIS_BUF_L1 DATA 37H DIS_BUF_L2 DATA 38H DIS_BUF_L3 DATA 39H DIS_BUF_L4 DATA 3AH DIS_BUF_L5 DATA 3BH DIS_BUF_L6 DATA 3CH DIS_BUF_L7 DATA 3DH DIS_BUF_L8 DATA 3EH DIS_BUF_L9 DATA 3FH DIS_BUF_L10 DATA 40H DIS_BUF_L11 DATA 41H DIS_BUF_L12 DATA 42H DIS_BUF_L13 DATA 43H DIS_BUF_L14 DATA 44H DIS_BUF_L15 DATA 45H FLAG DATA 46H ;1-年，2-月，3-日，4-時，5-分，6-秒，7-退出調整。 DIS_H DATA 47H DIS_M DATA 48H DIS_S DATA 49H
上傳時間： 2013-11-09
上傳用戶：xingisme
創新、效能、卓越是ADI公司的文化支柱。作為業界公認的全球領先數據轉換和信號調理技術領先者，我們除了提供成千上萬種產品以外，還開發了全面的設計工具，以便客戶在整個設計階段都能輕松快捷地評估電路。
上傳時間： 2013-10-18
上傳用戶：cxl274287265
網上瘋傳的Excel BOM經典腳本，相信諸位PADS用戶再熟悉不過了吧！ 但是它還有缺點： 1.元件封裝不能轉換。(元件位號為R/C/L的0402/063/0805/1206封裝自動轉換統一的對應封裝，以方便統計。) 2.元件參數轉換。(電阻的轉換0R時由0mR修正為0R,KR/MR修正為K/M。) 3.不能按元件的SMD屬性來分類統計。 4.有些公司在制作PADS庫元件時，已經為元件建立了Part ID。導出BOM時需要元件的Part ID屬性。 5.不能導出元件坐標。（本人改進導出元件幾何中心坐標，以便貼片生產之用。） 6.不能導出跳線。 7.不能支持WPS。 8.不能自定義導出元件的Part ID屬性。 9.不能自定義位號之間連接符號。 10.導出BOM特殊字符亂碼，比如常見的±/µ/Ω等。（PADS9.5在中文狀態下導出BOM就不會亂碼， 暫時還沒有更好的解決辦法，不過可以在Excel中替換解決。） 11.加載與運行腳本步驟繁冗；運行速度比較慢。（本人改進的代碼速度絕對不會比之前的慢。）
上傳時間： 2015-01-01
上傳用戶：rolypoly152
中文版詳情瀏覽：http://www.elecfans.com/emb/fpga/20130715324029.html Xilinx UltraScale:The Next-Generation Architecture for Your Next-Generation Architecture The Xilinx® UltraScale™ architecture delivers unprecedented levels of integration and capability with ASIC-class system- level performance for the most demanding applications. The UltraScale architecture is the industr y's f irst application of leading-edge ASIC architectural enhancements in an All Programmable architecture that scales from 20 nm planar through 16 nm FinFET technologies and beyond, in addition to scaling from monolithic through 3D ICs. Through analytical co-optimization with the X ilinx V ivado® Design Suite, the UltraScale architecture provides massive routing capacity while intelligently resolving typical bottlenecks in ways never before possible. This design synergy achieves greater than 90% utilization with no performance degradation. Some of the UltraScale architecture breakthroughs include: • Strategic placement (virtually anywhere on the die) of ASIC-like system clocks, reducing clock skew by up to 50% • Latency-producing pipelining is virtually unnecessary in systems with massively parallel bus architecture, increasing system speed and capability • Potential timing-closure problems and interconnect bottlenecks are eliminated, even in systems requiring 90% or more resource utilization • 3D IC integration makes it possible to build larger devices one process generation ahead of the current industr y standard • Greatly increased system performance, including multi-gigabit serial transceivers, I/O, and memor y bandwidth is available within even smaller system power budgets • Greatly enhanced DSP and packet handling The Xilinx UltraScale architecture opens up whole new dimensions for designers of ultra-high-capacity solutions.
標簽： UltraScale Xilinx 架構
上傳時間： 2013-11-21
上傳用戶：wxqman
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