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MATLab

MATLab是美國MathWorks公司出品的商業(yè)數(shù)學(xué)軟件,用于數(shù)據(jù)分析、無線通信、深度學(xué)習(xí)、圖像處理與計(jì)算機(jī)視覺、信號處理、量化金融與風(fēng)險(xiǎn)管理、機(jī)器人,控制系統(tǒng)等領(lǐng)域。[1]
  • 數(shù)字信號處理實(shí)驗(yàn)(MATLab版)課件

    數(shù)字信號處理實(shí)驗(yàn)(MATLab版)課件,ppt版本的

    標(biāo)簽: MATLab 數(shù)字信號處理 實(shí)驗(yàn)

    上傳時(shí)間: 2013-06-20

    上傳用戶:wweqas

  • 基本蛙跳程序MATLab

    基本蛙跳程序 MATLab/C混合蛙跳算法(SFLA)是一種基于群智能的亞啟發(fā)式進(jìn)化算法,并應(yīng)用于離散組合優(yōu)化問題的求解。該算法是又一種受自然界生物現(xiàn)象啟示而產(chǎn)生的基于群體的協(xié)同搜索方法。

    標(biāo)簽: MATLab 程序

    上傳時(shí)間: 2013-05-17

    上傳用戶:jing911003

  • MATLab金融工具箱操作

    描述MATLab金融工具箱的用法。是英文的,mathwork官方出口。

    標(biāo)簽: MATLab 金融 工具箱 操作

    上傳時(shí)間: 2013-05-30

    上傳用戶:han0097

  • MATLab 7.0

    MATLab 7.0是一個(gè)高級的矩陣/陣列語言,它包含控制語句、函數(shù)、數(shù)據(jù)結(jié)構(gòu)、輸入和輸出和面向?qū)ο缶幊烫攸c(diǎn)。用戶可以在命令窗口中將輸入語句與執(zhí)行命令同步,也可以先編寫好一個(gè)較大的復(fù)雜的應(yīng)用程序(M文件)后再一起運(yùn)行。新版本的MATLab 7.0語言是基于最為流行的C++語言基礎(chǔ)上的,因此語法特征與C++語言極為相似,而且更加簡單,更加符合科技人員對數(shù)學(xué)表達(dá)式的書寫格式。使之更利于非計(jì)算機(jī)專業(yè)的科技人員使用。而且這種語言可移植性好、可拓展性極強(qiáng),這也是MATLab 7.0能夠深入到科學(xué)研究及工程計(jì)算各個(gè)領(lǐng)域的重要原因

    標(biāo)簽: MATLab 7.0

    上傳時(shí)間: 2013-07-08

    上傳用戶:TF2015

  • MATLab中實(shí)現(xiàn)硬件FPGA

    MATLab中實(shí)現(xiàn)硬件FPGA

    標(biāo)簽: MATLab FPGA 硬件

    上傳時(shí)間: 2013-08-14

    上傳用戶:15736969615

  • MATLab建立模型設(shè)計(jì)fpga

    MATLab建立模型設(shè)計(jì)fpga,文章采用系統(tǒng)模型

    標(biāo)簽: MATLab fpga 模型設(shè)計(jì)

    上傳時(shí)間: 2013-08-14

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  • MATLab在fpga中的應(yīng)用的三個(gè)具體事例

    MATLab在fpga中的應(yīng)用的三個(gè)具體事例,。

    標(biāo)簽: MATLab fpga 中的應(yīng)用

    上傳時(shí)間: 2013-08-16

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  • Xilinx的FPGA 中的MATLab simulink建模

    Xilinx的FPGA 中的MATLab simulink建模,內(nèi)有幾種調(diào)制方式,比如QPSK等

    標(biāo)簽: simulink Xilinx MATLab FPGA

    上傳時(shí)間: 2013-08-16

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  • 無線通信的FPGA實(shí)現(xiàn)及MATLab程序

    無線通信的FPGA實(shí)現(xiàn)及MATLab程序

    標(biāo)簽: MATLab FPGA 無線通信 程序

    上傳時(shí)間: 2013-08-17

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  • 分析了MATLab/Simulink 中DSP Builder 模塊庫在FPGA 設(shè)計(jì)中優(yōu)點(diǎn)

    分析了MATLab/Simulink 中DSP Builder 模塊庫在FPGA 設(shè)計(jì)中優(yōu)點(diǎn),\\r\\n然后結(jié)合FSK 信號的產(chǎn)生原理,給出了如何利用DSP Builder 模塊庫建立FSK 信號發(fā)生器模\\r\\n型,以及對FSK 信號發(fā)生器模型進(jìn)行算法級仿真和生成VHDL 語言的方法,并在modelsim\\r\\n中對FSK 信號發(fā)生器進(jìn)行RTL 級仿真,最后介紹了在FPGA 芯片中實(shí)現(xiàn)FSK 信號發(fā)生器的設(shè)\\r\\n計(jì)方法。

    標(biāo)簽: Simulink Builder MATLab FPGA

    上傳時(shí)間: 2013-08-20

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