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MBUS主站接口模塊

  • 開(kāi)關(guān)電源共模EMI抑制技術(shù)研究.rar

    隨著電力電子技術(shù)的發(fā)展,開(kāi)關(guān)電源的小型化、高頻化成為趨勢(shì),其中各個(gè)部分工作時(shí)的電磁干擾問(wèn)題也越來(lái)越嚴(yán)重,因此開(kāi)關(guān)電源的電磁兼容性也越來(lái)越引起人們的重視。目前,軟開(kāi)關(guān)技術(shù)因其能減少開(kāi)關(guān)損耗和提高效率,在開(kāi)關(guān)電源中應(yīng)用越來(lái)越廣泛。本文的主要目的是針對(duì)開(kāi)關(guān)電源中的電磁干擾進(jìn)行分析,研究軟開(kāi)關(guān)技術(shù)對(duì)電磁干擾的影響,并且提出一種抑制共模干擾的濾波方法。 本文首先介紹了電磁兼容的定義、開(kāi)關(guān)電源EMI的特點(diǎn),論述了開(kāi)關(guān)電源中EMI的研究現(xiàn)狀。從電磁干擾的三要素出發(fā),介紹了開(kāi)關(guān)電源中電磁干擾的干擾源和干擾的耦合通路。分析了電感、電容、高頻變壓器等器件的高頻特性,并介紹了線性阻抗穩(wěn)定系統(tǒng)(LISN)的定義和作用。在了解了軟開(kāi)關(guān)基本概念的基礎(chǔ)上,本文以全橋變換器為對(duì)象,介紹了移相全橋ZVS的工作原理,分析了它在實(shí)現(xiàn)過(guò)程中對(duì)共模干擾的影響,并在考慮IGBT寄生電容的情況下,對(duì)其共模干擾通道進(jìn)行了分析。然后以UC3875為核心,設(shè)計(jì)了移相全橋ZVS的控制電路和主電路,實(shí)現(xiàn)了軟開(kāi)關(guān)。為了對(duì)共模干擾進(jìn)行抑制,本文提出了一種新型的有源和無(wú)源相結(jié)合的EMI濾波器,即無(wú)源部分采用匹配網(wǎng)絡(luò)法,將阻抗失配的影響降到最低;有源部分采用前饋控制,對(duì)共模電流進(jìn)行補(bǔ)償。 針對(duì)以上提出的問(wèn)題,本文通過(guò)Saber軟件對(duì)移相全橋ZVS進(jìn)行了仿真,并和硬開(kāi)關(guān)條件下的傳導(dǎo)干擾進(jìn)行了比較,得出了在高頻段,ZVS的共模干擾小于硬開(kāi)關(guān),在較低頻段改善不大,甚至更加嚴(yán)重,而差模干擾有較大衰減的結(jié)論。通過(guò)對(duì)混合濾波器進(jìn)行仿真,取得了良好的濾波效果,和傳統(tǒng)的無(wú)源EMI濾波器相比,在體積和重量上都有一定優(yōu)勢(shì)。

    標(biāo)簽: EMI 開(kāi)關(guān)電源

    上傳時(shí)間: 2013-05-28

    上傳用戶:iswlkje

  • 1553B總線接口技術(shù)研究及FPGA實(shí)現(xiàn).rar

    本論文在詳細(xì)研究MIL-STD-1553B數(shù)據(jù)總線協(xié)議以及參考國(guó)外芯片設(shè)計(jì)的基礎(chǔ)上,結(jié)合目前新興的EDA技術(shù)和大規(guī)模可編程技術(shù),提出了一種全新的基于FPGA的1553B總線接口芯片的設(shè)計(jì)方法。 從專用芯片實(shí)現(xiàn)的具體功能出發(fā),結(jié)合自頂向下的設(shè)計(jì)思想,給出了總線接口的總體設(shè)計(jì)方案,考慮到電路的具體實(shí)現(xiàn)對(duì)結(jié)構(gòu)進(jìn)行模塊細(xì)化。在介紹模擬收發(fā)器模塊的電路設(shè)計(jì)后,重點(diǎn)介紹了基于FPGA的BC、RT、MT三種類型終端設(shè)計(jì),最終通過(guò)工作方式選擇信號(hào)以及其他控制信號(hào)將此三種終端結(jié)合起來(lái)以達(dá)到通用接口的功能。同時(shí)給出其設(shè)計(jì)邏輯框圖、算法流程圖、引腳說(shuō)明以及部分模塊的仿真結(jié)果。為了資源的合理利用,對(duì)其中相當(dāng)部分模塊進(jìn)行復(fù)用。在設(shè)計(jì)過(guò)程中采用自頂向下、碼型轉(zhuǎn)換中的全數(shù)字鎖相環(huán)、通用異步收發(fā)器UART等關(guān)鍵技術(shù)。本設(shè)計(jì)使用VHDL描述,在此基礎(chǔ)之上采用專門的綜合軟件對(duì)設(shè)計(jì)進(jìn)行了綜合優(yōu)化,在FPGA芯片EP1K100上得以實(shí)現(xiàn)。通過(guò)驗(yàn)證證明該設(shè)計(jì)能夠完成BC/RT/MT三種模式的工作,能處理多種消息格式的傳輸,并具有較強(qiáng)的檢錯(cuò)能力。 最后設(shè)計(jì)了總線接口芯片測(cè)試系統(tǒng),選擇TMS320LF2407作為主處理器,測(cè)試主要包括主處理器的自發(fā)自收驗(yàn)證,加入RS232串口調(diào)試過(guò)程提高測(cè)試數(shù)據(jù)的直觀性。驗(yàn)證的結(jié)果表明本文提出的設(shè)計(jì)方案是合理的。

    標(biāo)簽: 1553B FPGA 總線接口

    上傳時(shí)間: 2013-06-04

    上傳用戶:ayfeixiao

  • 基于FPGA的全數(shù)字中頻接收機(jī)的研究與實(shí)現(xiàn).rar

    本論文基于直接擴(kuò)頻通信的理論設(shè)計(jì)了一種全數(shù)字的中頻接收機(jī),使用Xilinx公司的FPGA芯片xc3s400作為接收機(jī)的主芯片,實(shí)現(xiàn)中頻數(shù)字信號(hào)的下變頻,基帶解調(diào),PN碼的捕獲及跟蹤環(huán)路的設(shè)計(jì)并給出了它們的具體設(shè)計(jì)步驟及RTL級(jí)邏輯電路圖。本文對(duì)于數(shù)字下變頻器的設(shè)計(jì)、數(shù)字抑制載波恢復(fù)環(huán)的設(shè)計(jì)進(jìn)行了詳細(xì)的論述,還使用Matlab中的Simulink對(duì)本接收機(jī)系統(tǒng)所要使用的全數(shù)字Costas環(huán)進(jìn)行了功能仿真并給出了仿真結(jié)果。 本文使用高速模數(shù)轉(zhuǎn)換器AD9601對(duì)中頻模擬信號(hào)進(jìn)行采樣,最后再用高速數(shù)模轉(zhuǎn)換器AD9740還原出原始信息,并給出了它們與核心芯片xc3s400的接口設(shè)計(jì)方法及原理電路圖。

    標(biāo)簽: FPGA 全數(shù)字 中頻接收機(jī)

    上傳時(shí)間: 2013-07-30

    上傳用戶:weiwolkt

  • 基于FPGA的PCIE1接口設(shè)計(jì)與實(shí)現(xiàn).rar

    隨著現(xiàn)代計(jì)算機(jī)技術(shù)、微電子技術(shù)的進(jìn)一步結(jié)合和發(fā)展,可編程邏輯技術(shù)已成為當(dāng)前電子設(shè)計(jì)領(lǐng)域中最具活力和發(fā)展前途的技術(shù)。通過(guò)采用FPGA/EDA技術(shù),對(duì)通信卡的PCI接口、E1接口、外部邏輯電路進(jìn)行集成,并利用目前通用計(jì)算機(jī)強(qiáng)大的數(shù)字信息處理能力,可大大簡(jiǎn)化CTI硬件的設(shè)計(jì),降低制造成本,提高系統(tǒng)可靠性。 據(jù)此,本論文提出了基于FPGA/EDA技術(shù)的PCI-E1接口設(shè)計(jì)方法,文中對(duì)PCI總線接口、E1接口及兩接口的互連等相關(guān)技術(shù)進(jìn)行了深入分析,對(duì)各功能模塊和系統(tǒng)進(jìn)行了VHDL建模與仿真。 同時(shí),論文還介紹了基于ALTERACyclone系列FPGA芯片的PCI-E1接口硬件平臺(tái)的設(shè)計(jì)原理和基于DriverWorks的WDM驅(qū)動(dòng)程序的設(shè)計(jì)方法。 本論文涉及的軟件、硬件系統(tǒng)已經(jīng)開(kāi)發(fā)、調(diào)試完成。測(cè)試結(jié)果表明:1、論文所研究的PCI接口(主/從設(shè)備)在進(jìn)行配置讀/寫、I/O讀寫、存儲(chǔ)器讀寫及總線的猝發(fā)數(shù)據(jù)傳送等操作中,各項(xiàng)性能符合PCI2.3規(guī)范的要求。 2、論文所研究的E1接口支持成幀和不成幀兩種傳輸方式:在成幀模式下,信息的有效傳送速率為31×64Kbit/s;在不成幀的模式下,信息的有效傳送速率為2.048Mbit/s。E1輸出口各項(xiàng)參數(shù)符合CCITT相關(guān)規(guī)范要求。 3、論文所研究的PCI-E1接口在與現(xiàn)網(wǎng)設(shè)備、模塊的對(duì)接測(cè)試中,性能穩(wěn)定。基于本論文的產(chǎn)品已經(jīng)正式發(fā)布。國(guó)內(nèi)部分廠家已對(duì)該產(chǎn)品進(jìn)行了多方面的綜合測(cè)試,并計(jì)劃將其應(yīng)用到實(shí)際的生產(chǎn)和研究中。 本論文對(duì)于CTI硬件的設(shè)計(jì)是一項(xiàng)嘗試和革新。測(cè)試和應(yīng)用證明該方法行之有效,符合設(shè)計(jì)目標(biāo),具有較廣闊的應(yīng)用前景。

    標(biāo)簽: PCIE1 FPGA 接口設(shè)計(jì)

    上傳時(shí)間: 2013-06-02

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  • 基于ARM和GPRS的光纖直放站監(jiān)控系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    隨著通信技術(shù)飛速發(fā)展和直放站的廣泛應(yīng)用,直放站監(jiān)控系統(tǒng)在實(shí)時(shí)監(jiān)測(cè)直放站的工作狀態(tài)和遠(yuǎn)程控制方面發(fā)揮了重大作用,然而當(dāng)前的直放站監(jiān)控系統(tǒng)多采用單片機(jī)作為主控制器,通過(guò)GSM網(wǎng)絡(luò)或PSTN網(wǎng)絡(luò)傳輸監(jiān)控?cái)?shù)據(jù),隨著直放站監(jiān)控系統(tǒng)日益復(fù)雜化,目前的直放站監(jiān)控系統(tǒng)顯得處理速度慢,處理的任務(wù)有限,遠(yuǎn)程傳輸數(shù)據(jù)效率不高;為了改善當(dāng)前直放站監(jiān)控系統(tǒng)現(xiàn)有的這些缺點(diǎn),采用新的主控制器ARM7系列芯片,利用新的傳輸數(shù)據(jù)技術(shù)GPRS,設(shè)計(jì)并實(shí)現(xiàn)了一款光纖直放站監(jiān)控系統(tǒng)。 在充分研究當(dāng)前直放站監(jiān)控系統(tǒng)發(fā)展現(xiàn)狀和實(shí)現(xiàn)技術(shù)的基礎(chǔ)上,根據(jù)《中國(guó)移動(dòng)直放站監(jiān)控系統(tǒng)數(shù)據(jù)需求規(guī)范》對(duì)監(jiān)控參數(shù)和功能設(shè)置的要求,論證了光纖直放站監(jiān)控系統(tǒng)的整體設(shè)計(jì)方案和監(jiān)控終端的實(shí)現(xiàn)架構(gòu),選擇了PHILIPS的ARM7芯片LPC2134作為主控制器,選擇了SIMCOM300作為遠(yuǎn)程通信模塊;詳細(xì)介紹了光纖直放站監(jiān)控系統(tǒng)監(jiān)控終端的硬件電路設(shè)計(jì),闡釋了監(jiān)控終端嵌入軟件的設(shè)計(jì)思路流程,分析了如何把嵌入式軟件開(kāi)發(fā)技術(shù)和GPRS遠(yuǎn)程數(shù)據(jù)傳輸?shù)募夹g(shù)運(yùn)用到項(xiàng)目實(shí)踐中去,說(shuō)明了監(jiān)控系統(tǒng)中所用的通信協(xié)議,并且利用VC++開(kāi)發(fā)環(huán)境,采用SOCKET網(wǎng)絡(luò)編程技術(shù)和ADO數(shù)據(jù)庫(kù)開(kāi)發(fā)技術(shù),設(shè)計(jì)了光纖直放站監(jiān)控系統(tǒng)監(jiān)控中心應(yīng)用軟件。 經(jīng)過(guò)實(shí)驗(yàn)驗(yàn)證,該設(shè)備運(yùn)行結(jié)果良好,提高了光纖直放站的穩(wěn)定性和可靠性,光纖直放站監(jiān)控系統(tǒng)監(jiān)控終端處理任務(wù)的能力得到增強(qiáng),遠(yuǎn)程傳輸數(shù)據(jù)速度變快,傳輸數(shù)據(jù)所耗費(fèi)用降低,為光纖直放站系統(tǒng)的監(jiān)控提供了一種新的設(shè)計(jì)實(shí)現(xiàn)。

    標(biāo)簽: GPRS ARM 光纖直放站 監(jiān)控系統(tǒng)

    上傳時(shí)間: 2013-08-02

    上傳用戶:aa17807091

  • 基于HD61202U圖形液晶顯示模塊接口電路及編程

    從實(shí)際應(yīng)用的角度出發(fā)介紹了內(nèi)置HD61202 圖形液晶顯示模塊的結(jié)構(gòu)特性,液晶顯示模塊的硬件接口電路及編程要點(diǎn),并對(duì)其正常工作的條件、控制指令系統(tǒng)及編程思路進(jìn)行了探討。

    標(biāo)簽: 61202U 61202 HD 圖形液晶

    上傳時(shí)間: 2013-06-05

    上傳用戶:ywqaxiwang

  • 基于ARM和DSP的鐵路信號(hào)測(cè)試儀設(shè)計(jì)(DSP部分)

    UM71系列(包括ZPW-2000A)無(wú)絕緣軌道電路已成為我國(guó)鐵路的主流制式,軌道電路的正常工作對(duì)行車安全意義重大。軌道信號(hào)失真或者受到噪聲污染有可能導(dǎo)致鐵路信號(hào)設(shè)備錯(cuò)誤動(dòng)作進(jìn)而發(fā)生行車事故。通過(guò)對(duì)鐵路信號(hào)做出監(jiān)測(cè)以及判斷,可以幫助信號(hào)設(shè)備維護(hù)人員對(duì)故障設(shè)備進(jìn)行及時(shí)修復(fù)從而避免事故發(fā)生。 本文設(shè)計(jì)了一種基于ARM/DSP雙核結(jié)構(gòu)的鐵路信號(hào)測(cè)試儀,用以幫助設(shè)備維護(hù)人員及時(shí)檢修故障設(shè)備。其中,DSP芯片選用TI公司的32位浮點(diǎn)處理器TMS320VC33作為信號(hào)分析與處理的核心,實(shí)現(xiàn)信號(hào)的解調(diào)、頻譜分析和細(xì)化處理等功能。本測(cè)試儀作為一種實(shí)時(shí)的信號(hào)檢測(cè)設(shè)備,充分利用了浮點(diǎn)DSP芯片高效靈活以及系統(tǒng)可裁減的特性,因而更適合于現(xiàn)場(chǎng)環(huán)境的應(yīng)用。本測(cè)試儀主要針對(duì)目前使用較為廣泛的UM71、ZPW-2000A系統(tǒng)以及站內(nèi)25Hz相敏軌道電路,實(shí)現(xiàn)對(duì)移頻信號(hào)的數(shù)字解調(diào)、區(qū)間載波頻率檢測(cè)、信號(hào)幅度檢測(cè)、站內(nèi)軌道信號(hào)的相位角及其幅度檢測(cè)等功能。 本文著重分析了頻譜細(xì)化技術(shù)中的ZFFT算法在實(shí)時(shí)信號(hào)分析中的應(yīng)用,采用ZFFT算法可以在保證運(yùn)算效率的同時(shí)提高頻譜的分辨率。在此基礎(chǔ)上,本文就這種算法提出了若干改進(jìn)措施并且通過(guò)MATLAB對(duì)該算法及其改進(jìn)措施進(jìn)行了軟件仿真。同時(shí)本文完成了基于這種算法的DSP軟件設(shè)計(jì):為了提高系統(tǒng)實(shí)時(shí)性,DSP算法均采用匯編語(yǔ)言實(shí)現(xiàn)。理論分析和實(shí)驗(yàn)表明調(diào)制頻率的分辨率可以達(dá)到0.03Hz,滿足實(shí)際應(yīng)用要求。此外,本文設(shè)計(jì)了測(cè)試儀的硬件結(jié)構(gòu),主要是VC33的外圍器件及其與雙口RAMCY7C028的接口電路,以及基于這個(gè)接口電路的通信規(guī)程。

    標(biāo)簽: DSP ARM 鐵路信號(hào) 試儀設(shè)計(jì)

    上傳時(shí)間: 2013-06-29

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  • 12位4通道并行串行模數(shù)轉(zhuǎn)換芯片ADS7824的原理及應(yīng)用

    ADS7824是美國(guó)BB公司生產(chǎn)的12位開(kāi)關(guān)電容式逐次逼近型模/數(shù)轉(zhuǎn)換芯片.它具有與CPU的并行/串行接口,功耗低,片上資源豐富,接口靈活等特點(diǎn).文中詳細(xì)介紹了ADS7824的工作原理、引腳定義、工作

    標(biāo)簽: 7824 ADS 4通道 并行

    上傳時(shí)間: 2013-07-08

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  • 工具軟件\圖片漢字取模字庫(kù)生成查看套件

    5月1日凌晨發(fā)布第一測(cè)試版 功能介紹: 1.生成中英文數(shù)字混合的字符串的字模數(shù)據(jù). 2.可選擇字體,大小,并且可獨(dú)立調(diào)整文字的長(zhǎng)和寬,生成任意形狀的字符。 3.各種旋轉(zhuǎn),翻轉(zhuǎn)文字功能 4.任意調(diào)整輸出點(diǎn)陣大小,并任意調(diào)整字符在點(diǎn)陣中的位置。 5.字模數(shù)據(jù)輸出可自定義各種格式,系統(tǒng)預(yù)設(shè)了C語(yǔ)言和匯編語(yǔ)言兩種格式,并且可自己 定義出新的數(shù)據(jù)輸出格式;每行輸出數(shù)據(jù)個(gè)數(shù)可調(diào)。 6.支持四種取模方式:逐行(就是橫向逐行取點(diǎn)),逐列(縱向逐列取點(diǎn)),行列(先 橫向取第一行的8個(gè)點(diǎn)作為第一個(gè)字節(jié),然后縱向取第二行的8個(gè)點(diǎn)作為第二個(gè)字節(jié)……), 列行(先縱向取第一列的前8個(gè)點(diǎn)作為第一個(gè)字節(jié),然后橫向取第二列的前8個(gè)點(diǎn)作為第二個(gè) 字節(jié)……) 7.支持陰碼(亮點(diǎn)為1),陽(yáng)碼(亮點(diǎn)為0)取模 8.支持縱向(第一位為低位)(,倒向第一位為高位)取模 9.輸出數(shù)制可選16進(jìn)制或10進(jìn)制 10.可生成索引文件,用于在生成的大量字庫(kù)中可快速檢索到需要的漢字 11.動(dòng)態(tài)液晶面板彷真,可調(diào)節(jié)彷真面板象素點(diǎn)大小和顏色 12.圖形模式下可任意用鼠標(biāo)作畫,左鍵畫圖,右鍵擦圖。 12.旋轉(zhuǎn),翻轉(zhuǎn),平移等字符模式下的功能也可用與對(duì)BMP圖象的處理 版本為pctolcd1.94 5月1日晚上發(fā)布第二測(cè)試版 更新如下: 1.增加鎖定點(diǎn)陣大小功能,例如可鎖定24X24點(diǎn)陣大小,然后調(diào)節(jié)獨(dú)立調(diào)節(jié)字點(diǎn)陣的大小 2.增加熱鍵功能,可用光標(biāo)配合Ctrl,Shift對(duì)文字大小和位置修改 3.增加精簡(jiǎn)輸出格式選項(xiàng) 4.把文字輸入框換成了文字輸入組合框,這樣就可以保存歷史紀(jì)錄。 5.輸出數(shù)據(jù)會(huì)自動(dòng)清除以前的數(shù)據(jù) 6.可隱藏自定義格式,簡(jiǎn)化操作 7.一些小的BUG修正。 版本為pctolcd2.03 5月3日凌晨發(fā)布第三測(cè)試版 更新如下: 1.增加了一些小東西,例如演示動(dòng)畫一類的,我懶的一一寫了 2.改掉一些可惡的小BUG,例如點(diǎn)陣輸入框的自動(dòng)完成。 3.增加大量文字處理和導(dǎo)入TXT文本文件功能,并且可以去除文本中的空白和重復(fù)字符, 可以對(duì)文本進(jìn)行排序,適合于生成小字庫(kù)。我這里測(cè)試是3萬(wàn)多字的TXT文件在2分鐘內(nèi)轉(zhuǎn)成16X16點(diǎn)陣的字庫(kù)文件。 版本號(hào)為pctolcd2.53 由于本軟件側(cè)重于對(duì)字符的處理,所以在圖象方面功能較弱,請(qǐng)見(jiàn)晾。 5月8日發(fā)布正式版 正式版已經(jīng)開(kāi)始朝著液晶字庫(kù)生成軟件的方向進(jìn)化了,我在后來(lái)的更新中把主要精力也放 在這部分,由于我目前還沒(méi)有發(fā)現(xiàn)有同類的軟件具備這個(gè)功能,也無(wú)法得到任何的參考,只能 自己摸索前進(jìn),所以如果還有不方便的地方請(qǐng)大家多提意見(jiàn). 具體更新如下: 1.重寫大部分的內(nèi)核代碼以配合漢字庫(kù)生成的功能,目前這個(gè)內(nèi)核已經(jīng)進(jìn)行了反復(fù)的測(cè)試, 相信穩(wěn)定性和速度較前一版本有了巨大的提高. 2.去掉那個(gè)比較愚蠢的熱鍵區(qū)了,因?yàn)橛锰幉淮? 3.增加漢字庫(kù)生成功能,這是最重要的改進(jìn)之處,下文將詳細(xì)介紹. 4.修正許多小BUG,使軟件更加成熟些. 5月12日發(fā)布完美版 這次發(fā)布的PCtoLCD2002完美版與前一版本相比沒(méi)有增加太多的功能,因?yàn)槲矣X(jué)得現(xiàn)有的這些功能已經(jīng)足夠用于生成各種字模的需要了,所以完美版的主要工作是反復(fù)測(cè)試,精心去除各種BUG,以及調(diào)節(jié)一些細(xì)微之處,目的當(dāng)然就是追求完美!不過(guò)世上不會(huì)有真正完美的東西,這個(gè)軟件也不例外,而且這個(gè)軟件從頭至尾全部是我一個(gè)人編寫完成,精力有限,難免會(huì)顧此失彼,如果大家發(fā)現(xiàn)了這個(gè)版本中存在的BUG,請(qǐng)及時(shí)告訴我。 更新說(shuō)明: 1。界面采用新的字體,不會(huì)再有那種難看的黑色粗體字,比以前的要漂亮多了。 2。加入全面的提示幫助,盡量減少普通用戶的各種疑惑。 3。修正生成文件的擴(kuò)展名的一些BUG,不會(huì)總是加上FON的擴(kuò)展名了。 4。修正生成字模數(shù)據(jù)的一些格式BUG,現(xiàn)在生成的C51格式字模數(shù)據(jù)基本上可以直接粘貼到源程序中使用而不需要修改了 5。加入新的字模數(shù)據(jù)格式調(diào)整項(xiàng),允許用戶更自由的定制自己需要的數(shù)據(jù)格式 6。最重要的更新:全面支持保存當(dāng)前設(shè)置功能,用戶設(shè)置的字模格式,主窗口狀態(tài)和字庫(kù)生成窗口選項(xiàng)信息均可保存,下一次打開(kāi)窗口時(shí)不用重新設(shè)置。 7。修正了新建圖象時(shí)會(huì)自動(dòng)跳到圖形模式的BUG 8。增加輸出緊湊格式數(shù)據(jù)選項(xiàng),可以生成不包含空白行的字模數(shù)據(jù)。 9。完善了每行數(shù)據(jù)顯示個(gè)數(shù)的功能,可以任意設(shè)置每行顯示的數(shù)據(jù)個(gè)數(shù),并同時(shí)可以設(shè)置每行索引數(shù)據(jù)顯示個(gè)數(shù)。 10。修正了取模說(shuō)明的一些錯(cuò)誤,并改動(dòng)了格式。 11。現(xiàn)在當(dāng)用戶選擇10進(jìn)制輸出時(shí),會(huì)自動(dòng)去掉生成字模數(shù)據(jù)前的“0x",或后面的“H”,選擇16進(jìn)制時(shí)則會(huì)自動(dòng)加上。 12。對(duì)各個(gè)窗體重新設(shè)計(jì)以全面適應(yīng)最大化的需要,如果您覺(jué)得當(dāng)前窗口不夠大,可以最大化使用。 13。增加生成英文點(diǎn)陣字庫(kù)功能,可自動(dòng)生成ASCII碼從0-127的任意點(diǎn)陣字庫(kù),使用方法同生成國(guó)標(biāo)點(diǎn)陣字庫(kù)功能。 14。再次優(yōu)化代碼,去掉各種調(diào)試信息,使程序速度再快一些。 15。還有許多細(xì)微的調(diào)整我記不清了…… 需要注意的地方: 在測(cè)試的過(guò)程中我發(fā)現(xiàn)了一個(gè)問(wèn)題:在WIN98或WINME下當(dāng)用戶直接生成特大點(diǎn)陣的字模時(shí)(例如320*320,1024*768的漢字字模),此時(shí)由于數(shù)據(jù)量非常龐大,而WIN98/WINME會(huì)有64K的數(shù)據(jù)容量限制,所以在主窗口中是無(wú)法得到全部的字模數(shù)據(jù)的,這時(shí)您需要使用字庫(kù)生成功能,通過(guò)形成一個(gè)數(shù)據(jù)文件才能得到完整的字模數(shù)據(jù)。 我認(rèn)為到現(xiàn)在這個(gè)軟件功能已經(jīng)很完善了,但可能使用上有點(diǎn)不方便,如果你有什么不明白 的地方,可以發(fā)帖子或發(fā)MAIL詢問(wèn)

    標(biāo)簽: 軟件 漢字 取模 字庫(kù)

    上傳時(shí)間: 2013-07-26

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  • 基于FPGA的PCIE1接口設(shè)計(jì)與實(shí)現(xiàn)

    隨著現(xiàn)代計(jì)算機(jī)技術(shù)、微電子技術(shù)的進(jìn)一步結(jié)合和發(fā)展,可編程邏輯技術(shù)已成為當(dāng)前電子設(shè)計(jì)領(lǐng)域中最具活力和發(fā)展前途的技術(shù)。通過(guò)采用FPGA/EDA技術(shù),對(duì)通信卡的PCI接口、E1接口、外部邏輯電路進(jìn)行集成,并利用目前通用計(jì)算機(jī)強(qiáng)大的數(shù)字信息處理能力,可大大簡(jiǎn)化CTI硬件的設(shè)計(jì),降低制造成本,提高系統(tǒng)可靠性。 據(jù)此,本論文提出了基于FPGA/EDA技術(shù)的PCI-E1接口設(shè)計(jì)方法,文中對(duì)PCI總線接口、E1接口及兩接口的互連等相關(guān)技術(shù)進(jìn)行了深入分析,對(duì)各功能模塊和系統(tǒng)進(jìn)行了VHDL建模與仿真。 同時(shí),論文還介紹了基于ALTERACyclone系列FPGA芯片的PCI-E1接口硬件平臺(tái)的設(shè)計(jì)原理和基于DriverWorks的WDM驅(qū)動(dòng)程序的設(shè)計(jì)方法。 本論文涉及的軟件、硬件系統(tǒng)已經(jīng)開(kāi)發(fā)、調(diào)試完成。測(cè)試結(jié)果表明:1、論文所研究的PCI接口(主/從設(shè)備)在進(jìn)行配置讀/寫、I/O讀寫、存儲(chǔ)器讀寫及總線的猝發(fā)數(shù)據(jù)傳送等操作中,各項(xiàng)性能符合PCI2.3規(guī)范的要求。 2、論文所研究的E1接口支持成幀和不成幀兩種傳輸方式:在成幀模式下,信息的有效傳送速率為31×64Kbit/s;在不成幀的模式下,信息的有效傳送速率為2.048Mbit/s。E1輸出口各項(xiàng)參數(shù)符合CCITT相關(guān)規(guī)范要求。 3、論文所研究的PCI-E1接口在與現(xiàn)網(wǎng)設(shè)備、模塊的對(duì)接測(cè)試中,性能穩(wěn)定。基于本論文的產(chǎn)品已經(jīng)正式發(fā)布。國(guó)內(nèi)部分廠家已對(duì)該產(chǎn)品進(jìn)行了多方面的綜合測(cè)試,并計(jì)劃將其應(yīng)用到實(shí)際的生產(chǎn)和研究中。 本論文對(duì)于CTI硬件的設(shè)計(jì)是一項(xiàng)嘗試和革新。測(cè)試和應(yīng)用證明該方法行之有效,符合設(shè)計(jì)目標(biāo),具有較廣闊的應(yīng)用前景。

    標(biāo)簽: PCIE1 FPGA 接口設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

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