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Mti

  • 闡述了地面和機(jī)載雷達(dá)的兩種雜波抑制手段：Mti和MTD。很有用的東西

    闡述了地面和機(jī)載雷達(dá)的兩種雜波抑制手段：Mti和MTD。很有用的東西

    標(biāo)簽： Mti MTD 機(jī)載雷達(dá) 雜波

    上傳時(shí)間： 2014-11-16

    上傳用戶：jkhjkh1982

  • Mti國(guó)外經(jīng)典算法書籍,c++語(yǔ)言實(shí)現(xiàn)

    Mti國(guó)外經(jīng)典算法書籍,c++語(yǔ)言實(shí)現(xiàn)

    標(biāo)簽： Mti 算法 書籍 語(yǔ)言

    上傳時(shí)間： 2015-09-04

    上傳用戶：haohaoxuexi

  • Natural Language Processing Mti的研究生筆記～ 得來不易啊

    Natural Language Processing Mti的研究生筆記～ 得來不易啊

    標(biāo)簽： Processing Language Natural Mti

    上傳時(shí)間： 2015-09-12

    上傳用戶：myworkpost

  • Mti雷達(dá)（動(dòng)目標(biāo)檢測(cè)雷達(dá)）能夠抑制雜波保留目標(biāo)信號(hào)

    Mti雷達(dá)（動(dòng)目標(biāo)檢測(cè)雷達(dá)）能夠抑制雜波保留目標(biāo)信號(hào)，本人提供了單延遲線Mti對(duì)消器頻響，雙延遲線Mti對(duì)消器頻響，利用參差重頻消除盲速影響，討論Mti雷達(dá)參差比取不同的值對(duì)盲速的影響的matlab仿真源代碼。

    標(biāo)簽： Mti 雷達(dá) 動(dòng)目標(biāo)檢測(cè) 信號(hào)

    上傳時(shí)間： 2013-12-25

    上傳用戶：kristycreasy

  • 用simulink作的Mti高通濾波器的仿真程序

    用simulink作的Mti高通濾波器的仿真程序，其中輸入信號(hào)為高斯色噪聲，可以對(duì)輸出作時(shí)域和頻域分析。

    標(biāo)簽： simulink Mti 高通濾波器 仿真程序

    上傳時(shí)間： 2016-08-18

    上傳用戶：waitingfy

  • 慣性測(cè)量組件Mti進(jìn)行數(shù)據(jù)采集

    慣性測(cè)量組件Mti進(jìn)行數(shù)據(jù)采集，利用陀螺和加速度計(jì)數(shù)據(jù)進(jìn)行捷聯(lián)姿態(tài)角解算，采用四元數(shù)更新算法，解算周期可調(diào)。

    標(biāo)簽： Mti 慣性測(cè)量 數(shù)據(jù)采集

    上傳時(shí)間： 2016-08-27

    上傳用戶：love1314

  • MIMO雷達(dá)的Mti處理及性能分析

    MIMO雷達(dá)的Mti處理及性能分析，希望對(duì)大家有幫助

    標(biāo)簽： MIMO Mti 雷達(dá) 性能分析

    上傳時(shí)間： 2017-09-11

    上傳用戶：baitouyu

  • 雷達(dá)信號(hào)處理系統(tǒng)的設(shè)計(jì)與FPGA實(shí)現(xiàn).rar

    雷達(dá)信號(hào)處理是雷達(dá)系統(tǒng)的重要組成部分。在數(shù)字信號(hào)處理技術(shù)飛速發(fā)展的今天，雷達(dá)信號(hào)處理中也普遍使用數(shù)字信號(hào)處理技術(shù)。而現(xiàn)場(chǎng)可編程門陣列(FPGA)在數(shù)字信號(hào)處理中的廣泛應(yīng)用，使得FPGA在雷達(dá)信號(hào)處理中也占據(jù)了重要地位。 針對(duì)雷達(dá)信號(hào)處理的設(shè)計(jì)與實(shí)現(xiàn)，本文在以下兩個(gè)方面展開研究： 一方面以線性調(diào)頻信號(hào)(LFM)為例，分別對(duì)幾種基本的雷達(dá)信號(hào)處理，如正交相干檢波、脈沖壓縮、動(dòng)目標(biāo)顯示(Mti)/動(dòng)目標(biāo)檢測(cè)(MTD)和恒虛警(CFAR)詳細(xì)地闡述了其原理，在此基礎(chǔ)上給出了其經(jīng)常采用的實(shí)現(xiàn)方法，并在MATLAB環(huán)境中對(duì)各個(gè)環(huán)節(jié)進(jìn)行了參數(shù)化仿真，詳盡地給出了各環(huán)節(jié)的仿真波形圖。針對(duì)仿真結(jié)果，直觀形象地說明了不同實(shí)現(xiàn)方法的優(yōu)劣。 另一方面結(jié)合MATLAB仿真結(jié)果，給出利用FPGA實(shí)現(xiàn)雷達(dá)信號(hào)處理的方案。在Xilinx ISE6.3i軟件集成環(huán)境下，通過對(duì)Xilinx提供的IP核的調(diào)用，并與VHDL語(yǔ)言相結(jié)合，完成雷達(dá)信號(hào)處理的FPGA實(shí)現(xiàn)。

    標(biāo)簽： FPGA 雷達(dá)信號(hào) 處理系統(tǒng)

    上傳時(shí)間： 2013-06-08

    上傳用戶：qweqweqwe

  • 雷達(dá)信號(hào)處理系統(tǒng)的設(shè)計(jì)與FPGA實(shí)現(xiàn)

    雷達(dá)信號(hào)處理是雷達(dá)系統(tǒng)的重要組成部分。在數(shù)字信號(hào)處理技術(shù)飛速發(fā)展的今天，雷達(dá)信號(hào)處理中也普遍使用數(shù)字信號(hào)處理技術(shù)。而現(xiàn)場(chǎng)可編程門陣列(FPGA)在數(shù)字信號(hào)處理中的廣泛應(yīng)用，使得FPGA在雷達(dá)信號(hào)處理中也占據(jù)了重要地位。 針對(duì)雷達(dá)信號(hào)處理的設(shè)計(jì)與實(shí)現(xiàn)，本文在以下兩個(gè)方面展開研究： 一方面以線性調(diào)頻信號(hào)(LFM)為例，分別對(duì)幾種基本的雷達(dá)信號(hào)處理，如正交相干檢波、脈沖壓縮、動(dòng)目標(biāo)顯示(Mti)/動(dòng)目標(biāo)檢測(cè)(MTD)和恒虛警(CFAR)詳細(xì)地闡述了其原理，在此基礎(chǔ)上給出了其經(jīng)常采用的實(shí)現(xiàn)方法，并在MATLAB環(huán)境中對(duì)各個(gè)環(huán)節(jié)進(jìn)行了參數(shù)化仿真，詳盡地給出了各環(huán)節(jié)的仿真波形圖。針對(duì)仿真結(jié)果，直觀形象地說明了不同實(shí)現(xiàn)方法的優(yōu)劣。 另一方面結(jié)合MATLAB仿真結(jié)果，給出利用FPGA實(shí)現(xiàn)雷達(dá)信號(hào)處理的方案。在Xilinx ISE6.3i軟件集成環(huán)境下，通過對(duì)Xilinx提供的IP核的調(diào)用，并與VHDL語(yǔ)言相結(jié)合，完成雷達(dá)信號(hào)處理的FPGA實(shí)現(xiàn)。

    標(biāo)簽： FPGA 雷達(dá)信號(hào) 處理系統(tǒng)

    上傳時(shí)間： 2013-04-24

    上傳用戶：ylwleon

  • 基于FPGA模型化設(shè)計(jì)的雷達(dá)信號(hào)

    隨著現(xiàn)場(chǎng)可編程門陣列(FPGA)在工業(yè)中的廣泛應(yīng)用，使得基于FPGA數(shù)字信號(hào)處理的實(shí)現(xiàn)在雷達(dá)信號(hào)處理中有著重要地位。模型化設(shè)計(jì)是一種自頂向下的面向FPGA的快速原型驗(yàn)證法，它不僅降低了FPGA設(shè)計(jì)門檻，而且縮短了開發(fā)周期，提高了設(shè)計(jì)效率。這使得FPGA模型化設(shè)計(jì)成為了FPGA系統(tǒng)設(shè)計(jì)的發(fā)展趨勢(shì)。本文針對(duì)常見雷達(dá)信號(hào)處理模塊的FPGA模型化實(shí)現(xiàn)，在以下幾個(gè)方面展開研究：首先對(duì)基于FPGA的模型化設(shè)計(jì)方法進(jìn)行了研究，給出了模型化設(shè)計(jì)方法的發(fā)展現(xiàn)狀和趨勢(shì)，并對(duì)本文中使用的模型化設(shè)計(jì)方法的軟件工具System Generator和AccelDSP進(jìn)行了介紹。其次使用這兩種軟件工具對(duì)FIR濾波器進(jìn)行了模型化設(shè)計(jì)并同RTL(寄存器傳輸級(jí))設(shè)計(jì)方法進(jìn)行對(duì)比，全面分析了模型化設(shè)計(jì)方法和RTL設(shè)計(jì)方法的優(yōu)缺點(diǎn)。然后在簡(jiǎn)明闡述雷達(dá)信號(hào)處理原理的基礎(chǔ)上，使用System Generator對(duì)數(shù)字下變頻(DDC)、脈沖壓縮、動(dòng)目標(biāo)顯示(Mti)及恒虛警(CFAR)處理等雷達(dá)信號(hào)處理模塊進(jìn)行了自頂向下的模型化設(shè)計(jì)。在Simulink中進(jìn)行了功能仿真驗(yàn)證，生成了HDL代碼，并在Xilinx FPGA中進(jìn)行了RTL的時(shí)序仿真分析。關(guān)鍵詞：雷達(dá)信號(hào)處理 FPGA 模型化設(shè)計(jì) System Generator AccelDSP

    標(biāo)簽： FPGA 模型 雷達(dá)信號(hào)

    上傳時(shí)間： 2013-07-25

    上傳用戶：zhangsan123

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