胰島素泵的設(shè)計 MPLAB IDE是一種在PC 機上運行的軟件，用來為Microchip Technology系列單片機開發(fā)應(yīng)用程序。由于它提供了一種單一的集成環(huán)境來為嵌入式單片機開發(fā)程序代碼，因此被稱為集成開發(fā)環(huán)境或IDE，所有軟件開發(fā)任務(wù)都可以在MPLAB IDE下完成，包括編輯、編譯、調(diào)試程序和下載。MPLAB IDE提供了一個統(tǒng)一的開發(fā)平臺，用于所有Microchip Technology處理器系統(tǒng)。 本系統(tǒng)的軟件設(shè)計開發(fā)采用C語言。C語言的可移植性很高，并且可讀性很好。軟件設(shè)計是通過各個模塊的編程設(shè)計來實現(xiàn)的。
上傳時間： 2013-10-08
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Keil是業(yè)界最好的51單片機開發(fā)工具之一，它擁有流暢的用戶界面與強大的仿真功能。ARM將Keil公司收購之后，正式推出了針對ARM微控制器的開發(fā)工具RVMDK，它將ARM編譯器RVCT與Keil的工程管理、調(diào)試仿真工具集成在一起，是一款非常強大的ARM微控制器開發(fā)工具。2007年5月，ARM正式授權(quán)中國深圳英蓓特公司代理中文版RVMDK的出售事務(wù)。很多嵌入式系統(tǒng)開發(fā)工程師對ARM的老版本開發(fā)工具ADS1.2非常熟悉，而RVMDK與ADS相比較，從外觀、仿真流程以及內(nèi)部二進制編譯鏈接工具上都有了不少改進，用法稍有不同。本主的主旨是介紹通用的流程，以及一些注意事項，幫助ADS1.2用戶將老的，遺留的ADS1.2工程轉(zhuǎn)化成在RVMDK上進行開發(fā)調(diào)試的工程。 ARM新推出的微控制器開發(fā)工具RVMDK與ADS1.2在工具架構(gòu)組成上有一些不同，這些區(qū)別包括：不同版本的ARM編譯器（compiler），不同的調(diào)試器（debugger），不同的仿真器（simulator），以及不同的硬件調(diào)試單元。作為ARM的新一代微控制器開發(fā)工具，RVMDK不但包含ARM的最新版本編譯鏈接工具，即RVDS3.0的編譯鏈接工具，而且根據(jù)微控制器調(diào)試開發(fā)的特點采用了與ADS，RVDS完全不同的調(diào)試、仿真環(huán)境，uVision debugger 與simulator。 RVMDK集成了RVDS3.0的編譯工具RVCT3.0，與ADS1.2相比，除去編譯、連接工具的可執(zhí)行二進制文件不同之外，RVCT3.0的很多編譯連接選項與ADS編譯器也有不同。
標(biāo)簽： MDK3 ADS 1.2 轉(zhuǎn)換
上傳時間： 2013-11-01
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The VHDL Cookbook是 是VHDL編碼書籍。
標(biāo)簽： VHDL Cookbook The 編碼
上傳時間： 2013-11-13
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The Xilinx Zynq-7000 Extensible Processing Platform (EPP) redefines the possibilities for embedded systems, giving system and software architects and developers a flexible platform to launch their new solutions and traditional ASIC and ASSP users an alternative that aligns with today’s programmable imperative. The new class of product elegantly combines an industrystandard ARMprocessor-based system with Xilinx 28nm programmable logic—in a single device. The processor boots first, prior to configuration of the programmable logic. This, along with a streamlined workflow, saves time and effort and lets software developers and hardware designers start development simultaneously.
標(biāo)簽： xilinx Zynq 7000 EPP
上傳時間： 2013-11-01
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XAPP520將符合2.5V和3.3V I/O標(biāo)準(zhǔn)的7系列FPGA高性能I/O Bank進行連接 The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems
上傳時間： 2013-11-19
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實驗?zāi)康模?1、掌握EIGRP 的基本配置 2、掌握EIGRP 的通配符掩配置方法 3、掌握EIGRP 的自動匯總特性，理解EIGRP 的自動匯總的缺陷以及如何關(guān)閉自動匯總 4、掌握EIGRP 的手工匯總 5、掌握通過ip default-network 命令配置EIGRP 默認(rèn)網(wǎng)絡(luò) 6、掌握EIGRP 的手工自動總結(jié)的配置方
上傳時間： 2013-10-13
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特點 精確度0.05%滿刻度 ±1位數(shù) 顯示范圍-19999-99999可任意規(guī)劃 可直接量測直流4至20mA電流,無需另接輔助電源 尺寸小(24x48x50mm),穩(wěn)定性高 分離式端子,配線容易 CE 認(rèn)證 主要規(guī)格 輔助電源: NONE 精確度: 0.05% F.S. ±1 digit(DC) 輸入抗阻: approx. 250 ohm with 20mA input 輸入電壓降: max. DC5V with 20mA input 最大過載能力: < ±50mA 取樣時間: 2.5 cycles/sec. 顯示值范圍: -19999 - 99999 digit adjustable 歸零調(diào)整范圍: -999-999 digit adjustable 最大值調(diào)整范圍: -999-999 digit adjustable 過載顯示: " doFL " or "-doFL" 極性顯示: " 一 " for negative readings 顯示幕 : Brigh Red LEDs high 8.6mm(.338") 溫度系數(shù) : 50ppm/℃ (0-50℃) 參數(shù)設(shè)定方式: Touch switches 記憶型式: Non-volatile E2 外殼材料: ABS 絕緣耐壓能力: 2KVac/1 min. (input/case) 使用環(huán)境條件: 0-50℃(20 to 90% RH non-condensed) 存放環(huán)境條件: 0-70℃(20 to 90% RH non-condensed) 外型尺寸: 24x48x50mm CE認(rèn)證: EN 55022:1998/A1:2000 Class A EN 61000-3-2:2000 EN 61000-3-3:1995/A1:2001 EN 55024:1998/A1:2001
上傳時間： 2013-10-09
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特點 精確度0.1%滿刻度 ±1位數(shù) 顯示范圍-19999-99999可任意規(guī)劃 可直接量測直流電流/直流電壓,無需另接輔助電源 尺寸小(24x48x50mm),穩(wěn)定性高 分離式端子,配線容易 CE 認(rèn)證 2.主要規(guī)格 輔助電源: NONE 精確度: 0.1% F.S. ±1 digit(1-100%F.S.) 輸入抗阻 : >100Mohm(<2V range) >2Mohm(<2Vrange) < 0.25VA(current ranges) < 1000Vrms(>54V ranges) 最大過載能力: < 150Vrms(<54V ranges)
上傳時間： 2013-10-08
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6410中文手冊，三星S3C6410用戶手冊（中文版）。
上傳時間： 2013-11-15
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hao，MS-DOS6.2批處理文件高級指南。
上傳時間： 2013-11-18
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