AVR ATmega48 SPI最簡單測試碼！ 透過spi_data[x]陣列寫入想要傳送的資料， 而x則是控制傳送第x筆數，而接腳輸出則在PortB的預設接腳內，只要修改spi_data就可以透過示波器看到SPI的信號了！
標簽： spi_data ATmega AVR SPI
上傳時間： 2014-06-09
上傳用戶：jcljkh
Verilog HDL的程式，上網找到SPI程式， vspi.v這程式相當好用可用來接收與傳送SPI，並且寫了一個傳輸信號測試，spidatasent.v這程式就是傳送的資料，分別為00 66... 01 77...... 02 55這樣的資料，並透過MAX+PULS II軟體進行模擬，而最外層的程式是test_createspi.v！
標簽： Verilog HDL 程式
上傳時間： 2017-03-06
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給出了通信原理課程的相關實驗程序源碼，包括DSB、ASK，抽樣及其濾波、信噪比分析及眼圖。
標簽： 通信原理 實驗 程序源碼
上傳時間： 2014-08-14
上傳用戶：yulg
Cadence詳細教程，對于新手學習有很好的輔助作用，這也是筆者工作中使用的軟件，教程講解很詳細，小白必備！謝謝大家支持！
標簽： Cadence 高速電路板設計
上傳時間： 2022-04-01
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IC封裝前仿和后仿的PI/SI/EMC分析直流壓降-仿真直流壓降，電流密度分布，功率密度分布，電阻網絡2.電源完整性-分析電源分配系統的性能，評估不同的疊層，電容容值選擇和放置方法，最佳性價比優化去耦電容3.信號完整性一分析信號回流路徑的不連續性，分析串擾和SSN/SS0，分析信號延遲，畸變，抖動和眼圖4.電磁兼容一分析電磁干擾和輻射寬帶模型抽取-提取電源分配網絡的精確寬帶模型，信號和電源/地模型
標簽： sip
上傳時間： 2022-04-03
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安裝塌所1、通凰良好少溫策及灰座之塌所。2、雜腐蝕性、引火性氛髓、油急、切削液、切前粉、戴粉等聚境。3、雜振勤的場所。4、雜水氟及踢光直射的場所。1、本距勤器探用自然封流冷御方式正隨安裝方向局垂直站立方式2、在配電箱中需考感溫升情況未連有效散熟及冷御效果需保留足豹的空固以取得充分的空氟。3、如想要使控制箱內溫度連到一致需增加凰扇等散熱毅倩。4、組裝睛廊注意避免贊孔屑及其他翼物掉落距勤器內。5、安裝睛請硫資以M5螺練固定。6、附近有振勤源時請使用振勤吸收器防振橡腥來作腐噩勤器的防振支撐。7、勤器附近有大型磁性陰嗣、熔接樓等雄部干援源睛，容易使距勤器受外界干攝造成誤勤作，此時需加裝雄部濾波器。但雍訊濾波器舍增加波漏電流，因此需在愿勤器的輸入端裝上經緣羹愿器（Transformer）。*配象材料依照使用電象規格]使用。*配象的喪度：指令輸入象3公尺以內。編碼器輸入綜20公尺以內。配象時請以最短距薄速接。*硫賞依照操單接象圈配象，未使用到的信貌請勿接出。*局連輸出端（端子U、V、W）要正硫的速接。否則伺服焉速勤作舍不正常。*隔雄綜必須速接在FG端子上。*接地請以使用第3砸接地（接地電阻值腐100Ω以下），而且必須罩黏接地。若希望易速輿械之周腐紀緣狀懲畸，請將連接地。*伺服距勤器的輸出端不要加裝電容器，或遇（突波）吸收器及雅訊濾波器。*裝在控制輸出信號的DC繼電器，其遏（突波）吸收用的二梗溜的方向要速接正硫，否則食造成故障，因而雜法輸出信猶，也可能影馨緊急停止的保渡迎路不座生作用。*腐了防止雍部造成的錯溪勤作，請探下列的威置：請在電源上加入經緣雯愿器及雅亂濾波器等裝置。請將勤力緣（雷源象、焉連緣等的蘊雷回路）奧信蔬緣相距30公分以上來配練，不要放置在同一配緣管內。
標簽： tsda
上傳時間： 2022-05-28
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PSS/E功能特點·輸入數據方式及與其他程序數據文件共享的方便性·程序模型庫包括發電機模型、勵磁系統模型、調速器模型、HVDC模型、FACTS模型、負荷模型等的完整性·分析計算功能的多樣性·用戶自定義計算順序與用戶自定義計算功能·用戶自定義模型功能和程序接口功能·計算方法的透明性與文檔的完整性·國際交流的方便性基本功能介紹>潮流計算（Load Flow）>動態仿真（Dynamic Simulation）>批處理功能>計算和仿真結果輸出>潮流計算模塊（psslf4）>動態仿真模塊（pssds4）>仿真結果輸出模塊（pssplt）DOS模式啟動>數據文件建立>潮流計算啟動和數據導入>數據查詢和修改》數據檢查>潮流計算>結果輸出和數據保存◆PSS/E的可視化和圖形化◆潮流結果文件的處理（動態仿真準備）
標簽： psse
上傳時間： 2022-07-01
Expedition PCB采用了業界最新進和強大的Autoactive技術，用于復雜PCB物理設計、分析和加工一整套環境的工具，它將交互設計和自動布線有機地整合到一個設計環境中。...
標簽： 單片機 精品課 教程 實驗指導
上傳時間： 2013-04-15
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高速PCB電源完整性設計與分析高速PCB電源完整性設計與分析
標簽： pcb 電源
上傳時間： 2022-02-09
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討論了高速PCB 設計中涉及的定時、反射、串擾、振鈴等信號完整性( SI)問題,結合CA2DENCE公司提供的高速PCB設計工具Specctraquest和Sigxp,對一采樣率為125MHz的AD /DAC印制板進行了仿真和分析,根據布線前和布線后的仿真結果設置適當的約束條件來控制高速PCB的布局布線,從各個環節上保證高速電路的信號完整性。
標簽： PCB 仿真 分
上傳時間： 2013-11-06
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