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PD快充協(xié)議芯片

  • 雙信號快速測頻技術(shù)及FPGA實現(xiàn)

    建立在數(shù)據(jù)率轉(zhuǎn)換技術(shù)之上的寬帶數(shù)字偵察接收機要求能夠?qū)崿F(xiàn)高截獲概率、高靈敏度、近乎實時的信號處理能力。雙信號數(shù)據(jù)率轉(zhuǎn)換技術(shù)是寬帶數(shù)字偵察接收機關(guān)鍵技術(shù)之一,是解決寬帶數(shù)字接收機中前端高速ADC采樣的高速數(shù)據(jù)流與后端DSP處理速度之間瓶頸問題的可行方案。測頻技術(shù)以及帶通濾波,即寬帶數(shù)字下變頻技術(shù),是實現(xiàn)數(shù)據(jù)率轉(zhuǎn)換系統(tǒng)的關(guān)鍵技術(shù)。本文首先介紹了寬帶數(shù)字偵察接收關(guān)鍵技術(shù)之一的數(shù)據(jù)率轉(zhuǎn)換技術(shù),著重研究了快速、高精度雙信號測頻算法以及實驗系統(tǒng)硬件實現(xiàn)。論文主要工作如下: (1)分析了現(xiàn)代電子偵察環(huán)境下的信號特征,指出寬帶數(shù)字接收機必須滿足寬監(jiān)視帶寬、流水作業(yè)以及近實時的響應(yīng)時間。給出了一種頻率引導(dǎo)式的數(shù)字接收機方案,簡要介紹這種接收機的關(guān)鍵技術(shù)——快速、高精度頻率估計以及高效的數(shù)據(jù)率轉(zhuǎn)換。 (2)介紹了FFT技術(shù)在測頻算法中的應(yīng)用,比較了FFT專用芯片及其優(yōu)點和缺點,指出為了滿足實時處理要求,必須選用FPGA設(shè)計FFT模塊。 (3)在分析常規(guī)的插值算法基礎(chǔ)上,提出了一種單信號的快速插值頻率估計方法,只需三個FFT變換系數(shù)的實部構(gòu)造頻率修正項,計算量低。該方法具有精度高、測頻速率快的特點。 (4)基于DFT理論和自相關(guān)理論,提出了結(jié)合FFT和自相關(guān)的雙信號頻率估計算法。該方法先用DFT估計其中一個信號的頻率和幅度,以此頻率對信號解調(diào)并對消該頻率成分,最后利用自相關(guān)理論估計出另一個信號的頻率。 (5)基于DFT理論和FFT技術(shù),研究了信號平方與FFT結(jié)合的雙信號頻率估計算法。根據(jù)信號中兩頻率分量的幅度比,只需一次一維平方信號譜峰搜索,就可以得到雙信號的和頻與差頻分量的估計值,并利用插值技術(shù)提高測頻精度。該算法能夠精確地估計頻率間隔小的雙信號頻率,且容易地擴展到復(fù)信號,F(xiàn)PGA硬件實現(xiàn)容易。 (6)基于現(xiàn)代譜分析理論,研究了基于AR(2)模型的雙信號頻率估計算法。方法在利用AR(2)模型系數(shù)估計雙正弦信號頻率之和的同時,利用FFT快速測頻算法估計其中強信號分量的頻率值。算法仿真驗證和性能分析表明了提出的算法能快速高精度地估計雙信號頻率。 (7)給出了基于頻譜重心算法的雷達(dá)雙信號頻率估計的FPGA硬件實現(xiàn)架構(gòu),并進(jìn)行了時序仿真。 (8)討論了雙信號帶寬匹配接收系統(tǒng)的硬件設(shè)計方案,給出了快速測頻及帶寬估計模塊設(shè)計。

    標(biāo)簽: FPGA 信號 測頻

    上傳時間: 2013-06-02

    上傳用戶:youke111

  • 基于FPGA組的ASIC邏輯驗證技術(shù)研究

    隨著ASIC設(shè)計規(guī)模的增長,功能驗證已成為整個開發(fā)周期的瓶頸。傳統(tǒng)的基于軟件模擬和硬件仿真的邏輯驗證方法已難以滿足應(yīng)用的要求,基于FPGA組的原型驗證方法能有效縮短系統(tǒng)的開發(fā)周期,可提供更快更全面的驗證。由于FPGA芯片容量的增加跟不上ASIC設(shè)計規(guī)模的增長,單芯片已無法容納整個設(shè)計,所以常常需要對設(shè)計進(jìn)行邏輯分割,將子邏輯塊映射到FPGA陣列中。 本文對邏輯驗證系統(tǒng)的可配置互連結(jié)構(gòu)和ASIC邏輯分割算法進(jìn)行了深入的研究,提出了FPGA陣列的非對稱可配置互連結(jié)構(gòu)。與現(xiàn)有的對稱互連結(jié)構(gòu)相比,該結(jié)構(gòu)能提供更多的互連通道,可實現(xiàn)對I/O數(shù)量、電平類型和互連路徑的靈活配置。 本文對邏輯分割算法進(jìn)行了較深入的研究。針對現(xiàn)有的兩類分割算法存在的不足,提出并實現(xiàn)了基于設(shè)計模塊的邏輯分割算法,該算法有三個重要特征:1)基于設(shè)計代碼;2)以模塊作為邏輯分割的最小單位;3)使用模塊資源信息指導(dǎo)邏輯分割過程,避免了設(shè)計分割過程的盲目性,簡化了邏輯分割過程。 本文還對并行邏輯分割方法進(jìn)行了研究,提出了兩種基于不同任務(wù)分配策略的并行分割算法,并對其進(jìn)行了模擬和性能分析;驗證了采用并行方案對ASIC邏輯進(jìn)行分割和映射的可行性。 最后基于改進(jìn)的芯片互連結(jié)構(gòu),使用原型系統(tǒng)驗證方法對某一大規(guī)模ASIC設(shè)計進(jìn)行了邏輯分割和功能驗證。實驗結(jié)果表明,使用改進(jìn)后的FPGA陣列互連結(jié)構(gòu)可以更方便和快捷地實現(xiàn)ASIC設(shè)計的分割和驗證,不但能顯著提高芯片間互連路徑的利用率,而且能給邏輯分割乃至整個驗證過程提供更好的支持,滿足現(xiàn)在和將來大規(guī)模ASIC邏輯驗證的需求。

    標(biāo)簽: FPGA ASIC 邏輯 驗證技術(shù)

    上傳時間: 2013-06-12

    上傳用戶:極客

  • 基于FPGA的機載高速數(shù)據(jù)記錄系統(tǒng)的研究

    本文將電路接口技術(shù)與硬件可編程技術(shù)相結(jié)合,提出了用可編程芯片來控制IDE硬盤進(jìn)行高速數(shù)據(jù)記錄,能夠滿足機載數(shù)據(jù)記錄設(shè)備重量輕、容量大、速度快的要求。 論文對硬盤ATA接口標(biāo)準(zhǔn)進(jìn)行了研究,對VHDL語言、現(xiàn)場可編程門陣列器件(FPGA)實現(xiàn)硬件電路的原理和方法進(jìn)行了深入分析,在此基礎(chǔ)上完成了基于FPGA的數(shù)據(jù)記錄控制器的設(shè)計。文中選擇了具有低功耗、低成本、高性能的FPGA芯片(型號為CycloneEP1C3T144C8),將各功能模塊級聯(lián)成系統(tǒng)在該芯片上完成了控制器系統(tǒng)級的設(shè)計與仿真驗證,驗證結(jié)果表明了用FPGA實現(xiàn)高速數(shù)據(jù)記錄控制器的可行性。所設(shè)計的VHDL代碼經(jīng)QuartusⅡ綜合、布局布線、管腳分配后,在FPGA內(nèi)部可以達(dá)到104.46Mhz的電路工作速度,F(xiàn)PGA與硬盤之間采用ATA接口的UltraDMA模式2傳輸方式,可以達(dá)到33.3MByte/s的突發(fā)數(shù)據(jù)傳輸率。文中對所用到的FPGA設(shè)計技術(shù)給予了詳細(xì)說明,對各功能模塊的設(shè)計給予了詳細(xì)闡述,對關(guān)鍵設(shè)計給出了VHDL源代碼,還討論了FPGA設(shè)計中時序約束的作用,給出了本文所做時序約束的方法。 本文中所論述的工作對以后機載數(shù)據(jù)記錄系統(tǒng)的設(shè)計具有重要的鋪墊作用。文中在總結(jié)所做工作的同時,還對下一步工作提出了有益的建議。

    標(biāo)簽: FPGA 機載 高速數(shù)據(jù) 記錄系統(tǒng)

    上傳時間: 2013-08-05

    上傳用戶:hanli8870

  • 圖像縮放算法的研究及其在FPGA上的實現(xiàn)

    作者研究了當(dāng)前流行的縮放算法,對圖像紋理相關(guān)性大小和邊緣方向的判斷上提出了一種新的方法,并在此基礎(chǔ)上發(fā)展了一套適用于數(shù)字視頻芯片的圖像縮放算法。仿真結(jié)果表明此算法由優(yōu)于目前流行的圖像縮放算法。 介紹了FPGA的開發(fā)工作大致可以分為設(shè)計和驗證兩大部分,在具體開發(fā)流程上可以根據(jù)要求靈活控制。縮放芯片的開發(fā)可以分為:芯片結(jié)構(gòu)設(shè)計、時鐘系統(tǒng)設(shè)計、存儲器讀寫控制、IP核復(fù)用設(shè)計、計算精度控制等方面的電路設(shè)計。在設(shè)計完成各級子模塊以后拼接各子模快完成整個縮放模塊的設(shè)計。通過測試發(fā)現(xiàn)設(shè)計中存在的缺陷,修改再測試,最終完成整個模塊的設(shè)計。  

    標(biāo)簽: FPGA 圖像 法的研究

    上傳時間: 2013-05-31

    上傳用戶:tdyoung

  • 基于FPGA的逆變器控制芯片研究

    逆變控制器的發(fā)展經(jīng)歷從分立元件的模擬電路到以專用微處理芯片(DSP/MCU)為核心的電路系統(tǒng),并從數(shù)模混合電路過渡到純數(shù)字控制的歷程。但是,通用微處理芯片是為一般目的而設(shè)計,存在一定局限。為此,近幾年來逆變器專用控制芯片(ASIC)實現(xiàn)技術(shù)的研究越來越受到關(guān)注,已成為逆變控制器發(fā)展的新方向之一。本文利用一個成熟的單相電壓型PWM逆變器控制模型,圍繞逆變器專用控制芯片ASIC的實現(xiàn)技術(shù),依次對專用芯片的系統(tǒng)功能劃分,硬件算法,全系統(tǒng)的硬件設(shè)計及優(yōu)化,流水線操作和并行化,芯片運行穩(wěn)定性等問題進(jìn)行了初步研究。首先引述了單相電壓型PWM逆變器連續(xù)時間和離散時間的數(shù)學(xué)模型,以及基于極點配置的單相電壓型PWM逆變器電流內(nèi)環(huán)電壓外環(huán)雙閉環(huán)控制系統(tǒng)的設(shè)計過程,同時給出了仿真結(jié)果,仿真表明此系統(tǒng)具有很好的動、靜態(tài)性能,并且具有自動限流功能,提高了系統(tǒng)的可靠性。緊接著分析了FPGA器件的特征和結(jié)構(gòu)。在給出本芯片應(yīng)用目標(biāo)的基礎(chǔ)上,制定了FPGA目標(biāo)器件的選擇原則和芯片的技術(shù)規(guī)格,完成了器件選型及相關(guān)的開發(fā)環(huán)境和工具的選取。然后系統(tǒng)闡述了復(fù)雜FPGA設(shè)計的設(shè)計方法學(xué),詳細(xì)介紹了基于FPGA的ASIC設(shè)計流程,概要介紹了僅使用QuartusII的開發(fā)流程,以及Modelsim、SynplifyPro、QuartusII結(jié)合使用的開發(fā)流程。在此基礎(chǔ)上,進(jìn)行了芯片系統(tǒng)功能劃分,針對:DDS標(biāo)準(zhǔn)正弦波發(fā)生器,電壓電流雙環(huán)控制算法單元,硬件PI算法單元,SPWM產(chǎn)生器,三角波發(fā)生器,死區(qū)控制器,數(shù)據(jù)流/控制流模塊等逆變器控制硬件算法/控制單元,研究了它們的硬件算法,完成了模塊化設(shè)計。分析了全數(shù)字鎖相環(huán)的結(jié)構(gòu)和模型,以此為基礎(chǔ),設(shè)計了一種應(yīng)用于逆變器的,用比例積分方法替代傳統(tǒng)鎖相系統(tǒng)中的環(huán)路濾波,用相位累加器實現(xiàn)數(shù)控振蕩器(DCO)功能的高精度二階全數(shù)字鎖相環(huán)(DPLL)。分析了“流水線操作”等設(shè)計優(yōu)化問題,并針對逆變器控制系統(tǒng)中,控制系統(tǒng)算法呈多層結(jié)構(gòu),且層與層之間還有數(shù)據(jù)流聯(lián)系,其執(zhí)行順序和數(shù)據(jù)流的走向較為復(fù)雜,不利于直接采用流水線技術(shù)進(jìn)行設(shè)計的特點,提出一種全新的“分層多級流水線”設(shè)計技術(shù),有效地解決了復(fù)雜控制系統(tǒng)的流水線優(yōu)化設(shè)計問題。本文最后對芯片運行穩(wěn)定性等問題進(jìn)行了初步研究。指出了設(shè)計中的“競爭冒險”和飽受困擾之苦的“亞穩(wěn)態(tài)”問題,分析了產(chǎn)生機理,并給出了常用的解決措施。

    標(biāo)簽: FPGA 逆變器 控制芯片

    上傳時間: 2013-05-28

    上傳用戶:ice_qi

  • 指紋識別算法的研究及基于FPGA的硬件實現(xiàn)

    隨著圖像處理和模式識別技術(shù)的進(jìn)步,基于生物特征的識別技術(shù)成為蓬勃發(fā)展的高技術(shù)之一,根據(jù)IBG(InternationalBiometricGroup)組織對生物特征市場的統(tǒng)計和預(yù)測,該領(lǐng)域的收入的年增長率30-50%,到2008年,全球總收入將達(dá)到46.39億美元。而基于指紋特征的識別技術(shù)由于其獨特的可靠性,穩(wěn)定性,方便快捷的特點,恰好符合了市場的需求。目前指紋識別技術(shù)是生物識別領(lǐng)域中應(yīng)用最廣泛的識別技術(shù),也是研究與應(yīng)用的一個熱點。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計領(lǐng)域中最熱門的概念。NiosⅡ是Altera公司開發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核,可以將它嵌入FPGA內(nèi)部,與用戶自定義邏輯結(jié)合構(gòu)成一個基于FPGA的片上系統(tǒng)。與嵌入式硬核相比較,嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識別系統(tǒng)對速度的要求。 本文對指紋識別技術(shù)中各個環(huán)節(jié)的算法進(jìn)行了較為深入的研究,結(jié)合NiosⅡ嵌入式處理器的特點,對算法進(jìn)行了合理的選擇與優(yōu)化,形成了一套完整的指紋識別算法,并提出了一種基于FPGA的指紋識別系統(tǒng)硬件設(shè)計方案。 論文的內(nèi)容主要包括以下幾個方面: 1、對指紋圖像預(yù)處理、后處理和匹配算法進(jìn)行了改進(jìn),提高了算法的性能;設(shè)計了一種適用于快速匹配的指紋特征數(shù)據(jù)結(jié)構(gòu);提出了一套基于特征點匹配的指紋識別算法。實驗結(jié)果表明該算法速度快、誤識率較低、可靠性較高,可以滿足實用的要求。 2、本著增加系統(tǒng)集成度、減小系統(tǒng)體積、提高便攜性、降低功耗和成本,同時提升系統(tǒng)的性能的原則,使用Altera公司提供的外圍設(shè)備IP核配合NiosⅡ處理器軟核搭建了一個單片嵌入式系統(tǒng),然后以內(nèi)嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片,外配片外RAM和Flash存儲器以及小鍵盤和LCD顯示屏等器件,設(shè)計了一個便攜式指紋識別系統(tǒng),提出了一套基于FPGA的硬件設(shè)計方案。 3、利用NiosⅡ開發(fā)板對硬件設(shè)計方案進(jìn)行了初步的驗證,實現(xiàn)了指紋采集芯片F(xiàn)PS200與FPGA的接口,并進(jìn)行了算法的移植。 實驗結(jié)果表明本文所提出的系統(tǒng)設(shè)計方案是可行的。基于FPGA的自動指紋識別系統(tǒng)在速度、功耗、體積、擴展性方面有著獨特的優(yōu)勢,具有廣闊的發(fā)展空間。最后提出了對這一設(shè)計繼續(xù)改進(jìn)的思路和下一步研究的內(nèi)容。

    標(biāo)簽: FPGA 指紋識別 法的研究 硬件實現(xiàn)

    上傳時間: 2013-06-07

    上傳用戶:kikye

  • 基于DSP和FPGA的四關(guān)節(jié)實驗室機器人控制器的研制

    在機器人學(xué)的研究領(lǐng)域中,如何有效地提高機器人控制系統(tǒng)的控制性能始終是研究學(xué)者十分關(guān)注的一個重要內(nèi)容。在分析了工業(yè)機器人的發(fā)展歷程和機器人控制系統(tǒng)的研究現(xiàn)狀后,本論文的主要目標(biāo)是針對四關(guān)節(jié)實驗室機器人特有的機械結(jié)構(gòu)和數(shù)學(xué)模型,建立一個新型全數(shù)字的基于DSP和FPGA的機器人位置伺服控制系統(tǒng)的軟、硬件平臺,實現(xiàn)對四關(guān)節(jié)實驗室機器人的精確控制。 本論文從實際情況出發(fā),首先分析了所研究的四關(guān)節(jié)實驗室機器人的本體結(jié)構(gòu),并對其抽象簡化得到了它的運動學(xué)數(shù)學(xué)模型。在明確了實現(xiàn)機器人精確位置伺服控制的控制原理后,我們對機器人控制系統(tǒng)的諸多可行性方案進(jìn)行了充分論證,并最終決定采用了三級CPU控制的控制體系結(jié)構(gòu):第一級CPU為上位計算機,它實現(xiàn)對機器人的系統(tǒng)管理、協(xié)調(diào)控制以及完成機器人實時軌跡規(guī)劃等控制算法的運算;第二級CPU為高性能的DSP處理器,它輔之以具有高速并行處理能力的FPGA芯片,實現(xiàn)了對機器人多個關(guān)節(jié)的高速并行驅(qū)動;第三級CPU為交流伺服驅(qū)動處理器,它實現(xiàn)了機器人關(guān)節(jié)伺服電機的精確三閉環(huán)誤差驅(qū)動控制,以及電機的故障診斷和自動保護(hù)等功能。此外,我們采用比普通UART速度快得多的USB來實現(xiàn)上位計算機.與下位控制器之間的數(shù)據(jù)通信,這樣既保證了兩者之間連接方便,又有效的提高了控制系統(tǒng)的通信速度和可靠性。 機器人系統(tǒng)的軟件設(shè)計包括兩個部分:一是采用VC++實現(xiàn)的上位監(jiān)控軟件系統(tǒng),它主要負(fù)責(zé)機器人實時軌跡規(guī)劃等控制算法的運算,同時完成用戶與機器人系統(tǒng)之間的信息交互;二是采用C語言實現(xiàn)的下位DSP控制程序,它主要負(fù)責(zé)接收上位監(jiān)控系統(tǒng)或者下位控制箱發(fā)送的控制信號,實現(xiàn)對機器人的實時驅(qū)動,同時還能夠?qū)崟r的向上位監(jiān)控系統(tǒng)或者下位控制箱反饋機器人的當(dāng)前狀態(tài)信息。 研究開發(fā)出來的四關(guān)節(jié)實驗室機器人控制器具有控制實時性好、定位精度高、運行穩(wěn)定可靠的特點,它允許用戶通過上位控制計算機實現(xiàn)對機器人的各種設(shè)定作業(yè)的控制,也可以讓用戶通過機器人控制箱現(xiàn)場對機器人進(jìn)行回零、示教等各項操作。

    標(biāo)簽: FPGA DSP 實驗室 機器人控制器

    上傳時間: 2013-06-11

    上傳用戶:edisonfather

  • ARM嵌入式教學(xué)實驗系統(tǒng)的研究與實現(xiàn)

    ARM嵌入式技術(shù)在工業(yè)和生活中正得到越來越廣泛的應(yīng)用,為了適應(yīng)技術(shù)的發(fā)展和社會的需求,滿足為社會培養(yǎng)創(chuàng)新型人才的需要,高校通信類和電子類專業(yè)開設(shè)ARM嵌入式技術(shù)相關(guān)課程及其實驗課程將成為趨勢。在課程中設(shè)置合理實驗,可以有效提高學(xué)生的動手能力和培養(yǎng)創(chuàng)新性思維,幫助學(xué)生更快、更好地掌握理論和應(yīng)用技術(shù)。 論文設(shè)計的ARM嵌入式教學(xué)實驗系統(tǒng)包括一塊適合普通高校嵌入式技術(shù)實驗課程教學(xué)的實驗開發(fā)板及其配套的實驗。該實驗系統(tǒng)針對一般高校所開設(shè)的ARM嵌入式技術(shù)相關(guān)課程的要求而設(shè)計,配套實驗符合教學(xué)大綱及實驗課時的要求。 論文設(shè)計的實驗開發(fā)板主要組成模塊有:最小系統(tǒng),包括控制器模塊、電源模塊、復(fù)位模塊、Flash ROM模塊、SDRAM模塊、JTAG接口等;擴展接口,包括LED、鍵盤、RS232串口、I2C接口、液晶模塊、以太網(wǎng)模塊等。實驗開發(fā)板采用S3C4510B網(wǎng)絡(luò)控制芯片用作控制和信號處理,使用網(wǎng)絡(luò)接口芯片DM9161和隔離變壓器H1102完成網(wǎng)絡(luò)接入,使用AM29LV160和HY57V641620HG構(gòu)建16位存儲單元,使用AT24C01和PCF8583來構(gòu)建I2C接口,使用MAX232完成TTL電平轉(zhuǎn)換以擴展RS232串口,并擴展鍵盤和LCD實現(xiàn)人機交互。實驗開發(fā)板的硬件設(shè)計充分考慮了一般高校實驗室的條件和需求,能夠較好地將成本控制在150元左右,有利于在有限的條件下為每個學(xué)生盡可能的創(chuàng)造動手制作PCB的實驗條件。實驗板的接口設(shè)計能夠讓學(xué)生較為方便地開展實驗,并考慮了實驗板擴展和二次開發(fā)的需要。 論文設(shè)計的實驗系統(tǒng)配套實驗主要有基礎(chǔ)實驗、擴展實驗和設(shè)計實驗。基礎(chǔ)實驗主要幫助學(xué)生熟悉嵌入式系統(tǒng)的片內(nèi)資源和特殊功能寄存器的配置方法,對整個嵌入式系統(tǒng)的架構(gòu)有一定的理解,能編程完成一些簡單的控制功能;擴展實驗主要幫助學(xué)生建立嵌入式系統(tǒng)開發(fā)和設(shè)計的基本理念,能夠設(shè)計和實現(xiàn)常見的外設(shè)驅(qū)動程序,能夠進(jìn)行操作系統(tǒng)的配置和移植,能夠自行對實驗板進(jìn)行一定程度的擴展;設(shè)計實驗?zāi)軌驇椭鷮W(xué)生提高嵌入式系統(tǒng)的設(shè)計開發(fā)能力,使學(xué)生能根據(jù)需要設(shè)計出實現(xiàn)一定功能的擴展模塊,從而使實驗板擴展成實現(xiàn)具體功能的工業(yè)產(chǎn)品。基礎(chǔ)實驗包括ADS集成環(huán)境實驗、鍵盤實驗(GPIO輸入)、LED實驗(GPIO輸出)、定時器實驗、外部中斷實驗、UART串口通信實驗、I2C接口實驗、液晶顯示實驗;擴展實驗包括建立交叉編譯環(huán)境實驗、操作系統(tǒng)編譯實驗、操作系統(tǒng)移植實驗、以太網(wǎng)通信實驗、TFTP實驗、WEB訪問實驗;設(shè)計實驗包括TCP/IP協(xié)議棧實驗、Web服務(wù)器實驗。學(xué)生通過完成基礎(chǔ)實驗、擴展實驗和設(shè)計實驗來達(dá)到教學(xué)大綱的要求,并可以在此基礎(chǔ)上進(jìn)行更深入的創(chuàng)新性開發(fā)實驗,可以滿足一般高校嵌入式技術(shù)實驗課程教學(xué)的需要。 論文介紹了嵌入式交叉編譯環(huán)境的建立以及實驗開發(fā)板設(shè)計完成后進(jìn)行的調(diào)試。實驗開發(fā)板移植的嵌入式操作系統(tǒng)為uClinux,采用的Bootloader為U-boot。論文還簡單介紹了實驗系統(tǒng)的擴展方案和二次開發(fā)方案,并對嵌入式新技術(shù)的發(fā)展做了粗淺的探討。 論文所做的工作以科學(xué)發(fā)展觀為指導(dǎo),是對普通高校ARM嵌入式技術(shù)實驗課程設(shè)計的一次有益探索。

    標(biāo)簽: ARM 嵌入式 教學(xué)實驗系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:jjq719719

  • 基于ARMLinux的多道脈沖幅度分析器數(shù)字系統(tǒng)設(shè)計

    隨著電子技術(shù)的不斷發(fā)展,各種智能核儀器逐步走向自動化、智能化、數(shù)字化和便攜式的方向發(fā)展。針對傳統(tǒng)的多道脈沖幅度分析器體積大,人機交互不友好,不方便現(xiàn)場分析等的缺陷[5]。新型的高速、集成度高、界面友好的多道脈沖幅度分析器的陸續(xù)出現(xiàn)填補了這一缺點。 隨著電子技術(shù)的發(fā)展,以ARM為核的處理器技術(shù)的應(yīng)用領(lǐng)域不斷擴大,相比較單片機而言,它的主頻高、運算速度快,可以滿足多道脈沖幅度分析器的苛刻的時間上的要求。而且ARM處理器功耗小,適合于功耗要求比較苛刻的地方,這些方面的特點正好滿足了便攜式多道脈沖幅度分析器野外勘察的要求。同時,由于以ARM為核的處理器具有豐富的外設(shè)資源,這樣就簡化了外設(shè)電路及芯片的使用,降低了功耗并增強了產(chǎn)品的信賴性。另外,ARM芯片可以方便的移植操作系統(tǒng),為多道脈沖幅度分析器多任務(wù)的管理和并行的處理,甚至硬實時功能的實現(xiàn)提供了前提。而且在ARM平臺使用嵌入式linux操作系統(tǒng)使多道脈沖幅度分析器的軟件易于升級。 智能化和小型化是多道脈沖幅度分析器的發(fā)展趨勢。智能化要求系統(tǒng)的自動化程度高、操作簡便、容錯性好。智能化除了需要控制軟件外,還需要軟件命令的執(zhí)行者即硬件控制電路來實現(xiàn)相應(yīng)的控制邏輯,兩者的結(jié)合才能真正的實現(xiàn)智能化。小型化要求系統(tǒng)的體積小、功耗小、便于攜帶;小型化除了要求采用微功耗的器件,還要求電路板的尺寸盡量的小且所用元件盡量的少,但小型化的同時必須保持系統(tǒng)的智能化,即不能減少智能化所要求的復(fù)雜的邏輯和時序的控制功能。為此采用高集成度的ARM芯片實現(xiàn)控制電路能滿意地同時滿足智能化和小型化的要求。在研制的多道脈沖幅度分析器中,幾乎所有的控制都可以用控制芯片來實現(xiàn),如閾值設(shè)定、自動穩(wěn)譜以及多道數(shù)據(jù)采集,在節(jié)省了元件的數(shù)目和電路板的尺寸的同時仍能保持系統(tǒng)的智能化程度。 Linux內(nèi)核精簡而高效,可修改性強,支持多種體系結(jié)構(gòu)的處理器等,使得它是一個非常適合于嵌入式開發(fā)和應(yīng)用的操作系統(tǒng)。嵌入式Linux可以運行的硬件平臺十分廣泛,從x86、MIPS、POWERPC到ARM,以及其他許多硬件體系結(jié)構(gòu)。目前在世界范圍內(nèi),ARM體系結(jié)構(gòu)的SOC逐漸占領(lǐng)32位嵌入式微處理器市場,ARM處理器及技術(shù)的應(yīng)用幾乎已經(jīng)深入到各個領(lǐng)域,例如:工業(yè)控制,無線通訊,網(wǎng)絡(luò),消費類電子,成像等。 本課題采用三星公司生產(chǎn)的ARM(Advanced RISC Machines,先進(jìn)精簡指令集機器)芯片S3C2410A設(shè)計并研制了一種便攜式的核數(shù)據(jù)采集系統(tǒng)設(shè)計方案。利用ARM芯片豐富的外設(shè)資源對傳統(tǒng)的多道脈沖幅度分析器進(jìn)行改進(jìn)和簡化。系統(tǒng)由前端探測器系統(tǒng),以及由線性脈沖放大器、甄別電路、控制電路、采樣保持電路組成的前置電路,中央處理器模塊,顯示模塊,用戶交互模塊,存儲模塊,網(wǎng)絡(luò)傳輸模塊等多個模塊組成。本設(shè)計基于ARM9芯片S3C2410,并在此平臺上移植了嵌入式linux操作系統(tǒng)來進(jìn)行任務(wù)的調(diào)度和處理等。 電路板核心板部分設(shè)計采用6層PCB板結(jié)構(gòu),這樣增加了系統(tǒng)可靠性,提高了電磁兼容的穩(wěn)定性。數(shù)據(jù)采集系統(tǒng)是多道脈沖幅度分析器的核心,A/D轉(zhuǎn)換直接使用了S3C2410內(nèi)置的ADC(Analog to Digital Converter,模數(shù)轉(zhuǎn)換器),在2.5 MHz的轉(zhuǎn)換時鐘下最大轉(zhuǎn)換速度500 KSPS(Kilo-Samples per second,千采樣點每秒),滿足了系統(tǒng)最低轉(zhuǎn)換時間≤5 μs的要求,并且控制簡單,簡化了外部接口電路。由于SD(Secure Digital Card,安全數(shù)碼卡)卡存儲容量大、攜帶方便、成本低等優(yōu)點,所以設(shè)計中采用其作為外部的數(shù)據(jù)存儲設(shè)備,其驅(qū)動部分采用SD卡軟件包,為開發(fā)帶來了方便。本設(shè)計采用640*480的6.4寸LCD(Liquid Crystal Display,液晶顯示)屏作為人機交互的顯示部分,并且通過Qt/Embedded為系統(tǒng)提供圖形用戶界面的應(yīng)用框架和窗口系統(tǒng)。其中包括了波形顯示部分和用戶菜單設(shè)置部分,這樣方便了用戶操作。系統(tǒng)的數(shù)據(jù)存取方面是基于SQLite嵌入式小型數(shù)據(jù)庫而進(jìn)行的。為了方便數(shù)據(jù)向上位機的傳輸,系統(tǒng)設(shè)計中采用XML(Extensible Markup Language,可擴展標(biāo)記語言)格式來組織傳輸?shù)臄?shù)據(jù),通過基于TCP/IP(Transmission Control Protocol/Internet Protocol)協(xié)議的Linux下Socket套接字編程,來進(jìn)行與上位機或PC(Personal Computer,個人計算機或桌面機)等的連接和數(shù)據(jù)傳輸。

    標(biāo)簽: ARMLinux 多道 分析器 脈沖幅度

    上傳時間: 2013-04-24

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  • 基于ARM的多對象遠(yuǎn)程抄表系統(tǒng)集中器的設(shè)計與實現(xiàn)

    智能電表、水表、煤/燃?xì)獗怼崃勘淼却罅康爻霈F(xiàn)在人們的生活中,同時這些儀表的抄錄工作變得越來越煩瑣,工作量大,工作效率低,不僅給用戶帶來不便,而且會存在漏抄、誤抄、估抄的現(xiàn)象。隨著電子技術(shù)、通信技術(shù)和計算機技術(shù)的飛速發(fā)展,人工抄表已經(jīng)逐步被自動抄表所代替。 集中器是一個數(shù)據(jù)集中處理器,是多對象自動抄表系統(tǒng)的通信橋梁,負(fù)責(zé)對各智能表的數(shù)據(jù)進(jìn)行采集、存儲和管理,及時有效地向上位機傳輸數(shù)據(jù)并執(zhí)行上位機發(fā)送的指令。提高多對象集中器數(shù)據(jù)處理能力,有效完成上下行通信是多對象自動抄表系統(tǒng)AMRS(Automation Meter Reading System)目前需要解決的關(guān)鍵問題。 本文針對多對象集中器這樣一個較復(fù)雜的通信與控制系統(tǒng),提出采用32位的高性能嵌入式微處理器。32位ARM9微處理器處理速度快、硬件性能高、低功耗、低成本,集成了相當(dāng)多的硬件資源,硬件的擴展和設(shè)計大大簡化,ARM9(S3C2410)為工業(yè)級芯片,抗干擾能力強,能夠適應(yīng)運行現(xiàn)場的較惡劣環(huán)境,8/16位微控制器運算能力有限,對于較復(fù)雜的通信與控制算法難以順利完成;硬件平臺依賴性強,不利于軟件的開發(fā)、升級與移植;在缺乏多任務(wù)調(diào)度機制的情況下,應(yīng)用軟件不僅實現(xiàn)難度大,且可靠性難以保證。 本文首先對多對象遠(yuǎn)程抄表系統(tǒng)的總體結(jié)構(gòu)進(jìn)行研究,主要研究了多對象遠(yuǎn)程抄表系統(tǒng)中集中器的軟件和硬件實現(xiàn),對硬件資源進(jìn)行了外圍擴展,對S3C2410微處理器芯片的外圍硬件進(jìn)行了擴展設(shè)計,使之具備了滿足使用需求的最小系統(tǒng)硬件資源,包括時鐘、復(fù)位、電源、外圍存儲、LCD、RS-485通信模塊、CAN通信模塊等電路設(shè)計。實時時鐘為多對象集中器定時抄表提供時間標(biāo)準(zhǔn);電源電路為多對象集中器系統(tǒng)提供穩(wěn)定電源;看門狗電路的設(shè)計保證多對象集中器系統(tǒng)可靠運行,防止系統(tǒng)死機;數(shù)據(jù)存儲器主要用于存儲參數(shù)、變量、集中器自身的參數(shù),負(fù)責(zé)智能表的參數(shù)以及智能表用量等。上行通道即多對象集中器與上位機之間的通信線路,采用CAN現(xiàn)場總線進(jìn)行通信;下行通道即多對象集中器與智能表之間的通信,采用RS-485總線進(jìn)行通信。軟件設(shè)計上,主要針對多對象集中器的數(shù)據(jù)存儲功能和串行通訊功能進(jìn)行程序編寫。基于ARM的多對象遠(yuǎn)程抄表系統(tǒng)集中器可以實現(xiàn)多對象遠(yuǎn)程抄表,提高了數(shù)據(jù)處理能力,有效完成了上下行通信,可靠性強,穩(wěn)定性高,結(jié)構(gòu)簡單。

    標(biāo)簽: ARM 對象 遠(yuǎn)程抄表系統(tǒng) 集中器

    上傳時間: 2013-06-07

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