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PHY

（6層）S3C2410A 核心板硬件原理圖+PCB設計文件

S3C2410A_核心板硬件，采用6層板設計，ARM9處理器選用三星中的S3C2410A芯片，DDREAM選用K4S561632D-TC/L75，NOR FLASH選用SST39VF1601/1602，NAND FLASH選用K9F2808U0C-YCB0/YIB0，網(wǎng)口PHY芯片選用CS8900A，Protel 99se 設計的項目工程文件，包括原理圖及PCB印制板圖，可用Protel或 Altium Designer(AD)軟件打開或修改，都已經(jīng)制板在實際項目中使用，可作為你產(chǎn)品設計的參考。

標簽： s3c2410a pcb設計

上傳時間： 2022-05-17

上傳用戶：d1997wayne
Verilog實現(xiàn)千兆以太網(wǎng)傳輸

本實驗將實現(xiàn) FPGA 芯片和 PC 之間進行千兆以太網(wǎng)數(shù)據(jù)通信, 通信協(xié)議采用 Ethernet UDP 通信協(xié)議。 FPGA 通過 GMII 總線和開發(fā)板上的 Gigabit PHY 芯片通信, Gigabit PHY芯片把數(shù)據(jù)通過網(wǎng)線發(fā)給 PC

標簽： verilog 以太網(wǎng)

上傳時間： 2022-06-03

上傳用戶：得之我幸78
DP83848C原理圖

這個是STM32配合DP83848進行網(wǎng)絡通信的原理圖，實用的是RMII接口，這個DP83848近乎是所有官方例程所使用和推薦的為網(wǎng)絡通信（PHY）芯片，有想要多方面參考原理圖設計可可以下載看看

標簽： dp83848c 原理圖

上傳時間： 2022-06-05

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致象爾微TG401數(shù)據(jù)手冊

特點:o ARM? Cortex?-M4 CPU 平臺o 高達150MHz 的高性能Cortex?-M4 處理器o 集成FPU 和MPUo 內存o 512KB 片上SRAMo 2KB 至512KB 可編程保持存儲區(qū)o 閃存o 1MB 集成閃存o 原地執(zhí)行NOR 閃存接口，在閃存中執(zhí)行時接近0 等待狀態(tài)o 供電和復位管理系統(tǒng)o 片上穩(wěn)壓器，支持1.7V-3.6V 輸入o 上電復位（POR）o 時鐘管理o 10-30MHz 晶體振蕩器o 內部16MHz RCo 32kHz 晶體振蕩器o 內部32kHz RCo 具有可編程輸出頻率的低功耗PLLo 通用DMA：具有硬件流控制的8 通道DMA 控制器o 安全o 使用TRNG（真隨機數(shù)發(fā)生器）的簡單加密引擎o 定時器/計數(shù)器o 1x 系統(tǒng)節(jié)拍定時器o 4x 32 位定時器o 1x 看門狗定時器o 功耗（待確認）o 滿載：待定uA/MHz @ 25°Co 運行：待定uA /MHz @ 25°Co 停止：待定@ 25°Co 保留：待定@ 25°C，32kB 保留存儲器o 待機：待定@ 25°C，內部32kHz RCo 12 位逐次逼近寄存器（SAR）ADCo 每秒最多2M 樣本o 可通過8:1 多路復用器選擇輸入o 1 個帶有集成PHY 的USB 2.0 高速雙角色端口o 兩個SD / SDIO 主機接口o SD/SDIO 2.0 模式：時鐘高達50MHzo LCD 控制器o 分辨率高達480x320o 6800 和8080 異步模式（8 位）o JTAG 調試功能o 3 個PWM（6 個輸出），3 個捕捉和3 個QEP 模塊o 4x UART，帶有HW 流控制，最高可達4Mbpso 3x I2C，支持Fast Mode+（1000kbps）o 2x I2S 接口o 3x SPI 主器件高達25MHz，1x SPI 從器件高達10MHzo 32 個GPIOo 68 引腳QFN 封裝o 溫度范圍：-40 至85°C4.1 帶FPU 內核的ARM?CORTEX?-M4帶有FPU 處理器的ARM?Cortex?-M4 是一款32 位RISC 處理器，具有出色的代碼和功率效率。它支持一組DSP 指令，以允許高效執(zhí)行信號處理算法，非常適合于可穿戴和其他嵌入式市場。集成的單精度FPU（浮點單元）便于重用第三方庫，從而縮短開發(fā)時間。內部內存保護單元（MPU）用于管理對內的訪問，以防止一個任務意外破壞另一個活動任務使用的內存。集成緊密耦合的嵌套向量中斷控制器，提供多達16 個優(yōu)先級。4.2 系統(tǒng)內存Bock 包含512kB 零等待狀態(tài)SRAM，非常適合于當今算法日益增長的需求。同時，內存被細分為更小的區(qū)，從而可以單獨地關閉以降低功耗。4.3 閃存和XIP 單元提供1MB 的集成NOR 閃存，以支持CPU 直接執(zhí)行。為了提高性能，XIP 單元具有集成的緩存系統(tǒng)。緩沖內存與系統(tǒng)內存共享。與從系統(tǒng)內存運行性能相比，XIP 單元使得許多應用程序的運行接近100％。4.4 ROM集成ROM 固件包含通過NOR 閃存正常引導所需的引導加載程序，支持用于批量生產(chǎn)的閃存編程，還包括用于調試目的的UART 和USB 啟動功能。

標簽： tg401

上傳時間： 2022-06-06

上傳用戶：qdxqdxqdxqdx
基于Realtek RTL9047AA 的車用 7端口網(wǎng)路交換器方案

RTL9047A 為車用乙太網(wǎng)single chip 交換機方案,如下圖port0~port3 總共提供4ports 100BASE-T1,不用外掛PHY可節(jié)省cost 及PCB空間;port4為 selection port可選擇設定100BASE-T1或SGMII,其SGMII個外接CPU或對接相同型號switch做cascade擴充;port5為 selection port可選擇設定傳統(tǒng)100base-TX FE PHY, SGMII或 RGMII/MII/RMII,其100base-TX 界面作為車載Diagnostic界面;port6為RGMII/MII/RMII 界面,可用來外接CPU或擴充網(wǎng)路界面等應用。

標簽： realtek rtl9047aa

上傳時間： 2022-06-07

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datasheet

DM9161規(guī)格書，PHY芯片，用于以太網(wǎng)

標簽： datasheet

上傳時間： 2022-06-09

上傳用戶：15371038988
MIPI D-PHY Specification

MIPI_D-PHY_Specification

標簽： mipi D-PHY

上傳時間： 2022-06-11

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LoRa技術問題解答(匯總)

前幾天AUGTEK 發(fā)表了《LoRa 技術，你來問，我來答》上下兩部分，考慮到這一部分內容是對《LoRa 科普》很好的補充，故整合發(fā)布。感興趣的盆友可以多關注菜單欄，如果有新的LoRa 技術提問，小編會及時整合更新。鑒于LoRaWAN Server 是LoRaWAN 網(wǎng)絡框架中是比較重要的一環(huán)，且目前全球僅有少數(shù)幾家產(chǎn)商能夠提供，小編將在下篇新文章中為大家重點介紹。1. 什么是LoRa？LoRa 是低功耗廣域網(wǎng)通信技術中的一種，是Semtech 公司采用和推廣的一種基于擴頻技術的超遠距離無線傳輸技術，是Semtech 射頻部分產(chǎn)生的一種獨特的調制格式。LoRa 射頻部分的核心芯片是SX1276 和SX1278。這類芯片集成規(guī)模小、效率高，為LoRa 無線模塊帶來高接收靈敏度。而網(wǎng)關芯片則采用的是集成度更高、信道數(shù)更多的SX1301。用SX1301 作為核心開發(fā)出的LoRa 網(wǎng)關，可以與許許多多的LoRa 模塊構成多節(jié)點的復雜的物聯(lián)網(wǎng)自組網(wǎng)。2. LoRa是擴頻技術嗎？ LoRa 是一種擴頻技術，但它不是直接序列擴頻。直接序列擴頻通過調制載波芯片來傳輸更多的頻譜，從而提高編碼增益。而LoRa 調制與多狀態(tài)FSK 調制類似，使用未調制載波來進行線性調頻，使能量分散到更廣泛的頻段。3. LoRa 是Mesh 網(wǎng)絡、點對點傳輸還是星形網(wǎng)絡？ LoRa調制技術本身是一個物理層（ PHY layer ）協(xié)議，能被用在幾乎所有的網(wǎng)絡技術中。Mesh 網(wǎng)絡雖然擴展了網(wǎng)絡覆蓋的范圍，但是卻犧牲了網(wǎng)絡容量、同步開銷、電池使用壽命。隨著LoRa 技術鏈路預算和覆蓋距離的同時提升， Mesh 網(wǎng)絡已不再適合，故采用星形的組網(wǎng)方式來優(yōu)化網(wǎng)絡結構、延長電池壽命、簡化安裝。LoRa 網(wǎng)關和模塊間以星形網(wǎng)方式組網(wǎng)，而LoRa 模塊間理論上可以以點對點輪詢的方式組網(wǎng)，當然點對點輪詢效率要遠遠低于星形網(wǎng)

標簽： lora

上傳時間： 2022-06-19

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SPI-4.2協(xié)議詳解

1. 文檔概述1.1. 文檔目的本文檔描述對SPI-4.2 協(xié)議的理解，從淺入深地詳細講解規(guī)范。1.2. SPI-4.2 簡介SPI-4.2 協(xié)議的全稱為System Packet Interface ，可譯為“系統(tǒng)包接口” 。該協(xié)議由OIF（ Optical Internetwoking Forum ）創(chuàng)建，用于規(guī)定10Gbps 帶寬應用下的物理層（ PHY）和鏈路層（ Link ）之間的接口標準。SPI-4.2 是一個支持多通道的包或信元傳輸?shù)慕涌冢饕獞糜贠C-192 ATM 或PoS 的帶寬匯聚、及10G 以太網(wǎng)應用中。1.3. 參考資料1) SPI-4.2 協(xié)議的標準文檔。2) 中興公司對SPI-4.2 協(xié)議文檔的翻譯稿。2. SPI-4.2 協(xié)議2.1. SPI-4.2 系統(tǒng)參考模型圖 1 SPI-4.2 系統(tǒng)參考模型圖X:\ 學習筆記\SPI-4.2 協(xié)議詳解.doc - 1 - 創(chuàng)建時間： 2011-5-27 21:53:00田園風光書屋NB0005 v1.1 SPI-4.2 協(xié)議詳解SPI-4.2 是一種物理層和鏈路層之間的支持多通道的數(shù)據(jù)包傳輸協(xié)議，其系統(tǒng)參考模型如上圖所示，從鏈路層至物理層的數(shù)據(jù)方向，稱為“發(fā)送”方向，從物理層至鏈路層的數(shù)據(jù)方向，稱為“接收”方向。在兩個方向上，都存在著流控機制。值得注意的是， SPI-4.2 是一種支持多通道（ Port）的傳輸協(xié)議。一個通道，指接收或發(fā)送方向上，相互傳輸數(shù)據(jù)的一對關聯(lián)的實體。有很多對關聯(lián)的實體，即很多個通道，都在同時傳輸數(shù)據(jù)，它們可復用SPI 總線。最多可支持256 個通道。例如OC-192 的192 個STS-1 通道，快速以太網(wǎng)中的100 個通道等，各個通道的數(shù)據(jù)都可以相互獨立地復用在SPI總線上傳輸。

標簽： SPI-4.2協(xié)議

上傳時間： 2022-06-19

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基于有藍牙共存情況下的WiFi射頻模塊設計

移動通信網(wǎng)絡由于帶寬和技術的限制，遠遠不能滿足人們不斷高漲的無線上網(wǎng)需求。Wi-Fi作為無線接入技術MLAN的主流標準口益成熟，它能夠隨時隨地高速連接到Internet，極大地滿足了用戶對無線上網(wǎng)需求，受到消費者的青睞。因而越來越多的移動終端都集成了Wi-Fi功能，Wi-Fi和藍牙樣成為移動終端的標配。隨之而來的是wi-Fi和藍牙都工作在2.4CHZz ISM頻段而引發(fā)的互相擾問題，導致數(shù)據(jù)吞吐量下降，語音質量惡化失真，極端狀況下甚至導致鏈路斷開而不能正常工作。因此，必須尋求有效的措施和方法，實現(xiàn)兩種技術在近距離的和諧共存，這已成為非常迫切的技術需要，也成為人們研究的一個熱點和難點。近距離WiFi和藍牙互相1擾的問題，目前已經(jīng)形成了非常多的有效解決機制，包括基于Wi-Fi的PTA（Packet Traffic Arbitration）、AWMA（Alternating Wireless Medium Access）和DSE（Deterministic Spectral Excision），其中PTA和AWMA機制在Wi-Fi側MAC層實現(xiàn)，通過協(xié)調Wi-Fi和藍牙的幀發(fā)射時間來避免相互干擾：而DSE是在Wi-Fi側物理層PHY實現(xiàn)，通過一個可編程帶阻濾波器（Notch Filter）來阻止來白藍牙的窄帶干擾。還有基于藍牙側的AFH（Adaptive Frequency Hopping），它通過跳頻，自動避開被干擾的頻點，從而大大提高了藍牙傳輸性能。

標簽： 藍牙共存 wifi 射頻模塊

上傳時間： 2022-06-20

上傳用戶：zhanglei193

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PHY

（6層）S3C2410A 核心板硬件原理圖+PCB設計文件

Verilog實現(xiàn)千兆以太網(wǎng)傳輸

DP83848C原理圖

致象爾微TG401數(shù)據(jù)手冊

基于Realtek RTL9047AA 的車用 7端口網(wǎng)路交換器方案

datasheet

MIPI D-PHY Specification

LoRa技術問題解答(匯總)

SPI-4.2協(xié)議詳解

基于有藍牙共存情況下的WiFi射頻模塊設計