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PLD

可編程邏輯器件英文全稱為：programmablelogicdevice即PLD。PLD是做為一種通用集成電路產(chǎn)生的，他的邏輯功能按照用戶對(duì)器件編程來(lái)確定。一般的PLD的集成度很高，足以滿足設(shè)計(jì)一般的數(shù)字系統(tǒng)的需要。

注1：含有不可綜合語(yǔ)句

注1：含有不可綜合語(yǔ)句，請(qǐng)自行修改注2：一些PLD只允許I/O口對(duì)外三態(tài)，不支持內(nèi)部三態(tài)，使用時(shí)要注意注3: 設(shè)計(jì)RAM的最好方法是利用器件廠家提供的軟件自動(dòng)生成RAM元件，并在VHDL程序中例化

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上傳時(shí)間： 2016-05-03

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用fpga實(shí)現(xiàn)的DA轉(zhuǎn)換器

用fpga實(shí)現(xiàn)的DA轉(zhuǎn)換器，有說(shuō)明和源碼，VDHL文件。 A PLD Based Delta-Sigma DAC Delta-Sigma modulation is the simple, yet powerful, technique responsible for the extraordinary performance and low cost of today s audio CD players. The simplest Delta-Sigma DAC consists of a Delta-Sigma modulator and a one bit DAC. Since, both of these components can be realized using digital circuits, it is possible to implement a low precision Delta-Sigma DAC using a PLD.

標(biāo)簽： fpga DA轉(zhuǎn)換器

上傳時(shí)間： 2016-06-10

上傳用戶：bjgaofei
編輯軟件

編輯軟件，PLD文件的編輯，主要用于gal16v8的匯編。

標(biāo)簽： 編輯軟件

上傳時(shí)間： 2013-12-21

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4*4鍵盤顯示的4x4鍵盤識(shí)別與顯示模塊。小鍵盤中有0~f共16個(gè)按鍵

4*4鍵盤顯示的4x4鍵盤識(shí)別與顯示模塊。小鍵盤中有0~f共16個(gè)按鍵，小鍵盤和數(shù)碼管都連接到PLD芯片上，要求：按下哪個(gè)按鍵，數(shù)碼管就顯示哪個(gè)數(shù)碼，松手后仍然顯示該數(shù)碼，直到按動(dòng)新的按鍵。顯示字符字形如表5-1所示。在此設(shè)計(jì)中，7段數(shù)碼管只是個(gè)驗(yàn)證工具，因?yàn)閷?shí)際應(yīng)用中通常是一排數(shù)碼管，而不是一個(gè)數(shù)碼管。PLD芯片在此主要完成按鍵識(shí)別和顯示驅(qū)動(dòng)。

標(biāo)簽： 4x4 鍵盤顯示顯示模塊按鍵

上傳時(shí)間： 2016-08-15

上傳用戶：電子世界
四個(gè)撥碼開(kāi)關(guān)

四個(gè)撥碼開(kāi)關(guān)，撥上去對(duì)應(yīng)的前四個(gè)LED燈亮，體現(xiàn)了PLD io功能的靈活。請(qǐng)把撥碼開(kāi)關(guān)右上方的跳線帽跳上，同時(shí)拔掉ADC0804的跳線帽。

標(biāo)簽： 撥碼開(kāi)關(guān)

上傳時(shí)間： 2013-12-23

上傳用戶：tianjinfan
“數(shù)字電子技術(shù)”課程是電力類、自動(dòng)化類和計(jì)算機(jī)類等專業(yè)的一門重要的技術(shù)基礎(chǔ)課,具有很強(qiáng)的實(shí) 踐性,因此實(shí)驗(yàn)是“數(shù)字電子技術(shù)”課程教學(xué)中不可缺少的重要環(huán)節(jié)。隨著科學(xué)技術(shù)的發(fā)展,尤其是微電子

“數(shù)字電子技術(shù)”課程是電力類、自動(dòng)化類和計(jì)算機(jī)類等專業(yè)的一門重要的技術(shù)基礎(chǔ)課,具有很強(qiáng)的實(shí) 踐性,因此實(shí)驗(yàn)是“數(shù)字電子技術(shù)”課程教學(xué)中不可缺少的重要環(huán)節(jié)。隨著科學(xué)技術(shù)的發(fā)展,尤其是微電子技術(shù)和計(jì)算機(jī)技術(shù)取得的重大進(jìn)展,數(shù)字邏輯器件已由中、小規(guī)模的TTL 集成電路發(fā)展到大規(guī)模和超大規(guī) 模的可編程邏輯器件( PLD) 。相對(duì)應(yīng)地,數(shù)字邏輯電路的研究和實(shí)現(xiàn)方法隨之發(fā)生變化,從而促使“數(shù)字電子技術(shù)”實(shí)驗(yàn)的實(shí)驗(yàn)內(nèi)容、教學(xué)方式、實(shí)驗(yàn)手段和考核方式也應(yīng)該進(jìn)行不斷的更新、完善和開(kāi)拓。相比之下, 傳統(tǒng)的實(shí)驗(yàn)教學(xué)模式就顯得格格不入,已不能適應(yīng)現(xiàn) 代電子技術(shù)發(fā)展的需求,因此對(duì)電子技術(shù)實(shí)驗(yàn)教學(xué)模式的改革就勢(shì)在必行[1 ] 。

標(biāo)簽： 數(shù)字電子技術(shù) 技術(shù)基礎(chǔ) 實(shí)驗(yàn) 發(fā)展

上傳時(shí)間： 2017-01-28

上傳用戶：tfyt
純組合邏輯構(gòu)成的乘法器雖然工作速度比較快

純組合邏輯構(gòu)成的乘法器雖然工作速度比較快，但過(guò)于占用硬件資源，難以實(shí)現(xiàn)寬位乘法器，基于PLD器件外接ROM九九表的乘法器則無(wú)法構(gòu)成單片系統(tǒng)，也不實(shí)用。這里介紹由八位加法器構(gòu)成的以時(shí)序邏輯方式設(shè)計(jì)的八位乘法器，具有一定的實(shí)用價(jià)值，而且由FPGA構(gòu)成實(shí)驗(yàn)系統(tǒng)后，可以很容易的用ASIC大型集成芯片來(lái)完成，性價(jià)比高，可操作性強(qiáng)。

標(biāo)簽： 組合邏輯乘法器比較速度

上傳時(shí)間： 2017-02-03

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課程設(shè)計(jì)

課程設(shè)計(jì)，使用硬件描述語(yǔ)言對(duì)數(shù)字電路與系統(tǒng)進(jìn)行建模，仿真與實(shí)現(xiàn)的方法，ASM圖，PLD器件

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上傳時(shí)間： 2017-02-28

上傳用戶：hanli8870
在深圳固高科技器械平臺(tái)上實(shí)現(xiàn)倒立擺的實(shí)驗(yàn)研究以及相關(guān)器械使用手冊(cè)

在深圳固高科技器械平臺(tái)上實(shí)現(xiàn)倒立擺的實(shí)驗(yàn)研究以及相關(guān)器械使用手冊(cè)，能實(shí)現(xiàn)倒立擺的PLD調(diào)節(jié)等等！

標(biāo)簽： 倒立擺使用手冊(cè) 實(shí)驗(yàn)

上傳時(shí)間： 2013-12-17

上傳用戶：AbuGe
-- ------------------------------------------------------------------------------------ -- DESCRIP

-- ------------------------------------------------------------------------------------ -- DESCRIPTION : Demultiplexer -- Width: 8 -- Number of terminals: 4 -- Output enable active: HIGH -- Output active : HIGH -- Download from : http://www.PLD.com.cn ------------------------------------------------------------------------------------

標(biāo)簽： DESCRIP

上傳時(shí)間： 2013-12-27

上傳用戶：wangzhen1990

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