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QUartus

QUartusIIdesign是最高級和復(fù)雜的，用于system-on-a-programmable-chip(SOPC)的設(shè)計環(huán)境。QUartusIIdesign提供完善的timingclosure和LogicLock?基于塊的設(shè)計流程。QUartusIIdesign是唯一一個包括以timingclosure和基于塊的設(shè)計流為基本特征的programmablelogicdevice(PLD)的軟件。QUartusII設(shè)計軟件改進了性能、提升了功能性、解決了潛在的設(shè)計延遲等，在工業(yè)領(lǐng)域率先提供FPGA與mask-programmeddevices開發(fā)的統(tǒng)一工作流程。

利用vhdl語言編程實現(xiàn)的pn碼產(chǎn)生.在QUartus ii中通過

利用vhdl語言編程實現(xiàn)的pn碼產(chǎn)生.在QUartus ii中通過

標(biāo)簽： QUartus vhdl 語言編程實現(xiàn)

上傳時間： 2013-12-12

上傳用戶：ryb
該程序是用QUartus II作為開發(fā)工具

該程序是用QUartus II作為開發(fā)工具，用verilog語言編寫，實現(xiàn)helloworld的實例。對初學(xué)者很有意義

標(biāo)簽： QUartus 程序開發(fā)工具

上傳時間： 2014-12-22

上傳用戶：wpwpwlxwlx
該程序是用QUartus II作為開發(fā)工具

該程序是用QUartus II作為開發(fā)工具，用verilog語言編寫，實現(xiàn)全加器功能的實例。對初學(xué)者很有意義

標(biāo)簽： QUartus 程序開發(fā)工具

上傳時間： 2016-07-12

上傳用戶：cxl274287265
SOPC實驗--Hello World實驗:啟動QUartus II軟件

SOPC實驗--Hello World實驗:啟動QUartus II軟件，選擇File→New Project Wizard，在出現(xiàn)的對話框中填寫項目名稱 2、點擊Finish，然后選擇“是”。選擇Assignments→Device，改寫各項內(nèi)容。Family改為CycloneII，根據(jù)實驗板上的器件選擇相應(yīng)的器件，本實驗選擇EP2C5T144C8,點擊對話框中的Device & Pin Options，在Configuration中，選項Use Configuration Device為EPCS1，選項Unused Pins為As inputs,tri-stated.

標(biāo)簽： QUartus Hello World SOPC

上傳時間： 2014-01-13

上傳用戶：梧桐
利用Verilog實現(xiàn)交通燈控制 QUartus II平臺實現(xiàn)仿真

利用Verilog實現(xiàn)交通燈控制 QUartus II平臺實現(xiàn)仿真

標(biāo)簽： Verilog QUartus 交通燈控制仿真

上傳時間： 2014-12-07

上傳用戶：2404
Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

標(biāo)簽： Verylog QUartus 編寫仿真

上傳時間： 2014-01-20

上傳用戶：英雄
Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

標(biāo)簽： Verylog QUartus 編寫仿真

上傳時間： 2013-12-18

上傳用戶：gaome
流水燈　Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

流水燈　Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

標(biāo)簽： Verylog QUartus 流水燈仿真

上傳時間： 2014-01-18

上傳用戶：zhuimenghuadie
PLL 時鐘模塊　　QUartus II平臺的簡單設(shè)計實例　附仿真波形

PLL 時鐘模塊　　QUartus II平臺的簡單設(shè)計實例　附仿真波形

標(biāo)簽： QUartus PLL 時鐘模塊仿真

上傳時間： 2014-11-12

上傳用戶：小草123
使用QUartus II設(shè)計FPGA的應(yīng)用設(shè)計實例  “Example-b3-1uart_regssrc”目錄下為設(shè)計源文件  “Example-b3-1uart_

使用QUartus II設(shè)計FPGA的應(yīng)用設(shè)計實例  “\Example-b3-1\uart_regs\src”目錄下為設(shè)計源文件  “\Example-b3-1\uart_regs\core”目錄下為Altera的IP宏功能模塊  “\Example-b3-1\uart_regs\sim\funcsim”目錄下為功能仿真文件  “\Example-b3-1\uart_regs\sim\parsim”目錄下為時序仿真文件  “\Example-b3-1\uart_regs\dev”目錄下為工程文件（包含了約束、綜合、布局布線的過程文件和結(jié)果文件）

標(biāo)簽： Example-b 61548 uart_regssrc QUartus

上傳時間： 2016-07-18

上傳用戶：wlcaption

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QUartus

利用vhdl語言編程實現(xiàn)的pn碼產(chǎn)生.在QUartus ii中通過

該程序是用QUartus II作為開發(fā)工具

該程序是用QUartus II作為開發(fā)工具

SOPC實驗--Hello World實驗:啟動QUartus II軟件

利用Verilog實現(xiàn)交通燈控制 QUartus II平臺實現(xiàn)仿真

Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

流水燈　Verylog編寫的　QUartus II平臺的簡單設(shè)計實例　附仿真波形

PLL 時鐘模塊　　QUartus II平臺的簡單設(shè)計實例　附仿真波形

使用QUartus II設(shè)計FPGA的應(yīng)用設(shè)計實例  “Example-b3-1uart_regssrc”目錄下為設(shè)計源文件  “Example-b3-1uart_