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RS糾錯(cuò)編碼

LCD 電子密碼鎖

LCD 電子密碼鎖

標(biāo)簽： LCD

上傳時(shí)間： 2013-04-15

上傳用戶：eeworm
HOLTEK-微電腦密碼鎖-11頁(yè)-0.4M.rar

專輯類----單片機(jī)專輯 HOLTEK-微電腦密碼鎖-11頁(yè)-0.4M.rar

標(biāo)簽： HOLTEK 0.4 11

上傳時(shí)間： 2013-06-12

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LCD-電子密碼鎖-4頁(yè)-2.2M.pdf

專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G LCD-電子密碼鎖-4頁(yè)-2.2M.pdf

標(biāo)簽： LCD 2.2 頁(yè)

上傳時(shí)間： 2013-07-29

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計(jì)算機(jī)通信與rs-232接口實(shí)用指南-549頁(yè)-11.2M.pdf

專輯類-數(shù)字處理及顯示技術(shù)專輯-106冊(cè)-9138M 計(jì)算機(jī)通信與rs-232接口實(shí)用指南-549頁(yè)-11.2M.pdf

標(biāo)簽： 11.2 232 549

上傳時(shí)間： 2013-07-14

上傳用戶：wc412467303
RS-232／RS-485無(wú)源轉(zhuǎn)換電路設(shè)計(jì).rar

RS-232／RS-485 無(wú)源轉(zhuǎn)換電路設(shè)計(jì)

標(biāo)簽： RS 232 485

上傳時(shí)間： 2013-06-30

上傳用戶：rocwangdp
RS-485總線可靠性應(yīng)用研究.rar

RS-485總線可靠性應(yīng)用研究介紹的相當(dāng)詳細(xì)

標(biāo)簽： 485 RS 總線

上傳時(shí)間： 2013-05-17

上傳用戶：as275944189
基于RS-485的多點(diǎn)數(shù)據(jù)采集與顯示系統(tǒng).rar

基于RS-485的多點(diǎn)數(shù)據(jù)采集與顯示系統(tǒng)。

標(biāo)簽： 485 RS 多點(diǎn)

上傳時(shí)間： 2013-05-24

上傳用戶：huql11633
RS編譯碼器的設(shè)計(jì)與FPGA實(shí)現(xiàn)

Reed-Solomon碼(簡(jiǎn)稱RS碼)是一種具有很強(qiáng)糾正突發(fā)和隨機(jī)錯(cuò)誤能力的信道編碼方式，在深空通信、移動(dòng)通信、磁盤(pán)陣列以及數(shù)字視頻廣播(DVB)等系統(tǒng)中具有廣泛的應(yīng)用。本文簡(jiǎn)要介紹了有限域基本運(yùn)算的算法和常用的RS編碼算法，分析了改進(jìn)后的Euclid算法和改進(jìn)后的BM算法，針對(duì)改進(jìn)后的BM算法提出了一種流水線結(jié)構(gòu)的譯碼器實(shí)現(xiàn)方案并改進(jìn)了該算法的實(shí)現(xiàn)結(jié)構(gòu)，在譯碼器復(fù)雜度和譯碼延時(shí)上作了折衷，降低了譯碼器的復(fù)雜度并提高了譯碼器的最高工作頻率。在Xilinx公司的Virtex-Ⅱ系列FPGA上設(shè)計(jì)實(shí)現(xiàn)了RS(255,239)編譯碼器，證明了該方案的可行性。

標(biāo)簽： FPGA RS編譯碼

上傳時(shí)間： 2013-06-11

上傳用戶：奇奇奔奔
RS（255，223）譯碼器的FPGA實(shí)現(xiàn)及其性能測(cè)試

　　本課題首先研究了常規(guī)的RS譯碼器的算法，確定在關(guān)鍵方程的計(jì)算中采用一種新改進(jìn)的BM算法，然后提出了基于復(fù)數(shù)基的有限域快速并行乘法器和利用冪指數(shù)相減進(jìn)行除法計(jì)算的有限域除法器，通過(guò)這些優(yōu)化方法提高了RS譯碼器的速度，減少了譯碼延時(shí)和硬件資源使用，最后利用VHDL硬件描述語(yǔ)言在FPGA上實(shí)現(xiàn)了流水線處理的RS(255,223)譯碼器。　　本課題實(shí)現(xiàn)的RS(255,223)硬件譯碼器的性能在國(guó)內(nèi)具有領(lǐng)先水平，對(duì)我國(guó)以后航天項(xiàng)目高速數(shù)據(jù)傳輸系統(tǒng)的設(shè)計(jì)有著很大的意義。　

標(biāo)簽： FPGA 255 223 譯碼器

上傳時(shí)間： 2013-06-29

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IEEE 802.16a RS-CC編譯碼VLSI算法研究及FPGA實(shí)現(xiàn)

　　本論文依據(jù)IEEE802.16a物理層對(duì)RS-CC碼的參數(shù)要求，研究了RS-CC碼的高速編、譯碼的VLSI硬件算法，同時(shí)對(duì)FPGA開(kāi)發(fā)技術(shù)進(jìn)行了研究，以VerilogHDL為描述語(yǔ)言，在Xilinx公司的FPGA上實(shí)現(xiàn)了高速的RS-CC編、譯碼器。RS譯碼器中，錯(cuò)誤位置多項(xiàng)式和錯(cuò)誤值多項(xiàng)式的求解采用無(wú)求逆單元，并具有規(guī)則數(shù)據(jù)流、易于VLSI實(shí)現(xiàn)的改進(jìn)的歐幾里德算法(MEA)；CC譯碼器由采用模歸一化路徑度量的全并行的“加比選(ACS)”模塊和具有脈動(dòng)陣列結(jié)構(gòu)的幸存路徑回溯模塊組成。　　在實(shí)現(xiàn)RS-CC譯碼器的過(guò)程中，分別從算法上和根據(jù)FPGA的結(jié)構(gòu)特點(diǎn)上，對(duì)譯碼器做了一些優(yōu)化工作，降低了硬件資源占有率和提高了譯碼速度。　　此外，還搭建了以Xilinx公司40萬(wàn)等效門(mén)的FPGASpartan-Ⅲ400-4PQ208為主體，以Cypress公司的USB2.0芯片CY7C68013為高速數(shù)據(jù)接口的硬件試驗(yàn)平臺(tái)，并在此試驗(yàn)平臺(tái)上實(shí)現(xiàn)了文中的高速RS-CC編譯碼系統(tǒng)。

標(biāo)簽： 802.16 RS-CC IEEE FPGA

上傳時(shí)間： 2013-06-03

上傳用戶：lx9076