synopsys公司的專(zhuān)家講解如何用systemverilog寫(xiě)testbence來(lái)驗(yàn)證RTL代碼
標(biāo)簽： systemverilog testbence synopsys RTL
上傳時(shí)間： 2014-01-02
上傳用戶(hù)：410805624
比較經(jīng)典的使用verilog RTL規(guī)范coding style的書(shū)。
標(biāo)簽： verilog coding style RTL
上傳時(shí)間： 2013-12-25
上傳用戶(hù)：stampede
藍(lán)牙的一個(gè)ip RTL 核，不知道對(duì)大家有沒(méi)有用？謝謝。
標(biāo)簽： RTL 藍(lán)牙
上傳時(shí)間： 2014-01-04
上傳用戶(hù)：thuyenvinh
在 MAX+PLUS II開(kāi)發(fā)環(huán)境下采用 VHDL語(yǔ)言 設(shè)計(jì)并實(shí)現(xiàn)了電表抄表器 討論了系統(tǒng)的四個(gè) 組成模塊的設(shè)計(jì)和 VHDL 的實(shí)現(xiàn) 每個(gè)模塊采用 RTL 級(jí)描述 整體的生成采用圖形輸入法 通過(guò)波形仿真 下載芯片測(cè)試 完成了抄表器的功能
標(biāo)簽： VHDL PLUS MAX RTL
上傳時(shí)間： 2013-12-26
上傳用戶(hù)：myworkpost
Show hou use semaphores in RTL-ARM
標(biāo)簽： semaphores RTL-ARM Show hou
上傳時(shí)間： 2013-12-18
上傳用戶(hù)：鳳臨西北
RTL exmple program for keil
標(biāo)簽： program exmple keil RTL
上傳時(shí)間： 2013-12-23
上傳用戶(hù)：zhouchang199
Principles of Verifiable RTL Design.2nd.Edition.pdf
標(biāo)簽： Principles Verifiable Edition Design
上傳時(shí)間： 2017-05-25
上傳用戶(hù)：a3318966
C8051 RTL的匯編驅(qū)動(dòng)程序，如果能看懂會(huì)給你帶來(lái)很大的好處，學(xué)習(xí)的好資料.
標(biāo)簽： C8051 RTL 匯編 驅(qū)動(dòng)程序
上傳時(shí)間： 2017-06-06
上傳用戶(hù)：tfyt
usb RTL code, to fpga or asic
標(biāo)簽： code asic fpga usb
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sparc org, vhdl RTL code
標(biāo)簽： sparc code vhdl org
上傳時(shí)間： 2017-06-09
上傳用戶(hù)：xmsmh
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