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S-H

  • 基于FPGA的H.264變換量化、去方塊濾波研究及設計.rar

    H.264/AVC是由國際電信聯合會的視頻專家組和國際標準化組織的運動圖像專家組組成的聯合視頻小組制定的下一代視頻壓縮標準。新標準采用了一些先進算法,因此具有優異的壓縮性能和極好的網絡親和性,滿足低碼率情況下的高質量視頻的傳輸。 H.264/AVC采用的先進算法包括多模式幀間預測、1/4像素精度預測、整數變換量化、去方塊濾波和熵編碼。本論文著重對整數變換與量化、去方塊濾波做了研究。整數變換是一種只有加法和移位的運算,量化可以通過查表和乘法操作就可以完成,避免了反變換的時候失配問題,沒有精度損失;去方塊濾波是一種用來去除低碼率情況下的每個宏塊的塊效應,提高了解碼圖像的外觀。 本文主要從算法研究和硬件實現兩方面著手,在算法研究方面設計了一個可視化測試軟件,在硬件實現方面主要對整數變換、量化和去方塊濾波做了研究和實現。視頻壓縮技術的關鍵在于視頻壓縮算法及其芯片的實現,FPGA可重復使用,設計修改靈活,片內資源豐富,具備DSP模塊等優勢。在本論文的目標實現部分模塊FPGA的硬件設計,用Verilog完成了關鍵部分的設計。首先簡要介紹了視頻壓縮基本原理,常用視頻壓縮標準及其特性以及國內外的研究動態,并對H.264標準基本檔次所涉及的核心技術進行了詳細介紹,兩種分層結構分別討論。其次在掌握了H.264.算法及編解碼流程的基礎上,設計了基于H.264編解碼的可視化軟件平臺。然后詳細介紹了整數變換、量化、反變換和反量化核心模塊的設計和實現,并在Altera的軟件和開發板上進行了仿真驗證;對去方塊濾波算法做了軟件研究測試,并給出了一種改進的硬件整體結構設計。最后,對全文工作進行了總結和對未來研究工作做了展望。我在課題中所做的主要工作有: 1.查閱相關文獻,熟悉H.264.標準及整數變換、量化和去方塊濾波等算法。 2.用VC++完成了基于H.264編解碼的可視化軟件平臺設計。 3.用Verilog完成了整數變換量化、反變換反量化模塊FPGA設計與驗證。 4.去方塊濾波器的算法研究、仿真和硬件整體結構設計。

    標簽: FPGA 264 變換

    上傳時間: 2013-04-24

    上傳用戶:lanjisu111

  • H.264幀內預測算法優化及幾個重要模塊的FPGA實現.rar

    H.264作為新一代視頻編碼標準,相比上一代視頻編碼標準MPEG2,在相同畫質下,平均節約64﹪的碼流。該標準僅設定了碼流的語法結構和解碼器結構,實現靈活性極大,其規定了三個檔次,每個檔次支持一組特定的編碼功能,并支持一類特定的應用,因此。H.264的編碼器的設計可以根據需求的不同而不同。 H.264雖然具有優異的壓縮性能,但是其復雜度卻比一般編碼器高的多。本文對H.264進行了編碼復雜度分析,并統計了整個軟件編碼中計算量的分布。H.264中采用了率失真優化算法,提高了幀內預測編碼的效率。在該算法下進行幀內預測時,為了得到一個宏塊的預測模式,需要進行592次率失真代價計算。因此為了降低幀內預測模式選擇的計算復雜度,本文改進了幀內預測模式選擇算法。實踐證明,在PSNR值的損失可以忽略不計的情況下,該算法相比原算法,幀內編碼時間平均節約60﹪以上,對編碼的實時性有較大幫助。 為了實現實時編碼,考慮到FPGA的高效運算速度和使用靈活性,本文還研究了H.264編碼器基本檔次的FPGA實現。首先研究了H.264編碼器硬件實現架構,并對影響編碼速度,且具有硬件實現優越性的幾個重要部分進行了算法研究和FPGA.實現。本文主要研究了H.264編碼器中整數DCT變換、量化、Zig-Zag掃描、CAVLC編碼以及反量化、逆整數DCT變換等部分。分別對這些模塊進行了綜合和時序仿真,并將驗證后通過的系統模塊下載到Xilinx virtex-Ⅱ Pro的FPGA中,進行了在線測試,驗證了該系統對輸入的殘差數據實時壓縮編碼的功能。 本文對H.264編碼器幀內預測模式選擇算法的改進,算法實現簡單,對軟件編碼的實時性有很大幫助。本文對在單片FPGA上實現H.264編碼器做出了探索性嘗試,這對H.264編碼器芯片的設計有著積極的借鑒性。

    標簽: FPGA 264 幀內預測

    上傳時間: 2013-06-13

    上傳用戶:夜月十二橋

  • 基于H.264編解碼的算法優化研究及FPGA的硬件實現.rar

    H.264/AVC是由ITU和ISO兩大組織聯合組成的JVT共同制定的一項新的視頻壓縮技術標準,在較低帶寬上提供高質量的圖像傳輸是H.264/AVC的應用亮點。在同樣的視覺質量前提下,H.264/AVC比H.263和MPEG-4節約了50%的碼率。但H.264獲得優越性能的代價是計算復雜度的增加,據估計其編碼的計算復雜度大約為H.263的3倍,因此很難應用于實時視頻處理領域。針對這一現狀,業內做了大量的研究工作,力圖降低其計算復雜度和提高運行效率。比如在運動估計方面,國內外在這方面的研究已經很成熟。而針對幀內/幀間預測編碼的研究卻較少。因此研究預測模式的快速算法具有理論意義和應用價值。 本文在詳細研究H.264標準視頻壓縮編碼特點基礎上,分析了H.264幀內編碼, 幀間編碼及變換,量化技術的原理及特點,提出了一種基于局部邊緣方向信息的快速幀內模式判決算法,通過結合SAD的模式選擇方法來減少模式選擇數目。它采用了Sobel梯度算子計算當前塊的邊緣信息,累加當前塊中屬于同一方向像素點的邊緣矢量構造不同模式下的邊緣方向直方圖,以便確定最可能的預測模式。該算法有效降低了編碼器的運算復雜度,在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明:Foreman 圖像序列編碼性能有了提高,其中PSNR平均降低了0.06dB,Bitrate平均降低了19.4%,這大大提高了視頻傳輸的質量。 另外在幀間預測模式選擇算法方面進行了改進研究:按順序對不同類型進行判決,有選擇地去比較可能模式,使得在有效減少需判決的模式數量的同時,結合小塊模式搜索中途停止準則來確定最優模式。仿真表明:改進算法相對與原來算法能夠節省很多的編碼時間(平均下降了49.3%),但帶來的圖像質星的下降(平均下降0.08dB,可以忽略)和碼率較少的增加。 同時在整數DCT變換模塊中,提出了一種快速蝶形算法,使得對4×4點數據做一次變換,只需通過8×8次加法和2×8次移位運算便可完成,與原來12×8次加法和4×8次移位相比,新算法大大降低了運算復雜度。 最后介紹FPGA的特點及設計流程,并實現了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實現的H.264編碼視頻處理模塊設計具備了成本低,周期短,設計方法靈活等優點,具有廣闊的市場應用前景。 仿真表明,通過使用本文提出的幀內/幀間速算法方法可使得H.264編碼速度獲得顯著的提高,使H.264 Baseline編碼器能在PC平臺上實現實時編碼。

    標簽: FPGA 264 編解碼

    上傳時間: 2013-07-18

    上傳用戶:zukfu

  • 適用于H.264視頻解碼器的VLD設計

    設計了一種適合于H.264 的變字長解碼器根據碼流特點進行模塊劃分減少硬件開銷采用并行結構解NAL 包解碼效率高采用了桶形移位器進行并行解碼每個時鐘解一個碼字采用Verilog 語言進行設計仿真并通過

    標簽: 264 VLD 視頻解碼器

    上傳時間: 2013-07-15

    上傳用戶:shen007yue

  • h.264官方中文版

    H.264官方中文版,H.264官方中文版,H.264官方中文版,H.264官方中文版

    標簽: 264

    上傳時間: 2013-05-27

    上傳用戶:h886166

  • H.264解碼算法優化及在ARM上的移植

    在信息化發展的當前,音視頻等多媒體作為信息的載體,在社會生活的各個領域,起著越來越重要的作用。數字視頻的海量性成為阻礙其應用的的瓶頸之一。在這種情況下,H.264作為新一代的視頻壓縮標準,以其高性能的壓縮效率,成為備受關注的焦點和研究問題。H.264通過運動估計/運動補償(MP/MC)消除視頻時間冗余,對差值圖像進行離散余弦變換(DCT)消除空間冗余,對量化后的系數進行可變長編碼(VLC)消除統計冗余,獲得了極高的壓縮效率。隨著嵌入式處理器性能的逐漸提升和3G網絡即將商用的推動,H.264以其優秀的壓縮性能,無論是無線信道傳輸方面,還是存儲容量有限的嵌入式設備都具有廣闊的應用前景。 但H.264在提升壓縮性能的同時付出的代價是算法復雜度的成倍增加,實際應用中人們對視頻解碼的實時性要求嚴格,已出現的對應算法代碼多基于PC通用處理器實現,而嵌入式設備的主頻和處理能力仍然相對有限,存儲容量相對較小,總線速率相對偏低,因此必須對標準對應算法進行優化移植,才能滿足實際應用的需求。 本文在對H.264標準及其新特性進行詳細介紹后,重點研究了在解碼端如何針對解碼耗時較多的模塊進行改進,然后將算法移植到ARM平臺,并針對平臺特點作出相應優化,最后完成解碼圖象顯示,并給出了測試結果。本文主要完成的工作如下: 詳細分析了H.264的參考軟件JM中解碼流程,并利用測試工具分析了各模塊耗時,針對耗時較多的模塊如插值運算及去塊濾波模塊,提出了對應的改進算法并在H.264的參考軟件JM86上進行了實現,PC測試實驗證明了算法改進的優越性和運算優化的可行性。最后針對ARM平臺,在對程序結構和對應代碼進行優化之后,將其移植到WINCE系統之下,同時給出了WINCE平臺解碼后圖象加速顯示方法,并對最終測試結果與性能做出了評價。

    標簽: 264 ARM 解碼 算法優化

    上傳時間: 2013-06-04

    上傳用戶:shijiang

  • 基于H.264的無線傳輸差錯控制及解碼器的ARM實現

    信息化社會的到來以及IP技術的興起,正深刻的改變著電信網絡的面貌以及未來技術發展的走向。無線通信技術的發展為實現數字化社區提供了有力的保證。而視頻通信則成為多媒體業務的核心。如何在環境惡劣的無線環境中,實時傳輸高質量的視頻面臨著巨大的挑戰,因此這也成為人們的研究熱點。 對于無線移動信道來說,網絡的可用帶寬是有限的。由于多徑、衰落、時延擴展、噪聲影響和信道干擾等原因,無線移動通信不僅具有帶寬波動的特點,而且信道誤碼率高,經常會出現連續的、突發性的傳輸錯誤。無線信道可用帶寬與傳輸速率的時變特性,使得傳輸的可靠性大為降低。 視頻播放具有嚴格的實時性要求,這就要求網絡為視頻的傳輸提供足夠的帶寬.有保障的延時和誤碼率。為了獲得可接受的重建視頻質量,視頻傳輸至少需要28Kbps左右的帶寬。而且視頻傳輸對時延非常敏感。然而無線移動網絡卻無法提供可靠的服務質量。 基于無線視頻通信面臨的挑戰,本文在對新一代視頻編碼國際標準H.264/AVC研究的基礎上,主要在提高其編碼效率和H.264的無線傳輸抗誤碼性能,以及如何在嵌入式環境下實現H.264解碼器進行了研究。 結合低碼率和幀內刷新,提出一種針對感興趣區的可變幀內刷新方法。實驗表明該方法可以使用較少的碼率對感興趣區域進行更好的錯誤控制,以提高區域圖像質量,同時能根據感興趣區及信道的狀況自動調整宏塊刷新數量,充分利用有限的碼率。 為了有效的平衡編碼效率和抗誤碼能力的之間的矛盾,筆者提出了一種自適應FMO(Flexible Macroblock Order)編碼方法,可根據圖像的復雜度自適應地選擇編碼所需的FMO模式。仿真結果表明這種FMO編碼方式完全可行,且在運動復雜度頻繁變化時效果更加明顯,完全可應用在環境惡劣的無線信道中。 在對嵌入式PXA270硬件結構和X264研究的基礎上,基本實現了基于H.264的嵌入式解碼,在PXA270基礎上進行環境的配置,定制WirtCE操作系統,并編譯、產生開發所用的SDK和下載內核到目標機。利用開發工具EVC實現在PC機上的實時開發和在線仿真調試,最終實現了對無差錯H.264碼流實時解碼。

    標簽: 264 ARM 無線傳輸 差錯控制

    上傳時間: 2013-06-18

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  • H.264高清視頻編解碼系統中ARM控制模塊的軟件設計.pdf

    隨著數字電視日益深入人心,高清概念越來越為人所熟知。帶有高清視頻功能的產品已經逐步走向人們的工作和生活,高清視頻處理已經從理論研究走向系統實際應用。毫無疑問,無論是從觀眾的視覺還是從產業的角度來看,高清視頻已經成為數字視頻技術發展的必然趨勢。本文研究了整個編解碼系統中ARM控制模塊的軟件設計,最終完成以PC機為終端控制平臺,經ARM控制模塊將命令發送給核心編解碼芯片MB86H51,使其完成相應的操作。、本文主要的工作有如下幾個方面: 1、根據ARM各型號芯片的特點,結合本系統的實際需求,最終選定Atmel公司的AT91SAM9261作為ARM控制板的核心處理芯片,并深入了解該芯片的工作原理和內部結構。 2、根據本系統中所選用的DataFlash型號及外圍電路連接情況等諸多因素,并結合Atmel公司所提供的AT91SAM9261一級BootLoader參考代碼,編寫調試符合本系統啟動運行的一級BootLoader引導程序,也稱為Bootstrap引導程序,最終成功實現引導U-Boot程序。 3、深入分析了U-Boot和Linux的體系結構和編譯過程,結合AT91SAM9261芯片的特點和實際外圍電路的連接情況,修改U-Boot和Linux中主要的編譯參數,并進行重新編譯,最終成功移植到系統板中。 4、在ITU-T提供的H.264標準的參考解碼程序JM8.6的基礎上,詳細研究了H.264視頻編碼標準以及具體的解碼器結構和解碼流程,并結合DirectX技術,開發了一款基于PC機的H.264解碼播放器,用于驗證存儲在PC機上的H.264壓縮碼流的正確性。

    標簽: 264 ARM 高清視頻

    上傳時間: 2013-04-24

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  • H-Bridge.rar

    protel原理圖 H橋電機驅動器 特點:5-7V低電壓供電,帶升壓電路產生12V以上柵極驅動電壓,兩片so-8小體積mos管半橋驅動芯片保證驅動效果 本電路已應用到多個直流電機驅動板上,最大驅

    標簽: H-Bridge

    上傳時間: 2013-06-02

    上傳用戶:zhuoying119

  • 基于ARM的TimeToCount輻射測量儀的研究

    隨著半導體工藝的飛速發展和芯片設計水平的不斷進步,ARM微處理器的性能得到大幅度地提高,同時其芯片的價格也在不斷下降,嵌入式系統以其獨有的優勢,己經廣泛地滲透到科學研究和日常生活的各個方面。 本文以ARM7 LPC2132處理器為核心,結合蓋革一彌勒計數管對Time-To-Count輻射測量方法進行研究。ARM結構是基于精簡指令集計算機(RISC)原理而設計的,其指令集和相關的譯碼機制比復雜指令集計算機要簡單得多,使用一個小的、廉價的ARM微處理器就可實現很高的指令吞吐量和實時的中斷響應。基于ARM7TDMI-S核的LPC2132微處理器,其工作頻率可達到60MHz,這對于Time-To-Count技術是非常有利的,而且利用LPC2132芯片的定時/計數器引腳捕獲功能,可以直接讀取TC中的計數值,也就是說不再需要調用中斷函數讀取TC值,從而大大降低了計數前雜質時間。本文是在我師兄呂軍的《Time-To-Count測量方法初步研究》基礎上,使用了高速的ARM芯片,對基于MCS-51的Time-To-Count輻射測量系統進行了改進,進一步論證了采用高速ARM處理器芯片可以極大的提高G-M計數器的測量范圍與測量精度。 首先,討論了傳統的蓋革-彌勒計數管探測射線強度的方法,并指出傳統的脈沖測量方法的不足。然后討論了什么是Time-To-Count測量方法,對Time-To-Count測量方法的理論基礎進行分析。指出Time-To-Count方法與傳統的脈沖計數方法的區別,以及采用Time-To-Count方法進行輻射測量的可行性。 接著,詳細論述基于ARM7 LPC2132處理器的Time-To-Count輻射測量儀的原理、功能、特點以及輻射測量儀的各部分接口電路設計及相關程序的編制。 最后得出結論,通過高速32位ARM處理器的使用,Time-To-Count輻射測量儀的精度和量程均得到很大的提高,對于Y射線總量測量,使用了ARM處理器的Time-To-Count輻射測量儀的量程約為20 u R/h到1R/h,數據線性程度也比以前的Time-To-CotJnt輻射測量儀要好。所以在使用Time-To-Count方法進行的輻射測量時,如何減少雜質時間以及如何提高計數前時間的測量精度,是決定Time-To-Count輻射測量儀性能的關鍵因素。實驗用三只相同型號的J33G-M計數管分別作為探測元件,在100U R/h到lR/h的輻射場中進行試驗.每個測量點測量5次取平均,得出隨著照射量率的增大,輻射強度R的測量值偏小且與輻射真實值之間的誤差也隨之增大。如果將測量誤差限定在10%的范圍內,則此儀器的量程范圍為20 u R/h至1R/h,量程跨度近六個數量級。而用J33型G-M計數管作常規的脈沖測量,量程范圍約為50 u R/h到5000 u R/h,充分體現了運用Time-To-Count方法測量輻射強度的優越性,也從另一個角度反應了隨著計數前時間的逐漸減小,雜質時間在其中的比重越來越大,對測量結果的影響也就越來越嚴重,盡可能的減小雜質時間在Time-To-Count方法輻射測量特別是測量高強度輻射中是關鍵的。筆者用示波器測出此輻射儀器的雜質時間約為6.5 u S,所以在計算定時器值的時候減去這個雜質時間,可以增加計數前時間的精確度。通過實驗得出,在標定儀器的K值時,應該在照射量率較低的條件下行,而測得的計數前時間是否精確則需要在照射量率較高的條件下通過儀器標定來檢驗。這是因為在照射量率較低時,計數前時間較大,雜質時間對測量結果的影響不明顯,數據線斜率較穩定,適宜于確定標定系數K值,而在照射量率較高時,計數前時間很小,雜質時間對測量結果的影響較大,可以明顯的在數據線上反映出來,從而可以很好的反應出儀器的性能與量程。實驗證明了Time-To-Count測量方法中最為關鍵的環節就是如何對計數前時間進行精確測量。經過對大量實驗數據的分析,得到計數前時間中的雜質時間可分為硬件雜質時間和軟件雜質時間,并以軟件雜質時間為主,通過對程序進行合理優化,軟件雜質時間可以通過程序的改進而減少,甚至可以用數學補償的方法來抵消,從而可以得到比較精確的計數前時間,以此得到較精確的輻射強度值。對于本輻射儀,用戶可以選擇不同的工作模式來進行測量,當輻射場較弱時,通常采用規定次數測量的方式,在輻射場較強時,應該選用定時測量的方式。因為,當輻射場較弱時,如果用規定次數測量的方式,會浪費很多時間來采集足夠的脈沖信號。當輻射場較強時,由于輻射粒子很多,產生脈沖的頻率就很高,規定次數的測量會加大測量誤差,當選用定時測量的方式時,由于時間的相對加長,所以記錄的粒子數就相對的增加,從而提高儀器的測量精度。通過調研國內外先進核輻射測量儀器的發展現狀,了解到了目前最新的核輻射總量測量技術一Time-To-Count理論及其應用情況。論證了該新技術的理論原理,根據此原理,結合高速處理器ARM7 LPC2132,對以G-計數管為探測元件的Time-To-Count輻射測量儀進行設計。論文以實驗的方法論證了Time-To-Count原理測量核輻射方法的科學性,該輻射儀的量程和精度均優于以前以脈沖計數為基礎理論的MCS-51核輻射測量儀。該輻射儀具有量程寬、精度高、易操作、用戶界面友好等優點。用戶可以定期的對儀器的標定,來減小由于電子元件的老化對低儀器性能參數造成的影響,通過Time-To-Count測量方法的使用,可以極大拓寬G-M計數管的量程。就儀器中使用的J33型G-M計數管而言,G-M計數管廠家參考線性測量范圍約為50 u R/h到5000 u R/h,而用了Time-To-Count測量方法后,結合高速微處理器ARM7 LPC2132,此核輻射測量儀的量程為20 u R/h至1R/h。在允許的誤差范圍內,核輻射儀的量程比以前基于MCS-51的輻射儀提高了近200倍,而且精度也比傳統的脈沖計數方法要高,測量結果的線性程度也比傳統的方法要好。G-M計數管的使用壽命被大大延長。 綜上所述,本文取得了如下成果:對國內外Time-To-Count方法的研究現狀進行分析,指出了Time-To-Count測量方法的基本原理,并對Time-T0-Count方法理論進行了分析,推導出了計數前時間和兩個相鄰輻射粒子時間間隔之間的關系,從數學的角度論證了Time-To-Count方法的科學性。詳細說明了基于ARM 7 LPC2132的Time-To-Count輻射測量儀的硬件設計、軟件編程的過程,通過高速微處理芯片LPC2132的使用,成功完成了對基于MCS-51單片機的Time-To-Count測量儀的改進。改進后的輻射儀器具有量程寬、精度高、易操作、用戶界面友好等特點。本論文根據實驗結果總結出了Time-To-Count技術中的幾點關鍵因素,如:處理器的頻率、計數前時間、雜質時間、采樣次數和測量時間等,重點分析了雜質時間的組成以及引入雜質時間的主要因素等,對國內核輻射測量儀的研究具有一定的指導意義。

    標簽: TimeToCount ARM 輻射測量儀

    上傳時間: 2013-06-24

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