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SDrAM-mt

現(xiàn)代的4bank*1M*16bit的SDRAM（HY57V6416ET）的VHDL行為仿真程序

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標(biāo)簽： SDRAM V6416 bank 6416

上傳時間： 2013-12-22

上傳用戶：aeiouetla
本文詳細(xì)介紹了S3C2410CPU的引腳分布還有內(nèi)部SDRAM和NOR FLASH的連線情況

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標(biāo)簽： C2410 FLASH SDRAM 2410

上傳時間： 2014-12-04

上傳用戶：xiaoxiang
詳細(xì)介紹了S3C44B0CPU的引腳情況還有內(nèi)部存儲器包括SDRAM和NOR FLASH的連線

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標(biāo)簽： FLASH SDRAM 0CPU C44

上傳時間： 2015-10-03

上傳用戶：ryb
mt48lc4m32b2.v 是128M sdram 中典型設(shè)計(jì)。。可以借鑒。

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標(biāo)簽： sdram 128M mt 48

上傳時間： 2013-12-18

上傳用戶：zhenyushaw
XAPP858 - 利用 Virtex-5 FPGA 實(shí)現(xiàn)的高性能 DDR2 SDRAM 接口數(shù)據(jù)采集本應(yīng)用指南描述了用于實(shí)現(xiàn) 667 Mbps（333 MHz）高性能 DDR2 SDRAM 接口的

XAPP858 - 利用 Virtex-5 FPGA 實(shí)現(xiàn)的高性能 DDR2 SDRAM 接口數(shù)據(jù)采集本應(yīng)用指南描述了用于實(shí)現(xiàn) 667 Mbps（333 MHz）高性能 DDR2 SDRAM 接口的控制器和數(shù)據(jù)采集的技巧。本數(shù)據(jù)采集技巧使用了輸入串行器/解串器（ISERDES）和輸出串行器/解串器（OSERDES）的功能。

標(biāo)簽： SDRAM DDR2 Virtex XAPP

上傳時間： 2014-01-19

上傳用戶：sk5201314
verilog語言寫的sdram控制器—命令響應(yīng)模塊代碼

verilog語言寫的sdram控制器—命令響應(yīng)模塊代碼，經(jīng)過測試，邏輯正確，可編譯，可綜合

標(biāo)簽： verilog sdram 語言控制器

上傳時間： 2015-10-10

上傳用戶：onewq
SDRAM控制器的VHDL實(shí)現(xiàn)

SDRAM控制器的VHDL實(shí)現(xiàn)，pdf格式，有需要多的，聯(lián)系我

標(biāo)簽： SDRAM VHDL 控制器

上傳時間： 2014-12-01

上傳用戶：sz_hjbf
測試DSP6400中SDRAM的程序。幫助大家了解DSP6400的存儲器資源和調(diào)試CCS的過程.

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標(biāo)簽： 6400 DSP SDRAM CCS

上傳時間： 2014-11-23

上傳用戶：zhangjinzj
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標(biāo)簽：

上傳時間： 2013-12-23

上傳用戶：huql11633
Sdr SDRAM控制器參考設(shè)計(jì),很好的

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標(biāo)簽： SDRAM Sdr 控制器參考設(shè)計(jì)

上傳時間： 2015-10-27

上傳用戶：manlian

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