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SPARTAN

  • 基于Xilinx FPGA的雙輸出DC/DC轉換器解決方案

      Xilinx FPGAs require at least two power supplies: VCCINTfor core circuitry and VCCO for I/O interface. For the latestXilinx FPGAs, including Virtex-II Pro, Virtex-II and SPARTAN-3, a third auxiliary supply, VCCAUX may be needed. Inmost cases, VCCAUX can share a power supply with VCCO.The core voltages, VCCINT, for most Xilinx FPGAs, rangefrom 1.2V to 2.5V. Some mature products have 3V, 3.3Vor 5V core voltages. Table 1 shows the core voltagerequirement for most of the FPGA device families. TypicalI/O voltages (VCCO) vary from 1.2V to 3.3V. The auxiliaryvoltage VCCAUX is 2.5V for Virtex-II Pro and SPARTAN-3, andis 3.3V for Virtex-II.

    標簽: Xilinx FPGA DC 輸出

    上傳時間: 2013-10-22

    上傳用戶:aeiouetla

  • XAPP483 - 利用 Platform Flash PROM 實現多重啟動功能

      一些應用利用 Xilinx FPGA 在每次啟動時可改變配置的能力,根據所需來改變 FPGA 的功能。Xilinx Platform Flash XCFxxP PROM 的設計修訂 (Design Revisioning) 功能,允許用戶在單個PROM 中將多種配置存儲為不同的修訂版本,從而簡化了 FPGA 配置更改。在 FPGA 內部加入少量的邏輯,用戶就能在 PROM 中存儲的多達四個不同的修訂版本之間進行動態切換。多重啟動或從多個設計修訂進行動態重新配置的能力,與 SPARTAN™-3E FPGA 和第三方并行 flashPROM 一起使用時所提供的 MultiBoot 選項相似。本應用指南將進一步說明 Platform Flash PROM 如何提供附加選項來增強配置失敗時的安全性,以及如何減少引腳數量和板面積。此外,Platform Flash PROM 還為用戶提供其他優勢:iMPACT 編程支持、單一供應商解決方案、低成本板設計和更快速的配置加載。本應用指南還詳細地介紹了一個包含 VHDL 源代碼的參考設計。

    標簽: Platform Flash XAPP PROM

    上傳時間: 2013-10-10

    上傳用戶:wangcehnglin

  • WP370 -采用智能時鐘門控技術降低動態開關功耗

        賽靈思推出業界首款自動化精細粒度時鐘門控解決方案,該解決方案可將 Virtex®-6 和 SPARTAN®-6 FPGA 設計方案的動態功耗降低高達 30%。賽靈思智能時鐘門控優化可自動應用于整個設計,既無需在設計流程中添加更多新的工具或步驟,又不會改變現有邏輯或時鐘,從而避免設計修改。此外,在大多數情況下,該解決方案都能保留時序結果。

    標簽: 370 WP 智能時鐘 動態

    上傳時間: 2015-01-02

    上傳用戶:wutong

  • 基于FPGA的PAL-VGA轉換器的實現

    介紹了基于Xilinx SPARTAN- 3E FPGA XC3S250E 來完成分辨率為738×575 的PAL 制數字視頻信號到800×600 的VGA 格式轉換的實現方法。關鍵詞: 圖像放大; PAL; VGA; FPGA 目前, 絕大多數監控系統中采用的高解析度攝像機均由47 萬像素的CCD 圖像傳感器采集圖像, 經DSP 處理后輸出的PAL 制數字視頻信號不能直接在VGA 顯示器上顯示, 而在許多場合需要在VGA 顯示器上實時監視, 這就需要將隔行PAL 制數字視頻轉換為逐行視頻并提高幀頻, 再將每幀圖像放大到800×600 或1 024×768。常用的圖像放大的方法有很多種, 如最臨近賦值法、雙線性插值法、樣條插值法等[ 1] 。由于要對圖像進行實時顯示, 本文采用一種近似的雙線性插值方法對圖像進行放大。隨著微電子技術及其制造工藝的發展, 可編程邏輯器件的邏輯門密度有了很大提高, 現場可編程邏輯門陣列( FPGA) 有著邏輯資源豐富和可重復以及系統配置的靈活性, 同時隨著微處理器、專用邏輯器件以及DSP 算法以IP Core 的形式嵌入到FPGA 中[ 2] , FPGA 的功能越來越強, 因此FPGA 在現代電子系統設計中發揮著越來越重要的作用。本課題的設計就是采用VHDL 描述, 基于FPGA 來實現的。

    標簽: PAL-VGA FPGA 轉換器

    上傳時間: 2014-02-22

    上傳用戶:a1054751988

  • 賽靈思電機控制開發套件簡介(英文版)

      The power of programmability gives industrial automation designers a highly efficient, cost-effective alternative to traditional motor control units (MCUs)。 The parallel-processing power, fast computational speeds, and connectivity versatility of Xilinx® FPGAs can accelerate the implementation of advanced motor control algorithms such as Field Oriented Control (FOC)。   Additionally, Xilinx devices lower costs with greater on-chip integration of system components and shorten latencies with high-performance digital signal processing (DSP) that can tackle compute-intensive functions such as PID Controller, Clark/Park transforms, and Space Vector PWM.   The Xilinx SPARTAN®-6 FPGA Motor Control Development Kit gives designers an ideal starting point for evaluating time-saving, proven, motor-control reference designs. The kit also shortens the process of developing custom control capabilities, with integrated peripheral functions (Ethernet, PowerLink, and PCI® Express), a motor-control FPGA mezzanine card (FMC) with built-in Texas Instruments motor drivers and high-precision Delta-Sigma modulators, and prototyping support for evaluating alternative front-end circuitry.

    標簽: 賽靈思 電機控制 開發套件 英文

    上傳時間: 2013-10-28

    上傳用戶:wujijunshi

  • 介紹了基于FPGA的多功能計程車計價器的電路設計。該設計采用了可編程邏輯器件FPGA的ASIC設計

    介紹了基于FPGA的多功能計程車計價器的電路設計。該設計采用了可編程邏輯器件FPGA的ASIC設計,并基于超高速硬件描述語言VHDL在Xilinx公司的SPARTANⅡ系列的2sc200PQ208-5芯片上編程實現了整個系統的控制部分,整個自動控制系統由四個模塊構成:秒分頻模塊、控制模塊、計量模塊和譯碼顯示模塊。該設計不僅僅實現了顯示計程車計費的功能,其多功能表現在它可以通過選擇鍵選擇顯示計程車累計走的總路程和乘客乘載的時間。計時、計程、計費準確可靠,應用于實際當中有較好的實用價值和較高的可行性。

    標簽: FPGA ASIC 多功能 可編程邏輯器件

    上傳時間: 2014-07-27

    上傳用戶:llandlu

  • BurchED B5-X300 SPARTAN2e using XC2S300e device Top level file for 6809 compatible system on a chi

    BurchED B5-X300 SPARTAN2e using XC2S300e device Top level file for 6809 compatible system on a chip Designed with Xilinx XC2S300e SPARTAN 2+ FPGA. Implemented With BurchED B5-X300 FPGA board, B5-SRAM module, B5-CF module and B5-FPGA-CPU-IO module

    標簽: compatible 300 SPARTAN2e BurchED

    上傳時間: 2015-07-07

    上傳用戶:star_in_rain

  • 介紹了基于FPGA的多功能計程車計價器的電路設計。該設計采用了可編程邏輯器件FPGA的ASIC設計

    介紹了基于FPGA的多功能計程車計價器的電路設計。該設計采用了可編程邏輯器件FPGA的ASIC設計,并基于超高速硬件描述語言VHDL在Xilinx公司的SPARTANⅡ系列的2sc200PQ208-5芯片上編程實現了整個系統的控制部分,整個自動控制系統由四個模塊構成:秒分頻模塊、控制模塊、計量模塊和譯碼顯示模塊。該設計不僅僅實現了顯示計程車計費的功能,其多功能表現在它可以通過選擇鍵選擇顯示計程車累計走的總路程和乘客乘載的時間。計時、計程、計費準確可靠,應用于實際當中有較好的實用價值和較高的可行性

    標簽: FPGA ASIC 多功能 可編程邏輯器件

    上傳時間: 2015-10-24

    上傳用戶:偷心的海盜

  • 本代碼介紹了使用VHDL開發FPGA的一般流程

    本代碼介紹了使用VHDL開發FPGA的一般流程,最終采用了一種基于FPGA的數字頻率的實現方法。該設計采用硬件描述語言VHDL,在軟件開發平臺ISE上完成,可以在較高速時鐘頻率(100MHz)下正常工作。該設計的頻率計能準確的測量頻率在1Hz到100MHz之間的信號。使用ModelSim仿真軟件對VHDL程序做了仿真,并完成了綜合布局布線,最終下載到芯片SPARTAN-II上取得良好測試效果。

    標簽: VHDL FPGA 代碼 流程

    上傳時間: 2014-01-12

    上傳用戶:hj_18

  • 時鐘約束實驗

    時鐘約束實驗,在xilinx公司的SPARTAN 3E板上通過控制按鈕開關來實現對LED的控制

    標簽: 時鐘約束 實驗

    上傳時間: 2013-12-23

    上傳用戶:tb_6877751

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