數(shù)據(jù)采集處理技術(shù)是現(xiàn)代信號處理的基礎(chǔ),廣泛應(yīng)用于雷達(dá)、聲納、軟件無線電、瞬態(tài)信號測試等領(lǐng)域。隨著信息科學(xué)的飛速發(fā)展,人們面臨的信號處理任務(wù)越來越繁重,對數(shù)據(jù)采集處理系統(tǒng)的要求也越來越高。近年來FPGA...
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在國家重大科學(xué)工程HIRFL-CSR的CSR控制系統(tǒng)中,需要高速數(shù)據(jù)獲取和處理系統(tǒng)。該系統(tǒng)通常采用存儲器作為數(shù)據(jù)緩沖存儲。同步動態(tài)隨機(jī)存儲器SDRAM憑借其集成度高、功耗低、可靠性高、處理能力強(qiáng)等優(yōu)勢...
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SDRAM控制器,Verilog源碼。適用SDRAM芯片:三星KM416S1120D,NEC uPD4516161AG5,OKI MSM56V1616,有詳細(xì)的說明,可直接使用!...
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sdram讀寫測試,連續(xù)向SDRAM寫滿數(shù)據(jù)(00~FF),然后讀出SDRAM中的數(shù)據(jù)并通過串口上傳給PC機(jī),波特率9.6KBPS...
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軟件開發(fā)環(huán)境:ISE 7.1i
硬件開發(fā)環(huán)境:紅色颶風(fēng)II代-Xilinx版
1. 本實(shí)例用于控制開發(fā)板上面的SDRAM完成讀寫功能;
先向SDRAM里面寫數(shù)據(jù),然后再將數(shù)據(jù)讀出來做...
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在國家重大科學(xué)工程HIRFL-CSR的CSR控制系統(tǒng)中,需要高速數(shù)據(jù)獲取和處理系統(tǒng)。該系統(tǒng)通常采用存儲器作為數(shù)據(jù)緩沖存儲。同步動態(tài)隨機(jī)存儲器SDRAM憑借其集成度高、功耗低、可靠性高、處理能力強(qiáng)等優(yōu)勢...
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基于FPGA對sdram控制器的設(shè)計(jì)VERILOG語言...
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使用Verilog實(shí)現(xiàn)基于FPGA的SDRAM控制器...
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verilog 代碼,讀寫SDRAM 不帶仿真,需要自己編寫測試文件...
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fpga+sdram+PHY 芯片設(shè)計(jì)原理圖...
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