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Shift

  • 三維點云處理程序

    利用OpenGL、VC++編寫的C++,三維點云處理程序,對于學習圖形學、C++、OpenGL、文件讀寫很有幫助,是一個三維軟件公司編寫代碼一部分,尤其是OpenGL庫文件相當管用。 有兩個數據文件 鼠標默認操作:具體還在頭文件中 中鍵拖動 旋轉 中鍵+Ctrl 平移 中鍵+Shift 面旋 滾輪滾動 縮放 中鍵+Ctrl + Shift 局部放大

    標簽: 處理程序

    上傳時間: 2013-06-03

    上傳用戶:木末花開

  • 基于FPGA的可編程m序列發生器的實現

    · 摘要:  本文研究了由線性反饋移位寄存器(Linear Feedback Shift Registers,LFSR)生成m序列的原理,并對LFSR電路結構作了改進,利用基于現代DSP技術的DSP Builder軟件,設計了一種周期、相位可調的m序列發生器.經調試與仿真,結果表明該方法硬件結構簡單、開發周期短,為系統設計或測試帶來很大的便利.  

    標簽: FPGA 可編程 發生器 序列

    上傳時間: 2013-07-18

    上傳用戶:fuzhoulinzexu

  • 74LS164.pdf

    英文描述: 8-Bit Serial-Input/Parallel-Output Shift Register 中文描述: 8位Serial-Input/Parallel-Output移位寄存器

    標簽: 164 74 LS

    上傳時間: 2013-04-24

    上傳用戶:epson850

  • 74LS165.pdf

    英文描述: 8-Bit Parallel In/Serial Output Shift Registers 中文描述: 8位并行/串行輸出移位寄存器

    標簽: 165 74 LS

    上傳時間: 2013-06-03

    上傳用戶:林魚2016

  • 74LS595.pdf

    英文描述: 8-BIT Shift REGISTERS WITH OUTPUT LATCHES 中文描述: 8位移位寄存器與輸出鎖存器

    標簽: 595 74 LS

    上傳時間: 2013-06-23

    上傳用戶:327000306

  • Protel DXP快捷鍵大全

    enter——選取或啟動 esc——放棄或取消 f1——啟動在線幫助窗口 tab——啟動浮動圖件的屬性窗口 pgup——放大窗口顯示比例 pgdn——縮小窗口顯示比例 end——刷新屏幕 del——刪除點取的元件(1個) ctrl+del——刪除選取的元件(2個或2個以上) x+a——取消所有被選取圖件的選取狀態 x——將浮動圖件左右翻轉 y——將浮動圖件上下翻轉 space——將浮動圖件旋轉90度 crtl+ins——將選取圖件復制到編輯區里 Shift+ins——將剪貼板里的圖件貼到編輯區里 Shift+del——將選取圖件剪切放入剪貼板里 alt+backspace——恢復前一次的操作 ctrl+backspace——取消前一次的恢復 crtl+g——跳轉到指定的位置 crtl+f——尋找指定的文字  

    標簽: Protel DXP 快捷鍵

    上傳時間: 2013-12-29

    上傳用戶:13033095779

  • 基于C8051F系列單片機的無線收發電路設計

    基于幅移鍵控技術ASK(Amplitude-Shift Keying),以C8051F340單片機作為監測終端控制器,C8051F330D單片機作為探測節點控制器,采用半雙工的通信方式,通過監控終端和探測節點的無線收發電路,實現數據的雙向無線傳輸。收發電路采用直徑為0.8 mm的漆包線自行繞制成圓形空心線圈天線,天線直徑為(3.4±0.3)cm。試驗表明,探測節點與監測終端的通信距離為24 cm,通過橋接方式,節點收發功率為102 mW時,節點間的通信距離可達20 cm。與傳統無線收發模塊相比,該無線收發電路在受體積、功耗、成本限制的場合有廣闊的應用前景。 Abstract:  Based on ASK technology and with the C8051F340 and C8051F330D MCU as the controller, using half-duplex communication mode, this paper achieves bi-directional data transfer. Transceiver circuit constituted by enameled wire which diameter is 0.8mm and wound into a diameter (3.4±0.3) cm circular hollow coil antenna. Tests show that the communication distance between detection and monitoring of the terminal is 24cm,the distance is up to 20cm between two nodes when using the manner of bridging and the node transceiver power is 102mW. Compared with the conventional wireless transceiver modules, the circuit has wide application prospect in small size, low cost and low power consumption and other characteristics.

    標簽: C8051F 單片機 無線收發 電路設計

    上傳時間: 2013-10-19

    上傳用戶:xz85592677

  • MCU(單片機)對可控硅的控制

    MCU(單片機)對可控硅的控制:交流市電控制――MCU對可控硅的控制 郭江辛 07-23-03在用可控硅對交流市電控制中,主要注意以下幾個方面:一, 同步信號 (弄不好都會產生不均勻的斬波,控制白熾燈表現為燈閃)1) 清楚同步信號在交流周期中的位置,最好在交流零點選取.在一些阻容降壓對MCU 供電電路中,最好直接在交流電源兩端取同步信號(過零點),以避免計算阻容產生的象移(PHASE Shift)2) 同步信號要穩定二, 控制信號 (弄不好則可控硅不能通,或一直通)1) 可控硅斷路時,可控硅控制極(GATE)最好是開路,沒有開極的MCU可加如下電路:

    標簽: MCU 單片機 可控硅 控制

    上傳時間: 2014-05-05

    上傳用戶:comer1123

  • XAPP806 -決定DDR反饋時鐘的最佳DCM相移

    This application note describes how to build a system that can be used for determining theoptimal phase Shift for a Double Data Rate (DDR) memory feedback clock. In this system, theDDR memory is controlled by a controller that attaches to either the OPB or PLB and is used inan embedded microprocessor application. This reference system also uses a DCM that isconfigured so that the phase of its output clock can be changed while the system is running anda GPIO core that controls that phase Shift. The GPIO output is controlled by a softwareapplication that can be run on a PowerPC® 405 or Microblaze™ microprocessor.

    標簽: XAPP 806 DDR DCM

    上傳時間: 2013-10-15

    上傳用戶:euroford

  • 擴頻通信芯片STEL-2000A的FPGA實現

    針對傳統集成電路(ASIC)功能固定、升級困難等缺點,利用FPGA實現了擴頻通信芯片STEL-2000A的核心功能。使用ISE提供的DDS IP核實現NCO模塊,在下變頻模塊調用了硬核乘法器并引入CIC濾波器進行低通濾波,給出了DQPSK解調的原理和實現方法,推導出一種簡便的引入?仔/4固定相移的實現方法。采用模塊化的設計方法使用VHDL語言編寫出源程序,在Virtex-II Pro 開發板上成功實現了整個系統。測試結果表明該系統正確實現了STEL-2000A的核心功能。 Abstract:  To overcome drawbacks of ASIC such as fixed functionality and upgrade difficulty, FPGA was used to realize the core functions of STEL-2000A. This paper used the DDS IP core provided by ISE to realize the NCO module, called hard core multiplier and implemented CIC filter in the down converter, described the principle and implementation detail of the demodulation of DQPSK, and derived a simple method to introduce a fixed phase Shift of ?仔/4. The VHDL source code was designed by modularity method , and the complete system was successfully implemented on Virtex-II Pro development board. Test results indicate that this system successfully realize the core function of the STEL-2000A.

    標簽: STEL 2000 FPGA 擴頻通信

    上傳時間: 2013-11-06

    上傳用戶:liu123

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