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Soft-ICE

  • VISUAL ELITE 0

    Summit Design公司基于ESL設(shè)計(jì)產(chǎn)品的最新Visual Elite圖像產(chǎn)品具有Advanced SystemC建模及分析功能。該工具的最新版本包括原始SystemC構(gòu)造，允許用戶在SystemC內(nèi)建模并驗(yàn)證設(shè)計(jì)。 該工具的HDL版本可幫助門級設(shè)計(jì)師們學(xué)習(xí)用Verilog和VHDL設(shè)計(jì)。最新版本的Visual Elite可幫助硬件設(shè)計(jì)師們和C/C++編程者迅速使用SystemC語言創(chuàng)建系統(tǒng)。Visual Elite 允許用戶熟悉語言后，使用預(yù)建圖形模塊創(chuàng)建系統(tǒng)并自行創(chuàng)建文本模塊。 該工具的瀏覽器

    標(biāo)簽： 機(jī)械原理 機(jī)械設(shè)計(jì)

    上傳時間： 2013-04-15

    上傳用戶：eeworm

  • SYNPLICITY 9.6.20

    軟件具有極高的性能，有助于大幅提高工作效率，必將成為設(shè)計(jì)人員在 FPGA 或 ASIC 硬件中實(shí)現(xiàn) DSP 功能時的首選技術(shù)

    標(biāo)簽： 模具設(shè)計(jì)

    上傳時間： 2013-05-30

    上傳用戶：eeworm

  • LEONARDOSPECTRUM V2006A0

    LeonardoSpectrum是Mentor公司出品的一款HDL邏輯綜合軟件

    標(biāo)簽： 2008 iso 機(jī)械設(shè)計(jì)手冊 軟件

    上傳時間： 2013-05-30

    上傳用戶：eeworm

  • PRECISION RTL V2005B.1100

    Actel公司與Mentor Graphics公司日前推出Mentor Graphics的Precision RTL綜合工具最新版本。該版本利用Actel基于閃存的ProASIC Plus家族FPGA產(chǎn)品以提供更高的設(shè)計(jì)性能。

    標(biāo)簽： 自動變速器 結(jié)構(gòu)原理

    上傳時間： 2013-04-15

    上傳用戶：eeworm

  • PRECISION PHYSICAL 2010A.2180

    新一代FPGA綜合技術(shù),邏輯設(shè)計(jì)中出現(xiàn)的多個層次進(jìn)行優(yōu)化， 通過精簡邏輯層次，提升了電路性能，并且降低了功耗

    標(biāo)簽： 光學(xué) 設(shè)計(jì)方法

    上傳時間： 2013-06-16

    上傳用戶：eeworm

  • HDL DESIGNER SERIES 2010.2A WIN320

    Mentor Graphics HDL Designer 工具套件，為客戶帶來生產(chǎn)力更高的設(shè)計(jì)輸入、分析與管理功能，包括更強(qiáng)大的聯(lián)機(jī)資料表格，無論設(shè)計(jì)復(fù)雜性如何，都能迅速建立高品質(zhì)且結(jié)構(gòu)良好的硬件描述語言。HDL Designer Series可協(xié)助工程師迅速輸入和分析復(fù)雜的ASIC、FPGA和系統(tǒng)單芯片設(shè)計(jì)，讓客戶新產(chǎn)品于更短時間內(nèi)上

    標(biāo)簽： 金屬材料 標(biāo)準(zhǔn)手冊

    上傳時間： 2013-04-15

    上傳用戶：eeworm

  • MAX+PLUS II ADVANCED SYNTHSIS 10.230

    MAX+PLUS II Advanced Synthsis ALtera的一個免費(fèi)HDL綜合工具，安裝后可以直接使用，是MaxplusII的一個插件，用這個插件進(jìn)行語言綜合，比直接使用MaxplusII綜合的效果好

    標(biāo)簽： 2.0 機(jī)械設(shè)計(jì) 軟件

    上傳時間： 2013-07-15

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  • MODLESIM 10.0A0

    modelsim么就是個比較強(qiáng)大的功能仿真軟件。然后作為互助軟件。modelsim和altera、xilinx等提供了專用的優(yōu)化版本

    標(biāo)簽： 液壓 元件

    上傳時間： 2013-04-15

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  • ACTIVE HDL 8.4.30

    ALDEC公司的Active-HDL是一個開放型的仿真工具。 可支持幾乎所有的FPGA/CPLD廠商的產(chǎn)品，設(shè)計(jì)輸入可以原理圖或硬件描述語言或有限狀態(tài)機(jī) 方式

    標(biāo)簽： 汽車 圖解

    上傳時間： 2013-04-15

    上傳用戶：eeworm

  • NC-SIM 5.40

    NC-Sim工具進(jìn)行邏輯驗(yàn)證，通常編寫B(tài)FM是不可缺少的工作，而激勵產(chǎn)生、結(jié)果分析和建模只能選擇高級語言了。您推薦使用C/C++

    標(biāo)簽： 電鍍技術(shù)

    上傳時間： 2013-07-04

    上傳用戶：eeworm

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