對(duì)于CPLD、FPGA和HardCopy? ASIC設(shè)計(jì)，Quartus? II軟件10.1是業(yè)界性能和效能首屈一指的軟件，現(xiàn)在可以下載。這一最新版軟件引入了Qsys，它是功能強(qiáng)大的系統(tǒng)集成新工具。在Quartus II訂購(gòu)版軟件10.1中以beta版的形式提供Qsys，它提高了系統(tǒng)開(kāi)發(fā)速度，支持設(shè)計(jì)重用，從而縮短了FPGA設(shè)計(jì)過(guò)程，減輕了工作量。
上傳時(shí)間： 2013-07-24
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ISE® 12 軟件設(shè)計(jì)套件，實(shí)現(xiàn)了具有更高設(shè)計(jì)生產(chǎn)力的功耗和成本的突破性優(yōu)化。ISE 設(shè)計(jì)套件首次利用“智能”時(shí)鐘門控技術(shù)，將動(dòng)態(tài)功耗降低多達(dá) 30%。此外，該新型套件還提供了基于時(shí)序的高級(jí)設(shè)計(jì)保存功能、為即插即用設(shè)計(jì)提供符合 AMBA 4 AXI4 規(guī)范的 IP 支持，同時(shí)具備第四代部分重配置功能的直觀設(shè)計(jì)流程，可降低多種高性能應(yīng)用的系統(tǒng)成本。
標(biāo)簽： 模擬電子 技術(shù)基礎(chǔ)
上傳時(shí)間： 2013-05-15
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在為所有 Xilinx® Virtex®-6 和 Spartan®-6 FPGA 產(chǎn)品系列提供全面生產(chǎn)支持的同時(shí)，ISE 12 版本作為業(yè)界唯一一款領(lǐng)域?qū)Ｓ迷O(shè)計(jì)套件，不斷發(fā)展和演進(jìn)，可以為邏輯、數(shù)字信號(hào)處理(DSP)、嵌入式處理以及系統(tǒng)級(jí)設(shè)計(jì)提供互操作性設(shè)計(jì)流程和工具配置。此外，賽靈思還在 ISE 12 套件中采用了大量軟件基礎(chǔ)架構(gòu)，并改進(jìn)了設(shè)計(jì)方法，從而不僅可縮短運(yùn)行時(shí)間，提高系統(tǒng)集成度，而且還能在最新一代器件產(chǎn)品系列和目標(biāo)設(shè)計(jì)平臺(tái)上擴(kuò)展 IP 互操作性
標(biāo)簽： 電子技術(shù) 模電 數(shù)電
上傳時(shí)間： 2013-04-15
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ispLEVER2.0是一套完整的EDA軟件。設(shè)計(jì)輸入可采用原理圖、硬件描述語(yǔ)言、混合輸入三種方式。能對(duì)所設(shè)計(jì)的數(shù)字電子系統(tǒng)進(jìn)行功能仿真和時(shí)序仿真。編譯器是此軟件的核心，能進(jìn)行邏輯優(yōu)化，將邏輯映射到器件中去，自動(dòng)完成布局與布線并生成編程所需要的熔絲圖件。軟件支持原有Lattice公司的GAL、ispLSI、MACH、ispGDX、ORCA2、ORCA3、ORCA4和最新的ispMACH器件。Xilinx.ISE.Design.Suite（北京市電子設(shè)計(jì)競(jìng)賽指定軟件）
標(biāo)簽： 機(jī)械設(shè)備 故障診斷
上傳時(shí)間： 2013-05-20
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簡(jiǎn)單的高速接口，F(xiàn)PGA和高速AD的接口編程-Simple high-speed
標(biāo)簽： 精密 設(shè)計(jì)方法
上傳時(shí)間： 2013-07-21
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"該軟件提供了用戶誰(shuí)想要換行文本（插入一個(gè)回車）由單詞數(shù)字符數(shù)，或通過(guò)與字檢測(cè)的字符數(shù)，一個(gè)解決方案。只需添加拖放"
標(biāo)簽： 精密 機(jī)構(gòu)
上傳時(shí)間： 2013-05-17
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ABEL設(shè)計(jì)軟件是一種高級(jí)編譯型可編程邏輯設(shè)計(jì)軟件， 只需要輸入符合語(yǔ)法規(guī)定的邏輯描述，就能設(shè)計(jì)各種不同類型 的PLD器件。這種軟件可以對(duì)用戶的邏輯設(shè)計(jì)進(jìn)行語(yǔ)法檢查、 邏輯化簡(jiǎn)、自動(dòng)生成符合標(biāo)準(zhǔn)的JEDEC文件（“．JED”文件）， 還能將用戶的設(shè)計(jì)要求與所選器件的功能相結(jié)合，分析檢查用 戶的設(shè)計(jì)目的是否切實(shí)可行，目前已經(jīng)成為國(guó)際通用的PLD輔 助設(shè)計(jì)軟件之一。
標(biāo)簽： 液壓氣動(dòng) 實(shí)用手冊(cè)
上傳時(shí)間： 2013-07-24
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?開(kāi)發(fā)GAL/PAL的軟件，DOS界面進(jìn)行行為級(jí)仿真，判斷設(shè)計(jì)的可行性，驗(yàn)證模塊的功能和設(shè)計(jì)的debug。然后是調(diào)試和分析環(huán)境中使用代碼處理箱（verisure/for verilog) (VHDLCover/for VHDL)分析仿真結(jié)果，驗(yàn)證測(cè)試級(jí)別。
標(biāo)簽： 公差 實(shí)用技術(shù)
上傳時(shí)間： 2013-04-15
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Actel Corporation Libero 集成設(shè)計(jì)環(huán)境(IDE) 為 FPGA 設(shè)計(jì)。新版本提供 SmartDesign, 使用戶設(shè)計(jì)在一個(gè)更高的水平抽象。新工具隨員支持所有Actel 的FPGAs, 包括并且基于閃光的, 低功率ProASIC3 和5 微瓦特Actel 園屋頂?shù)男∥軫PGAs, 單片Actel 融合PSC (可編程序的系統(tǒng)芯片)
標(biāo)簽： 傳動(dòng) 標(biāo)準(zhǔn) 應(yīng)用手冊(cè)
上傳時(shí)間： 2013-07-09
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UltraEdit是能夠滿足你一切編輯需要的編輯器。UltraEdit是一套功能強(qiáng)大的文本編輯器,可以編輯文本、十六進(jìn)制、ASCII碼,可以取代記事本,內(nèi)建英文單字檢查、C++及VB指令突顯,可同時(shí)編輯多個(gè)文件,而且即使開(kāi)啟很大的文件速度也不會(huì)慢。軟件附有HTML標(biāo)簽顏色顯示、搜尋替換以及無(wú)限制的還原功能,一般大家喜歡用其來(lái)修改EXE或DLL文件。
標(biāo)簽： 制冷 設(shè)備技術(shù)
上傳時(shí)間： 2013-05-22
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