FPGA Synthesis with the Synplify Pro Tool
標簽： Synthesis Synplify FPGA with
上傳時間： 2013-09-04
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大型設(shè)計中FPGA的多時鐘設(shè)計策略,很詳細的描述了在FPGA設(shè)計中時鐘設(shè)計的方法
標簽： FPGA 大型 多時鐘 策略
上傳用戶：妄想演繹師
fpga時序約束.rar
標簽： fpga 時序約束
上傳用戶：1101055045
在EDA中，基于數(shù)字頻率合成器的FPGA實現(xiàn)
標簽： FPGA EDA 數(shù)字頻率合成器
上傳用戶：hanli8870
該文闡述了現(xiàn)場可編程邏輯器件FPGA的主要特點，應(yīng)用FPGA芯片和VHDL硬件描述語言設(shè)計的模擬示波器數(shù)字信號顯示系統(tǒng)的設(shè)計原理和設(shè)計方法。
標簽： FPGA 現(xiàn)場可編程 邏輯器件
上傳用戶：qweqweqwe
FPGA特殊管腳說明
標簽： FPGA 管腳
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無淪是用離散邏輯、可編程邏輯，還是用全定制硅器件實現(xiàn)的任何數(shù)字設(shè)計，為了成功地操\r\n作，可靠的時鐘是非常關(guān)鍵的。設(shè)計不良的時鐘在極限的溫度、電壓或制造工藝的偏差情況下將\r\n導(dǎo)致錯誤的行為，并且調(diào)試困難、花銷很大。 在設(shè)計PLD/FPGA時通常采用幾種時鐘類型。時鐘可\r\n分為如下四種類型：全局時鐘、門控時鐘、多級邏輯時鐘和波動式時鐘。多時鐘系統(tǒng)能夠包括上\r\n述四種時鐘類型的任意組合。
標簽： FPGA PLD 時鐘
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xilinx virtex fpga
標簽： xilinx virtex fpga 設(shè)計指南
上傳時間： 2013-09-05
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基于FPGA的256-QAM實現(xiàn) 寫FPGA的QAM調(diào)制程序有幫助
標簽： FPGA QAM 256 調(diào)制
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VGA顯示的FPGA實現(xiàn)
標簽： FPGA VGA
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