vhdl編寫的彩燈控制程序，比較簡單，僅供初學者參考
標簽： vhdl 編寫 彩燈控制 程序
上傳時間： 2013-12-22
上傳用戶：ikemada
vhdl編寫的智力搶答器程序，比較簡單，僅供參考
標簽： vhdl 編寫 搶答器 程序
上傳時間： 2015-08-15
上傳用戶：zhuyibin
1.高精度數(shù)字秒表（0.01秒的vhdl語言實現(xiàn)） 2.具有定時，暫停，按鍵隨機存儲，翻頁回放功能； 3.對30M時鐘分頻產(chǎn)生顯示掃描時鐘 4.精度高達0.01s,并且可以通過改變主頻來更改分頻比和記數(shù)間隔，可控性高。 5.模塊化設計，其中的許多函數(shù)可以成為vhdl語言的通用經(jīng)典例子（包含分頻電路設計，動態(tài)掃描時鐘設計，譯碼電路設計，存儲器設計，存儲回放顯示設計）
標簽： 0.01 vhdl 高精度 數(shù)字秒表
上傳時間： 2015-08-16
上傳用戶：waitingfy
1.AD0809轉(zhuǎn)換器的vhdl實現(xiàn) 2.用狀態(tài)機來實現(xiàn)不同狀態(tài)的動態(tài)切換，思路明晰簡單實現(xiàn)。 3.內(nèi)含注釋，易于修改和理解 4.對數(shù)碼管的動態(tài)掃描,顯示
標簽： 0809 vhdl 狀態(tài) AD
上傳時間： 2014-01-06
上傳用戶：123456wh
1.漢明編碼的硬件實現(xiàn)vhdl語言 2.測試用，簡單明晰 3.內(nèi)含有另一份c代碼的漢明碼糾錯編碼源代碼
標簽： vhdl 漢 編碼 硬件實現(xiàn)
上傳用戶：kelimu
項目中自己設計的URAT的VHDL源程序及仿真，已經(jīng)通過了編譯和仿真，有項目用的到的可參考下。
標簽： URAT VHDL 項目 源程序
上傳時間： 2014-01-12
上傳用戶：xiaoxiang
基本FIR濾波器的VHDL源代碼及其測試程序。
標簽： VHDL FIR 濾波器 源代碼
上傳用戶：yuanyuan123
SPI協(xié)議的VHDL/Verilog語言實現(xiàn)。
標簽： Verilog VHDL SPI 協(xié)議
上傳用戶：baiom
通過CPLD實現(xiàn)串行通信之VHDL語言，好看易懂
標簽： CPLD VHDL 串行通信 語言
上傳時間： 2014-01-20
上傳用戶：hewenzhi
用VHDL能進行正常的時、分、秒計時功能、分別有6個數(shù)碼管顯示24小時、60分鐘、60秒鐘的計數(shù)器顯示。
標簽： VHDL 分 正 數(shù)碼管顯示
上傳時間： 2013-12-20
上傳用戶：kytqcool
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