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VeriLog-HDL

Visual Elite 0

Summit Design公司基于ESL設計產品的最新Visual Elite圖像產品具有Advanced SystemC建模及分析功能。該工具的最新版本包括原始SystemC構造，允許用戶在SystemC內建模并驗證設計。該工具的HDL版本可幫助門級設計師們學習用Verilog和VHDL設計。最新版本的Visual Elite可幫助硬件設計師們和C/C++編程者迅速使用SystemC語言創建系統。Visual Elite 允許用戶熟悉語言后，使用預建圖形模塊創建系統并自行創建文本模塊。該工具的瀏覽器

標簽： Visual Elite

上傳時間： 2013-04-24

上傳用戶：東大小布
HDL Designer Series 2010.2a win320

Mentor Graphics HDL Designer 工具套件，為客戶帶來生產力更高的設計輸入、分析與管理功能，包括更強大的聯機資料表格，無論設計復雜性如何，都能迅速建立高品質且結構良好的硬件描述語言。HDL Designer Series可協助工程師迅速輸入和分析復雜的ASIC、FPGA和系統單芯片設計，讓客戶新產品于更短時間內上

標簽： Designer 2010.2 Series HDL

上傳時間： 2013-08-05

上傳用戶：hustfanenze
Active HDL 8.4.30

ALDEC公司的Active-HDL是一個開放型的仿真工具。可支持幾乎所有的FPGA/CPLD廠商的產品，設計輸入可以原理圖或硬件描述語言或有限狀態機方式

標簽： Active HDL 30

上傳時間： 2013-07-14

上傳用戶：來茴
ModleSim 6.50

Mentor公司的ModelSim是業界最優秀的HDL語言仿真軟件，它能提供友好的仿真環境，是業界唯一的單內核支持VHDL和Verilog混合仿真的仿真器

標簽： ModleSim 6.50

上傳時間： 2013-04-24

上傳用戶：zukfu
Active HDL 8.10

ALDEC公司的Active-HDL是一個開放型的仿真工具。可支持幾乎所有的FPGA/CPLD廠商的產品，設計輸入可以原理圖或硬件描述語言或有限狀態機方式

標簽： Active 8.10 HDL

上傳時間： 2013-05-29

上傳用戶：1583060504
介紹配置曼徹斯特編碼器譯碼器的VHDL和Verilog源代碼

This application note provides a functional des cription of VHDL and Verilog source code for a

標簽： Verilog VHDL 曼徹斯特編碼器

上傳時間： 2013-07-04

上傳用戶：李夢晗
周立功Verilog精華

周立功Verilog精華教程，歡迎下載學習用

標簽： Verilog

上傳時間： 2013-08-04

上傳用戶：tedo811
VHDL和Verilog轉換軟件

這是一款相當不錯的VHDL和Verilog轉換軟件，希望對大家有所幫助。

標簽： Verilog VHDL 轉換軟件

上傳時間： 2013-05-28

上傳用戶：www240697738
VHDL和Verilog轉換軟件3

這是一款相當不錯的VHDL和Verilog轉換軟件。希望對大家有所幫助。

標簽： Verilog VHDL 轉換軟件

上傳時間： 2013-06-10

上傳用戶：aig85
verilog大量源程序

verilog大量源程序，希望對大家有所幫助。。。。。。

標簽： verilog 源程序

上傳時間： 2013-06-03

上傳用戶：ztj182002

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