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用verilog語言編的正弦波發生器，可以用QuartusII來打開這個源碼，也可以轉換成VHDL語言
標簽： verilog 語言 正弦波發生器
上傳時間： 2014-11-27
上傳用戶：葉山豪
Delphi中工作列狀態區的設計參考文件資料
標簽： Delphi
上傳時間： 2013-12-16
上傳用戶：gxmm
TC&MSC高階函式庫設計技術, 如何在DOS下作出圖形介面的程式, 備有豐富的程式庫.
標簽： MSC DOS 程式 TC
上傳時間： 2014-01-21
上傳用戶：lijinchuan
利用verilog實現單片機的反向設計。編程環境為modelsim6.0
標簽： modelsim verilog 6.0 單片機
上傳時間： 2016-01-11
上傳用戶：yzhl1988
這一篇論文的標題為「適應性BIC-MIMO-OFDM系統的性能分析和接收器設計」是2007發表的
標簽： BIC-MIMO-OFDM 2007 系統 性能分析
上傳時間： 2016-01-14
上傳用戶：BIBI
用于生成GF(2^m)有限域中乘法器的Verilog HDL源文件的C程序
標簽： Verilog HDL GF C程序
上傳時間： 2016-01-15
上傳用戶：王楚楚
用于生成GF(2^m)有限域中常數乘法器的Verilog HDL源文件的C程序
上傳用戶：chenbhdt
用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序
上傳時間： 2014-01-13
上傳用戶：gyq
JPEG的硬體設計採用的是VHDL設計,有源碼
標簽： JPEG VHDL 有源
上傳時間： 2016-01-18
上傳用戶：agent
用Verilog HDL寫的數字時鐘,已經在開發板上驗證過的,絕對原創,使用數碼管進行顯示!
標簽： Verilog HDL 數字時鐘 開發板
上傳時間： 2013-12-03
上傳用戶：lnnn30
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