感到風(fēng)格犯得上廣泛的老姑娘留念佛朗哥今年；風(fēng)格內(nèi)禮服呢感了；能夠浪費(fèi)；電功率；豆腐干那么浪費(fèi)的；購買力棵；反革命勞動法；可哥羅仿多功能們，似的。功能們
上傳時間： 2014-08-14
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自己做的VHDL交通燈控制器；分頻器、信號控制器、時鐘模塊；EDA； 通過了仿真、運(yùn)行。時間可以設(shè)置為隨意的兩位數(shù).
上傳時間： 2017-08-10
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隨著科學(xué)技術(shù)的快速發(fā)展和數(shù)據(jù)采集系統(tǒng)的廣泛應(yīng)用，人們對數(shù)據(jù)采集系統(tǒng)的速度、精度、易操作性以及實(shí)時性的要求也在不斷地提高。通用串行總線USB作為一種新型的微機(jī)總線接口規(guī)范，以其使用方便、易于擴(kuò)展、速度快等優(yōu)點(diǎn)而被廣泛地應(yīng)用于數(shù)據(jù)采集系統(tǒng)中?，F(xiàn)場可編程門陣列最大的特點(diǎn)是結(jié)構(gòu)靈活，開發(fā)周期較短，適合于實(shí)時信號處理，已被廣泛應(yīng)用于通信、數(shù)據(jù)采集、圖像處理等諸多領(lǐng)域。 @@ 本文充分利用USB和FPGA的上述優(yōu)點(diǎn)，設(shè)計了一種基于USB2.0技術(shù)和FPGA技術(shù)相結(jié)合的高速數(shù)據(jù)采集系統(tǒng)。 @@ 首先，對數(shù)據(jù)采集基本理論及系統(tǒng)相關(guān)技術(shù)進(jìn)行了簡單地介紹。 @@ 其次，對以ADC轉(zhuǎn)換器(TLC5510)、FPGA芯片(EP1C6Q240C8)為控制器和USB接口芯片(CY7C68013A-56，簡稱FX2)為主的數(shù)據(jù)采集系統(tǒng)進(jìn)行了硬件設(shè)計和分析，并在此設(shè)計的基礎(chǔ)上給出相應(yīng)的原理圖、PCB。硬件設(shè)計主要包括FPGA與ADC和FX2之間的接口電路設(shè)計以及硬件邏輯設(shè)計。 @@ 再次，根據(jù)系統(tǒng)需求，對系統(tǒng)軟件部分進(jìn)行了設(shè)計，分三部分：一是為滿足FX2在USB上的最大傳輸速率而編寫的固件程序；二是在PC機(jī)中的WindowsXP系統(tǒng)下利用GPD編寫USB設(shè)備驅(qū)動程序；三是充分了解FX2的主要功能特點(diǎn)，并編寫出應(yīng)用程序。 @@ 最后，對系統(tǒng)的軟硬件進(jìn)行了調(diào)試，給出了調(diào)試結(jié)果和分析，對出現(xiàn)的問題給出了解決方案。結(jié)果表明，系統(tǒng)符合設(shè)計要求。 @@關(guān)鍵詞：USB2.0；FPGA；SOPC；數(shù)據(jù)采集；固件；
上傳時間： 2013-06-21
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新興的SAl'A技術(shù)為高速、便攜、高性價比的嵌入式硬盤存儲系統(tǒng)的研制提供了保障。將SATA2．5協(xié)議寫到Virtex一5 FPGA內(nèi)部，通過GTP收發(fā)器實(shí)現(xiàn)高速串行數(shù)據(jù)傳輸與存儲，可以突破PCI接口的瓶頸，使系統(tǒng)具備高速、實(shí)時、便攜和海量存儲等特點(diǎn)。關(guān)鍵詞：SATA；Virtex一5；FPGA；硬盤存儲；嵌入式系統(tǒng) SATA硬盤作為新型的存儲介質(zhì)，具有高速、海量、價格低廉、使用方便等優(yōu)點(diǎn)。SATA2．5協(xié)議支持3．0Gb／s的接口速度，SATA2．5硬盤的持續(xù)存儲速度可達(dá)80MB／8，最大存儲容量已經(jīng)達(dá)到750GB(如希捷ST3750640AS硬盤)。SAlrA硬盤已經(jīng)占據(jù)了大部分的PC機(jī)硬盤市場，并且正向工作站、服務(wù)器的領(lǐng)域邁進(jìn)。而在嵌入式的應(yīng)用領(lǐng)域，目前的硬盤存儲設(shè)備依然廣泛采用傳統(tǒng)的IDE(ATA)和SCSI硬盤。由于兩者存在低速或昂貴的缺點(diǎn)。因此如何將SATA硬盤存儲應(yīng)用到嵌入式系統(tǒng)中就成為今后相關(guān)領(lǐng)域的研究重點(diǎn)。
標(biāo)簽： SATA 嵌入式 存儲系統(tǒng)
上傳時間： 2015-01-03
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摘 要：介紹了直接數(shù)字頻率合成 (DDS) 技術(shù)的基本原理，給出了基于Altera公司FPGA器件的一個三相正弦信號發(fā)生器的設(shè)計方案，同時給出了其軟件程序和仿真結(jié)果。仿真結(jié)果表明：該方法生成的三相正弦信號具有對稱性好、波形失真小、頻率精度高等優(yōu)點(diǎn)，且輸出頻率可調(diào)。 關(guān)鍵詞：直接數(shù)字頻率合成；現(xiàn)場可編程門陣列；FPGA；三相正弦信號
標(biāo)簽： DDS 數(shù)字頻率合成
上傳時間： 2014-01-10
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矢量控制作為一種先進(jìn)的控制策略，是在電機(jī)統(tǒng)一理論、機(jī)電能量轉(zhuǎn)換和坐標(biāo)變換理論的基礎(chǔ)上發(fā)展起來的，具有先進(jìn)性、新穎性和實(shí)用性的特點(diǎn)。它是以交流電動機(jī)的雙軸理論為依據(jù)，將定子電流矢量分解為按轉(zhuǎn)子磁場定向的兩個直流分量：一個分量與轉(zhuǎn)子磁鏈?zhǔn)噶恐睾希Q為勵磁電流分量；另一個分量與轉(zhuǎn)子磁鏈?zhǔn)噶看怪?，稱為轉(zhuǎn)矩電流分量。通過控制定子電流矢量在旋轉(zhuǎn)坐標(biāo)系的位置及大小，即可控制勵磁電流分量和轉(zhuǎn)矩電流分量的大小，實(shí)現(xiàn)像直流電動機(jī)那樣對磁場和轉(zhuǎn)矩的解耦控制。本文研究的是以TMS320LF2407ADSP和FPGA為控制核心的矢量控制變頻調(diào)速系統(tǒng)。 分析了脈寬調(diào)制和矢量控制的原理與實(shí)現(xiàn)方法，從而建立了異步電動機(jī)的數(shù)學(xué)模型。對于矢量控制，分析了矢量控制的基本原理和控制算法，推導(dǎo)了三相坐標(biāo)系、兩相靜止與旋轉(zhuǎn)坐標(biāo)系下的電機(jī)基本方程和矢量控制基本公式。同時在進(jìn)行相應(yīng)的坐標(biāo)變換以后，得到了間接磁場定向型變頻調(diào)速系統(tǒng)的矢量控制圖，并結(jié)合TMS320LF2407ADSP完成了具體的實(shí)現(xiàn)方法，根據(jù)矢量控制的基本原理，設(shè)計了一種基于DSP和FPGA的SVPWM冗余系統(tǒng)。 在硬件方面，以TMS320LF2407ADSP和EP1C12Q240FPGA為控制器，兩者之間通過雙口RAMIDT7130完成數(shù)據(jù)的交換，并能在一方失控時另一方立即產(chǎn)生SVPWM波形。同時完成無線遙控、速度給定、數(shù)據(jù)顯示以及電流、速度檢測和保護(hù)等功能，也對變頻調(diào)速系統(tǒng)的主電路、電源電路、FPGA配置電路、無線遙控電路、LCD顯示電路、保護(hù)電路、電流和轉(zhuǎn)速檢測電路作了簡單的介紹。在軟件方面，給出了基于DSP的矢量控制系統(tǒng)軟件流程圖，并用C語言進(jìn)行了編程。用硬件描述語言Verilog對FPGA進(jìn)行了編程，并給出了相關(guān)的仿真波形。MATLAB仿真結(jié)果表明，本文研究的調(diào)速系統(tǒng)的矢量控制算法是成功的，并實(shí)現(xiàn)了對電機(jī)的高性能控制。
上傳時間： 2013-07-09
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近幾年來，OFDM(Orthogonal Frequency Division Multiplexing)技術(shù)引起了人們的廣泛注意，根據(jù)這項新技術(shù)，很多相關(guān)協(xié)議被提出來。其中WiMax(Wireless MetropolitanArea Networks)代表空中接口滿足IEEE 802.16標(biāo)準(zhǔn)的寬帶無線通信系統(tǒng)，IEEE標(biāo)準(zhǔn)在2004年定義了空中接口的物理層(PHY)，即802.16d協(xié)議。該協(xié)議規(guī)定數(shù)據(jù)傳輸采用突發(fā)模式，調(diào)制方式采用OFDM技術(shù)，傳輸速率較高且實(shí)現(xiàn)方便、成本低廉，已經(jīng)成為首先推廣應(yīng)用的商業(yè)化標(biāo)準(zhǔn)。 本文主要對IEEE802.16d OFDM系統(tǒng)物理層進(jìn)行研究，并在XILINX公司的Virtexpro II芯片上實(shí)現(xiàn)了基帶算法。 首先討論了OFDM基本原理及其關(guān)鍵技術(shù)。根據(jù)IEEE802.16d OFDM系統(tǒng)的物理層發(fā)送端流程搭建了基帶仿真鏈路，利用MATLAB/SIMULINK仿真了OFDM系統(tǒng)在有無循環(huán)前綴(CP)、多徑數(shù)目不同等情況下的性能變化。由于同步算法和信道估計算法計算量都很大，為了找到適合采用FPGA實(shí)現(xiàn)的算法，分析了同步誤差和不同信道估計算法對接收信號的影響，并結(jié)合計算量的大小提出了一種新的聯(lián)合同步算法，以及得出了LS信道估計算法最適合802.16d系統(tǒng)的結(jié)論。 其次，完成了基帶發(fā)射機(jī)和接收機(jī)的FPGA硬件電路實(shí)現(xiàn)。為了使系統(tǒng)的時鐘頻率更高，采用了流水線的結(jié)構(gòu)。設(shè)計中采用編寫Verilog程序和使用IP核相結(jié)合的辦法，實(shí)現(xiàn)了新的聯(lián)合同步算法，并且通過簡化結(jié)構(gòu)，避免了信道估計算法中的繁瑣除法。利用ISE9. 2i和Modelsim6.Oc軟件平臺對程序進(jìn)行設(shè)計、綜合和仿真，并將仿真結(jié)果和MATLAB軟件計算結(jié)果相對比。結(jié)果表明，采用16位數(shù)據(jù)總線可達(dá)到理想的精度。 最后，采用串口通信的方式對基帶系統(tǒng)進(jìn)行了驗(yàn)證。通過串口通信從功能上表明該系統(tǒng)確實(shí)可行。 關(guān)鍵詞：IEEE802. 16d； OFDM； 同步；信道估計；基帶系統(tǒng)
上傳時間： 2013-07-31
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FPGA作為新一代集成電路的出現(xiàn)，引起了數(shù)字電路設(shè)計的巨大變革。隨著FPGA工藝的不斷更新與改善，越來越多的用戶與設(shè)計公司開始使用FPGA進(jìn)行系統(tǒng)開發(fā)，因此，PFAG的市場需求也越來越高，從而使得FPGA的集成電路板的工藝發(fā)展也越來越先進(jìn)，在如此良性循環(huán)下，不久的將來，F(xiàn)PGA可以主領(lǐng)集成電路設(shè)計領(lǐng)域。正是由于FPGA有著如此巨大的發(fā)展前景與市場吸引力，因此，本文采用FPGA作為電路設(shè)計的首選。 @@ 隨著FPGA的開發(fā)技術(shù)日趨簡單化、軟件化，從面向硬件語言的VHDL、VerilogHDL設(shè)計語言，到現(xiàn)在面向?qū)ο蟮腟ystem Verilog、SystemC設(shè)計語言，硬件設(shè)計語言開始向高級語言發(fā)展。作為一個軟件設(shè)計人員，會很容易接受面向?qū)ο蟮恼Z言?，F(xiàn)在軟件的設(shè)計中，算法處理的瓶頸就是速度的問題，如果采用專用的硬件電路，可以解決這個問題，本文在第一章第二節(jié)詳細(xì)介紹了軟硬結(jié)合的開發(fā)優(yōu)勢。另外，在第一章中還介紹了知識產(chǎn)權(quán)核心（IP Core）的發(fā)展與前景，特別是IP Core中軟核的設(shè)計與開發(fā)，許多FGPA的開發(fā)公司開始爭奪軟核的開發(fā)市場。 @@ 數(shù)字電路設(shè)計中最長遇到的就是通信的問題，而每一種通信方式都有自己的協(xié)議規(guī)范。在CPU的設(shè)計中，由于需要高速的處理速度，因此其內(nèi)部都是用并行總線進(jìn)行通信，但是由于集成電路資源的問題，不可能所有的外部設(shè)備都要用并行總線進(jìn)行通信，因此其外部通信就需要進(jìn)行串行傳輸。又因?yàn)樾枰B接的外部設(shè)備的不同，因此就需要使用不同的串行通信接口。本文主要介紹了小型CPU中常用的三種通信協(xié)議，那就是SPI、I2C、UART。除了分別論述了各自的通信原理外，本文還特別介紹了一個小型CPU的內(nèi)部構(gòu)造，以及這三個通信協(xié)議在CPU中所處的位置。 @@ 在硬件的設(shè)計開發(fā)中，由于集成電路本身的特殊性，其開發(fā)流程也相對的復(fù)雜。本文由于篇幅的問題，只對總的開發(fā)流程作了簡要的介紹，并且將其中最復(fù)雜但是又很重要的靜態(tài)時序分析進(jìn)行了詳細(xì)的論述。在通信協(xié)議的開發(fā)中，需要注意接口的設(shè)計、時序的分析、驗(yàn)證環(huán)境的搭建等，因此，本文以SPI數(shù)據(jù)通信協(xié)議的設(shè)計作為一個開發(fā)范例，從協(xié)議功能的研究到最后的驗(yàn)證測試，將FPGA 的開發(fā)流程與關(guān)鍵技術(shù)等以實(shí)例的方式進(jìn)行了詳細(xì)的論述。在SPI通信協(xié)議的開發(fā)中，不僅對協(xié)議進(jìn)行了詳細(xì)的功能分析，而且對架構(gòu)中的每個模塊的設(shè)計都進(jìn)行了詳細(xì)的論述。@@關(guān)鍵詞：FPGA；SPI；I2C；UART；靜態(tài)時序分析；驗(yàn)證環(huán)境
上傳時間： 2013-04-24
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對弓網(wǎng)故障的檢測是當(dāng)今列車檢測的一項重要任務(wù)。原始故障視頻圖像具有極大的數(shù)據(jù)量，使實(shí)時存儲和傳輸故障視頻圖像極其困難。由于視頻的數(shù)據(jù)量相當(dāng)大，需要采用先進(jìn)的視頻編解碼協(xié)議進(jìn)行處理，進(jìn)而實(shí)現(xiàn)檢測現(xiàn)場的實(shí)時監(jiān)控。 @@ H．264/AVC(Advanced Video Coding)作為MPEG-4的第10部分，因其具有超高的壓縮效率、極好的網(wǎng)絡(luò)親和性，而被廣泛研究與應(yīng)用。H．264/AVC采用了先進(jìn)的算法，主要有整數(shù)變換、1/4像素精度插值、多模式幀間預(yù)測、抗塊效應(yīng)濾波器和熵編碼等。 @@ 本文使用硬件描述語言Verilog，以紅色颶風(fēng) II開發(fā)板作為硬件平臺，在開發(fā)工具QUARTUSII 6．0和MODELSIM_SE 6．1B環(huán)境中完成軟核的設(shè)計與仿真驗(yàn)證。以Altera公司的CycloneII FPGA(Field Programmable Gate Array)EP2C35F484C8作為核心芯片，實(shí)現(xiàn)視頻圖像采集、存儲、顯示以及實(shí)現(xiàn)H．264/AVC部分算法的基本系統(tǒng)。 @@ FPGA以其設(shè)計靈活、高速、具有豐富的布線資源等特性，逐漸成為許多系統(tǒng)設(shè)計的首選，尤其是與Verilog和VHDL等語言的結(jié)合，大大變革了電子系統(tǒng)的設(shè)計方法，加速了系統(tǒng)的設(shè)計進(jìn)程。 @@ 本文首先分析了FPGA的特點(diǎn)、設(shè)計流程、verilog語言等，然后對靜態(tài)圖像及視頻圖像的編解碼進(jìn)行詳細(xì)的分析，比如H．264/AVC中的變換、量化、熵編碼等：并以JM10．2為平臺，運(yùn)用H．264/AVC算法對視頻序列進(jìn)行大量的實(shí)驗(yàn)，對不同分辨率、量化步長、視頻序列進(jìn)行編解碼以及對結(jié)果進(jìn)行分析。接著以紅色颶風(fēng)II開發(fā)板為平臺，進(jìn)行視頻圖像的采集存儲、顯示分析，其中詳細(xì)分析了SAA7113的配置、CCD信號的A/D轉(zhuǎn)換、I2C總線、視頻的數(shù)字化ITU-R BT．601標(biāo)準(zhǔn)介紹及視頻同步信號的獲取、基于SDRAM的視頻幀存儲、VGA顯示控制設(shè)計；最后運(yùn)用verilog語言實(shí)現(xiàn)H．264/AVC部分算法，并進(jìn)行功能仿真，得到預(yù)計的效果。 @@ 本文實(shí)現(xiàn)了整個視頻信號的采集存儲、顯示流程，詳細(xì)研究了H．264/AVC算法，并運(yùn)用硬件語言實(shí)現(xiàn)了部分算法，對視頻編解碼芯片的設(shè)計具有一定的參考價值。 @@關(guān)鍵詞：FPGA；H．264/AVC；視頻；verilog；編解碼
上傳時間： 2013-04-24
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基于嵌入式技術(shù)的遠(yuǎn)程監(jiān)控系統(tǒng)可以達(dá)到動態(tài)、無死角的監(jiān)控目的，可以對一些特殊環(huán)境進(jìn)行遠(yuǎn)程監(jiān)視和控制，且不受濕度、溫度等條件的影響，廣泛應(yīng)用于軍事、交通、智能家居、醫(yī)療監(jiān)護(hù)等多個領(lǐng)域?？梢越鉀Q傳統(tǒng)監(jiān)控系統(tǒng)將圖像采集設(shè)備固定在一個地方而使監(jiān)控范圍有限，適用場合少等弊端。 本文設(shè)計了一款基于ARM和FPGA的遠(yuǎn)程監(jiān)控系統(tǒng)。首先在對遠(yuǎn)程監(jiān)控系統(tǒng)功能分析的基礎(chǔ)上，設(shè)計了以ARM為主控制器和FPGA為輔助控制器的硬件電路，采用ARM芯片控制圖像采集、速度采集、網(wǎng)絡(luò)傳輸?shù)雀蓴_小的模塊，采用FPGA芯片控制電機(jī)驅(qū)動、舵機(jī)驅(qū)動、電池監(jiān)控等干擾大的模塊，大大提高了系統(tǒng)的穩(wěn)定性；其次設(shè)計了基于WinCE操作系統(tǒng)的圖像采集、GPIO、PWM、外中斷EINT-19的流接口驅(qū)動程序；同時設(shè)計了基于WinCE操作系統(tǒng)的圖像采集及壓縮、網(wǎng)絡(luò)通信、車模速度采集的應(yīng)用程序；FPGA內(nèi)部邏輯電路采用Verilog語言完成電源監(jiān)控、舵機(jī)控制、直流電機(jī)控制等功能。 本系統(tǒng)集圖像采集和壓縮、運(yùn)動控制、網(wǎng)絡(luò)傳輸于一體。其圖像采集速度達(dá)30幀/秒，圖像分辨率達(dá)640x480，JPEG壓縮比達(dá)10：1，控制命令響應(yīng)時間為1s，網(wǎng)絡(luò)傳輸速率達(dá)10Mbps。其功能擴(kuò)展容易，功耗低，體積小，抗干擾能力強(qiáng)，具有很好的市場前景。
標(biāo)簽： FPGA ARM 遠(yuǎn)程監(jiān)控 系統(tǒng)設(shè)計
上傳時間： 2013-06-18
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