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Virtex5

  • 基于Virtex5的PCI接口電路

    PCI Express是由Intel，Dell，Compaq，IBM，Microsoft等PCI SIG聯(lián)合成立的Arapahoe Work Group共同草擬并推舉成取代PCI總線標準的下一代標準。PCI Express利用串行的連接特點能輕松將數(shù)據(jù)傳輸速度提到一個很高的頻率，達到遠遠超出PCI總線的傳輸速率。一個PCI Express連接可以被配置成x1，x2，x4，x8，x12，x16和x32的數(shù)據(jù)帶寬。x1的通道能實現(xiàn)單向312.5 MB／s（2.5 Gb／s）的傳輸速率。Xilinx公司的Virtex5系列FPGA芯片內嵌PCI-ExpressEndpoint Block硬核，為實現(xiàn)單片可配置PCI-Express總線解決方案提供了可能。　　本文在研究PCI-Express接口協(xié)議和PCI-Express Endpoint Block硬核的基礎上，使用Virtex5LXT50 FPGA芯片設計PCI Express接口硬件電路，實現(xiàn)PCI-Express數(shù)據(jù)傳輸

    標簽： Virtex5 PCI 接口電路

    上傳時間： 2013-12-27

    上傳用戶：wtrl

  • Xilinx Virtex5 SGMII高速串行通信例程。

    Xilinx Virtex5 SGMII高速串行通信例程。

    標簽： Virtex5 Xilinx SGMII 高速串行

    上傳時間： 2017-01-28

    上傳用戶：thuyenvinh

  • 基于FPGA的SATAⅡ協(xié)議研究與實現(xiàn).rar

    現(xiàn)代的計算機追求的是更快的速度、更高的數(shù)據(jù)完整性和靈活性。無論從物理性能，還是從電氣性能來看，現(xiàn)今的并行總線都已出現(xiàn)了某些局限，無法提供更高的數(shù)據(jù)傳輸率。而SATA以其傳輸速率快、支持熱插拔、可靠的數(shù)據(jù)傳輸?shù)忍攸c，得到各行業(yè)越來越多的支持。 目前市場上的SATA IP CORE都是面向IC設計的，不利于在FPGA上集成，因此，本文在Xilinx公司的Virtex5系列FPGA上實現(xiàn)SATAⅡ協(xié)議，對SATA技術的推廣、國內邏輯IP核的發(fā)展都有一定的意義。 本文將SATAⅡ協(xié)議的FPGA實現(xiàn)劃分成物理層、鏈路層、傳輸層和應用層四個模塊。提出了物理層串行收/發(fā)器設計以及物理鏈路初始化方案。分析了鏈路層模塊結構，給出了作為SATAⅡ鏈路層核心的狀態(tài)機的設計。為滿足SATAⅡ協(xié)議3．0Gbps的速率，采用擴大數(shù)據(jù)處理位寬的方法，設計完成了鏈路層的16b/20b編碼模塊，同時為提高數(shù)據(jù)傳輸可靠性和信號的穩(wěn)定性，分別實現(xiàn)了鏈路層CRC校驗模塊和并行擾碼模塊。在描述協(xié)議傳輸層的模塊結構的基礎上，給出了作為傳輸層核心的狀態(tài)機的設計，并以DMA DATA OUT命令的操作為例介紹了FIS在傳輸層中的處理過程。完成了命令層協(xié)議狀態(tài)機的設計，并實現(xiàn)了SATAⅡ新增功能NCQ技術，從而使得數(shù)據(jù)傳輸更加有效。最后為使本設計應用更加廣泛，設計了基于AHB總線的用戶接口。 本設計采用Verilog HDL語言對需要實現(xiàn)的電路進行描述，并使用Modelsim軟件仿真。仿真結果表明，本文設計的邏輯電路可靠穩(wěn)定，與SATAⅡ協(xié)議定義功能一致。

    標簽： FPGA SATA 協(xié)議研究

    上傳時間： 2013-06-16

    上傳用戶：cccole0605

  • SATA2.0硬盤加解密接口芯片數(shù)據(jù)通路的設計與FPGA實現(xiàn).rar

    SATA接口是新一代的硬盤串行接口標準，和以往的并行硬盤接口比較它具有支持熱插拔、傳輸速率快、執(zhí)行效率高的明顯優(yōu)勢。SATA2．0是SATA的第二代標準，它規(guī)定在數(shù)據(jù)線上使用LVDS NRZ串行數(shù)據(jù)流傳輸數(shù)據(jù)，速率可達3Gb/s。另外，SATA2．0還具有支持NCQ（本地命令隊列）、端口復用器、交錯啟動等一系列技術特征。正是由于以上的種種技術優(yōu)點，SATA硬盤業(yè)已被廣泛的使用于各種企業(yè)級和個人用戶。 硬盤作為主要的信息載體之一，其信息安全問題尤其引起人們的關注。由于在加密時需要實時處理大量的數(shù)據(jù)，所以對硬盤數(shù)據(jù)的加密主要使用帶有密鑰的硬件加密的方式。因此將硬盤加密和SATA接口結合起來進行設計和研究，完成基于SATA2．0接口的加解密芯片系統(tǒng)設計具有重要的使用價值和研究價值。 本論文首先介紹了SATA2．0的總線協(xié)議，其協(xié)議體系結構包括物理層、鏈路層、傳輸層和命令層，并對系統(tǒng)設計中各個層次中涉及的關鍵問題進行了闡述。其次，本論文對ATA協(xié)議和命令進行了詳細的解釋和分析，并針對設計中涉及的命令和對其做出的修改進行了說明。接著，本論文對SATA2．0加解密控制芯片的系統(tǒng)設計進行了講解，包括硬件平臺搭建和器件選型、模塊和功能劃分、系統(tǒng)工作原理等，剖析了系統(tǒng)設計中的難點問題并給出解決問題的方法。然后，對系統(tǒng)數(shù)據(jù)通路的各個模塊的設計和實現(xiàn)進行詳盡的闡述，并給出各個模塊的驗證結果。最后，本文簡要的介紹了驗證平臺搭建和測試環(huán)境、測試方法等問題，并分析測試結果。 本SATA2．0硬盤加解密接口電路在Xilinx公司的Virtex5 XC5VLX50T FPGA上進行測試，目前工作正常，性能良好，已經(jīng)達到項目性能指標要求。本論文在SATA加解密控制芯片設計與實現(xiàn)方面的研究成果，具有通用性、可移植性，有一定的理論及經(jīng)濟價值。

    標簽： SATA FPGA 2.0

    上傳時間： 2013-04-24

    上傳用戶：JIUSHICHEN

  • 基于ARM和FPGA的嵌入式開發(fā)平臺設計與實現(xiàn)

    隨著計算機技術、網(wǎng)絡技術和微電子技術的深入發(fā)展，嵌入式系統(tǒng)在各個領域中得到廣泛應用。以ARM和以FPGA為核心的嵌入式系統(tǒng)是當前嵌入式研究的熱點，而相關研究的開展需要功能強大的開發(fā)平臺支持，因此基于ARM和FPGA的開發(fā)平臺設計研究具有重要意義。 本文分別設計了一款基于PXA270的ARM開發(fā)平臺和一款基于Virtex5的FPGA開發(fā)平臺，主要針對電源管理、接口設計、板級時序等關鍵技術進行了研究。在此基礎上利用PADS Logic設計工具完成了系統(tǒng)原理圖設計，并借助Hyperlynx SI仿真工具，對PCB的板級設計問題進行了分析，實現(xiàn)了平臺PCB的可靠設計。最后對平臺各模塊進行了調試，通過在平臺上運行操作系統(tǒng)并加載可執(zhí)行程序的方法驗證了平臺整體功能。 本文的特色體現(xiàn)在以下三個方面： (1)結合PXA270處理器內部的電源管理單元和MAX1586A集成電源管理芯片，實現(xiàn)了PXA270開發(fā)平臺的動態(tài)電源管理，有效降低了平臺功耗； (2)平臺實現(xiàn)了FF/BT/STUART、USB Host/Client、SD/MMC、AC'97、LCD和擴展VGA、PCMCIA/CF等多種接口，具有良好的開發(fā)靈活性和通用性； (3)對開發(fā)平臺PCB板級走線中可能出現(xiàn)的反射、串擾、時序沖突等問題進行評估，給出了布線約束方案，使系統(tǒng)可靠性得到有效提高。

    標簽： FPGA ARM 嵌入式開發(fā) 平臺設計

    上傳時間： 2013-07-06

    上傳用戶：gps6888

  • 基于FPGA的遺傳算法的硬件實現(xiàn)

    遺傳算法是一種基于自然選擇原理的優(yōu)化算法，在很多領域有著廣泛的應用。但是，遺傳算法使用計算機軟件實現(xiàn)時，會隨著問題復雜度和求解精度要求的提高，產生很大的計算延時，這種計算的延時限制了遺傳算法在很多實時性要求較高場合的應用。為了提升運行速度，可以使用FPGA作為硬件平臺，設計數(shù)字系統(tǒng)完成遺傳算法。和軟件實現(xiàn)相比，硬件實現(xiàn)盡管在實時性和并行性方面具有很大優(yōu)勢，但同時會導致系統(tǒng)的靈活性不足、通用性不強。本文針對上述矛盾，使用基于功能的模塊化思想，將基于FPGA的遺傳算法硬件平臺劃分成兩類模塊：系統(tǒng)功能模塊和算子功能模塊。針對不同問題，可以在保持系統(tǒng)功能模塊不變的前提下，選擇不同的遺傳算子功能模塊完成所需要的優(yōu)化運算。本文基于Xilinx公司的Virtex5系列FPGA平臺，使用VerilogHDL語言實現(xiàn)了偽隨機數(shù)發(fā)生模塊、隨機數(shù)接口模塊、存儲器接口/控制模塊和系統(tǒng)控制模塊等系統(tǒng)功能模塊，以及基本位交叉算子模塊、PMX交叉算子模塊、基本位變異算子模塊、交換變異算子模塊和逆轉變異算子模塊等遺傳算法功能模塊，構建了系統(tǒng)功能構架和遺傳算子庫。該設計方法不僅使遺傳算法平臺在解決問題時具有更高的靈活性和通用性，而且維持了系統(tǒng)架構的穩(wěn)定。本文設計了多峰值、不連續(xù)、不可導函數(shù)的極值問題和16座城市的旅行商問題 (TSP)對遺傳算法硬件平臺進行了測試。根據(jù)測試結果，該硬件平臺表現(xiàn)良好，所求取的最優(yōu)解誤差均在1％以內。相對于軟件實現(xiàn)，該系統(tǒng)在求解一些復雜問題時，速度可以提高2個數(shù)量級。最后，本文使用FPGA實現(xiàn)了粗粒度并行遺傳算法模型，并用于 TSP問題的求解。將硬件平臺的運行速度在上述基礎上提高了近1倍，取得了顯著的效果。關鍵詞：遺傳算法，硬件實現(xiàn)，并行設計，F(xiàn)PGA，TSP

    標簽： FPGA 算法 硬件實現(xiàn)

    上傳時間： 2013-06-15

    上傳用戶：hakim

  • Genesys_rm(xilinxV5數(shù)據(jù)手冊)

    xilinx Virtex5開發(fā)板技術手冊

    標簽： Genesys_rm xilinxV5 數(shù)據(jù)手冊

    上傳時間： 2013-10-15

    上傳用戶：黃華強

  • 基于FPGA實現(xiàn)的高速串行交換模塊實現(xiàn)方法研究

    采用Xlinx公司的Virtex5系列FPGA設計了一個用于多種高速串行協(xié)議的數(shù)據(jù)交換模塊,并解決了該模塊實現(xiàn)中的關鍵問題.該交換模塊實現(xiàn)4X模式RapidIO協(xié)議與4X模式PCI Express協(xié)議之間的數(shù)據(jù)交換,以及自定義光纖協(xié)議與4X模式PCI Express協(xié)議之間的數(shù)據(jù)交換,實現(xiàn)了單字讀寫以及DMA操作,并提供高速穩(wěn)定的傳輸帶寬.

    標簽： FPGA 高速串行 模塊 實現(xiàn)方法

    上傳時間： 2013-10-12

    上傳用戶：rnsfing

  • 功率倒置算法在北斗抗干擾天線系統(tǒng)中的應用

    為解決北斗導航接收機干擾功率強、有效信號弱的不足，提出了一種基于功率倒置自適應算法的抗干擾設計方案。該方案以自適應天線系統(tǒng)為平臺，采用FPGA處理器Virtex5芯片實現(xiàn)自適應算法，根據(jù)最小均方誤差原則迭代計算功率倒置的最優(yōu)權值并產生加權輸出。測試結果顯示：功率倒置算法在干擾形式、干擾方向未知的情況下能夠有效抑制干擾，為北斗導航接收機提供最高50 dB的抗干擾能力。

    標簽： 功率倒置 中的應用 算法 北斗

    上傳時間： 2013-11-07

    上傳用戶：born2007

  • Genesys_rm(xilinxV5數(shù)據(jù)手冊)

    xilinx Virtex5開發(fā)板技術手冊

    標簽： Genesys_rm xilinxV5 數(shù)據(jù)手冊

    上傳時間： 2013-11-05

    上傳用戶：lgnf

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