基于USB6008的多功能數(shù)據(jù)測(cè)控系統(tǒng)
標(biāo)簽： 6008 USB 多功能 數(shù)據(jù)測(cè)控
上傳時(shí)間： 2013-10-23
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AD9981是首款集成自動(dòng)失調(diào)功能的顯示電子器件(DEPL)。自動(dòng)失調(diào)功能通過計(jì)算所需的失調(diào)設(shè)置來工作，從而在箝位期間產(chǎn)生給定的輸出代碼。當(dāng)自動(dòng)失調(diào)使能時(shí)(寄存器0x1B:5 = 1)，寄存器0x0B-0x10的設(shè)置由自動(dòng)失調(diào)電路用作期望的箝位代碼(或目標(biāo)代碼)，而非失調(diào)值。電路會(huì)在箝位后(但仍在“后肩”期間)輸出代碼和目標(biāo)代碼作比較，然后上調(diào)或下調(diào)失調(diào)以進(jìn)行補(bǔ)償。在自動(dòng)失調(diào)模式下，目標(biāo)代碼為11位二進(jìn)制補(bǔ)碼字，并將0x0B位7用作紅色通道的符號(hào)位(0x0D位7用于綠色通道，0x0F位7用于藍(lán)色通道)。
標(biāo)簽： 9981 AD 自動(dòng)失調(diào)
上傳時(shí)間： 2014-12-23
上傳用戶：glxcl
AD9880集成自動(dòng)失調(diào)功能。動(dòng)失調(diào)功能通過監(jiān)控各ADC在箝位期間的輸出并計(jì)算所需的失調(diào)設(shè)置來工作，從而產(chǎn)生給定的輸出代碼。當(dāng)自動(dòng)失調(diào)功能使能時(shí)(寄存器0x1C:7= 1)，“目標(biāo)代碼”寄存器(0x09、0x0B、0x0D)中的設(shè)置由自動(dòng)失調(diào)電路用作期望的箝位代碼。電路會(huì)在箝位后(但仍在“后肩”期間)對(duì)比輸出代碼和目標(biāo)代碼，然后上調(diào)或下調(diào)失調(diào)以進(jìn)行補(bǔ)償。在自動(dòng)失調(diào)模式下，失調(diào)寄存器(0x08、0x0A、0x0C)均為8位二進(jìn)制補(bǔ)碼字格式，各對(duì)應(yīng)寄存器的位7為符號(hào)位。
標(biāo)簽： 9880 AD 自動(dòng)失調(diào)
上傳時(shí)間： 2013-10-22
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提出了一種有效實(shí)現(xiàn)自動(dòng)糾錯(cuò)功能FIR數(shù)字濾波器技術(shù)，該技術(shù)采用2種不同架構(gòu)的標(biāo)準(zhǔn)濾波器通過并行操作來完成。任一濾波器軟錯(cuò)誤的發(fā)生就會(huì)引起兩個(gè)濾波器輸出不匹配，達(dá)到檢測(cè)錯(cuò)誤的目的，增強(qiáng)了傳統(tǒng)濾波器對(duì)差錯(cuò)檢測(cè)和差錯(cuò)糾正的支持。最后對(duì)該濾波器地性能進(jìn)行評(píng)估，該濾波器性能良好，糾錯(cuò)率接近100%，可廣泛運(yùn)用在各種信號(hào)處理中。
標(biāo)簽： FIR 自動(dòng)糾錯(cuò) 濾波器
上傳時(shí)間： 2013-10-27
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數(shù)字電路功能
上傳時(shí)間： 2013-10-12
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多功能數(shù)字鐘的VHDL設(shè)計(jì)
上傳時(shí)間： 2013-10-29
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AD9980集成自動(dòng)失調(diào)功能。自動(dòng)失調(diào)功能通過計(jì)算所需的失調(diào)設(shè)置來工作，從而在箝位期間產(chǎn)生給定的輸出代碼。當(dāng)自動(dòng)失調(diào)使能時(shí)(寄存器0x1B:5 = 1)，寄存器0x0B至0x10的設(shè)置由自動(dòng)失調(diào)電路用作期望的箝位代碼(或目標(biāo)代碼)，而非失調(diào)值。電路會(huì)在箝位后(但仍在后沿箝位期間)對(duì)比輸出代碼和目標(biāo)代碼，然后上調(diào)或下調(diào)失調(diào)以進(jìn)行補(bǔ)償。在自動(dòng)失調(diào)模式下，目標(biāo)代碼為11位二進(jìn)制補(bǔ)碼字，并將0x0B位7用作紅色通道的符號(hào)位(0x0D位7用于綠色通道，0x0F位7用于藍(lán)色通道)。
標(biāo)簽： 9980 AD 自動(dòng)失調(diào)
上傳時(shí)間： 2013-10-24
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74HC系列通用邏輯電路功能
上傳時(shí)間： 2013-10-10
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74系列芯片功能大全
上傳時(shí)間： 2013-12-21
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為了提高數(shù)字集成電路芯片的驅(qū)動(dòng)能力，采用優(yōu)化比例因子的等比緩沖器鏈方法，通過Hspice軟件仿真和版圖設(shè)計(jì)測(cè)試，提出了一種基于CSMC 2P2M 0.6 μm CMOS工藝的輸出緩沖電路設(shè)計(jì)方案。本文完成了系統(tǒng)的電原理圖設(shè)計(jì)和版圖設(shè)計(jì)，整體電路采用Hspice和CSMC 2P2M 的0.6 μm CMOS工藝的工藝庫（06mixddct02v24）仿真，基于CSMC 2P2M 0.6 μm CMOS工藝完成版圖設(shè)計(jì)，并在一款多功能數(shù)字芯片上使用，版圖面積為1 mm×1 mm，并參與MPW（多項(xiàng)目晶圓）計(jì)劃流片，流片測(cè)試結(jié)果表明，在輸出負(fù)載很大時(shí)，本設(shè)計(jì)能提供足夠的驅(qū)動(dòng)電流，同時(shí)延遲時(shí)間短、并占用版圖面積小。
標(biāo)簽： CMOS 工藝 多功能 數(shù)字芯片
上傳時(shí)間： 2013-10-09
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