這是Matlab實(shí)現(xiàn)的非常簡(jiǎn)單的數(shù)字信號(hào)調(diào)制仿真，用于Xilinx FPGA（ASK, BPSK, FSK, OOK, QPSK）
標(biāo)簽： XILinX-FPGA-Matlab-Simulate
上傳時(shí)間： 2013-07-15
上傳用戶(hù)：thh29
基于Xilinx FPGA的DDRSDRAM的Verilog控制代碼，使用的FPGA為Virtex-4，實(shí)現(xiàn)對(duì)DDRSDRAM的簡(jiǎn)單控制（對(duì)一系列地址的寫(xiě)入和讀取）。
標(biāo)簽： DDRSDRAM Verilog Xilinx FPGA
上傳時(shí)間： 2013-08-07
上傳用戶(hù)：ainimao
Xilinx FPGA Design Tutorial
標(biāo)簽： Tutorial Xilinx Design FPGA
上傳用戶(hù)：一諾88
非常不錯(cuò)的Xilinx FPGA技術(shù)的高級(jí)教程\r\n
標(biāo)簽： Xilinx FPGA 教程
上傳時(shí)間： 2013-08-08
上傳用戶(hù)：netwolf
詳細(xì)介紹了 關(guān)于xilinx FPGA的內(nèi)部結(jié)構(gòu)，熟悉內(nèi)部結(jié)構(gòu)對(duì)于編寫(xiě)高效的代碼有十分重要的作用
標(biāo)簽： xilinx FPGA 內(nèi)部結(jié)構(gòu)
上傳時(shí)間： 2013-08-09
上傳用戶(hù)：dumplin9
通過(guò) VLYNQ 把 Xilinx FPGA 作為 TI DSP 的外設(shè).rar
標(biāo)簽： Xilinx VLYNQ FPGA DSP
上傳時(shí)間： 2013-08-13
上傳用戶(hù)：lz4v4
FPGA設(shè)計(jì)全流程十分鐘學(xué)會(huì)Xilinx FPGA 設(shè)計(jì)
標(biāo)簽： FPGA Xilinx 流程 十分
上傳時(shí)間： 2013-08-14
上傳用戶(hù)：klin3139
xilinx fpga 做VGA驅(qū)動(dòng)信號(hào)的Verilog原代碼,ise版本9.2,
標(biāo)簽： Verilog xilinx fpga VGA
上傳時(shí)間： 2013-08-16
上傳用戶(hù)：jasson5678
Xilinx fpga 設(shè)計(jì)培訓(xùn)中文教程,比較好的學(xué)習(xí)FPGA入門(mén)的教程
標(biāo)簽： Xilinx FPGA fpga 教程
上傳時(shí)間： 2013-08-23
上傳用戶(hù)：上善若水
十分鐘學(xué)會(huì)Xilinx FPGA 設(shè)計(jì)1.1，內(nèi)容明了，推薦
標(biāo)簽： Xilinx FPGA 十分
上傳時(shí)間： 2013-09-01
上傳用戶(hù)：18888888888
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