ISE® 12 軟件設計套件，實現了具有更高設計生產力的功耗和成本的突破性優化。ISE 設計套件首次利用“智能”時鐘門控技術，將動態功耗降低多達 30%。此外，該新型套件還提供了基于時序的高級設計保存功能、為即插即用設計提供符合 AMBA 4 AXI4 規范的 IP 支持，同時具備第四代部分重配置功能的直觀設計流程，可降低多種高性能應用的系統成本。
上傳時間： 2013-05-15
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在為所有 Xilinx® Virtex®-6 和 Spartan®-6 FPGA 產品系列提供全面生產支持的同時，ISE 12 版本作為業界唯一一款領域專用設計套件，不斷發展和演進，可以為邏輯、數字信號處理(DSP)、嵌入式處理以及系統級設計提供互操作性設計流程和工具配置。此外，賽靈思還在 ISE 12 套件中采用了大量軟件基礎架構，并改進了設計方法，從而不僅可縮短運行時間，提高系統集成度，而且還能在最新一代器件產品系列和目標設計平臺上擴展 IP 互操作性
上傳時間： 2013-04-15
上傳用戶：eeworm
ispLEVER2.0是一套完整的EDA軟件。設計輸入可采用原理圖、硬件描述語言、混合輸入三種方式。能對所設計的數字電子系統進行功能仿真和時序仿真。編譯器是此軟件的核心，能進行邏輯優化，將邏輯映射到器件中去，自動完成布局與布線并生成編程所需要的熔絲圖件。軟件支持原有Lattice公司的GAL、ispLSI、MACH、ispGDX、ORCA2、ORCA3、ORCA4和最新的ispMACH器件。Xilinx.ISE.Design.Suite（北京市電子設計競賽指定軟件）
上傳時間： 2013-05-20
上傳用戶：eeworm
大家好，歡迎Vivado的一個快速演示，它是xilinx新的設計套件，應用到7系列和以上的系列器件。
上傳時間： 2013-08-03
上傳用戶：xiaoxiang
matlab實現的多個基礎程序和報告并有流程圖（1） 繪出正弦信號波形及頻譜。 （2） 單極性歸零（RZ）波形及其功率譜，占空比為50％。 （3） 升余弦滾降波形的眼圖及其功率譜。滾降系數為0.5。發送碼元取值為0、2。 （4） 最佳基帶系統的Pe~Eb\No曲線，升余弦滾降系數a=0.5，取樣值的偏差是Ts/4。 （5） Pe~Eb\No，升余弦滾降系數a=0.5，取樣時間無偏差，但信道是多徑信道，C(f)=abs(1-0.5*exp(-j*2*pi*f*dt))，dt=Ts/2。 （6） 仿真數字基帶傳輸系統，包括輸入、輸出信號波形及其功率譜，眼圖（升余弦滾降系數a=0.5），Pe~Eb\No曲線，取樣時間無偏差。
上傳時間： 2014-01-22
上傳用戶：aix008
計算這個智力題： 在這個乘法算式里，每一個字母代表著0-9中的一個數，不同字母代表不同數。 A B C D E F G H * A J --------------------- E J A H F D G K C B D F H A J E C --------------------- C C C C C C C C C 請問，C 代表哪個數字？
上傳時間： 2013-12-30
上傳用戶：stampede
使用ASP元件（請自行下載、安裝或登錄） AspUpload+AspJpeg+Jmail[或AspMail] 整合JS與FLASH套件 Highslide JS+SWFUpload+TitleView+FPV4[請自行下載] 新增相薄圖檔後[Web上傳或FTP上傳後批次新增]，自動生成TitleView／FPV4，使用的XML腳本檔。刪除或搬移圖檔，同樣更新XML腳本檔。 使用 4.1_先用記事本設定編輯config.asp/menu.asp 4.2_瀏覽器進入addphoto.asp新增相簿分類（請事先作好規劃） 4.3_瀏覽器進入index.asp[被轉到NewPhoto.asp]，簽入後按上傳圖檔，按新增相片後上傳圖檔 更詳細解說： http://www.chome.idv.tw/article.asp?id=158
標簽： AspUpload Highslide SWFUpload AspJpeg
上傳時間： 2013-12-21
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本文主要介紹如何在Wado設計套件中進行時序約束，原文出自 xilinx中文社區。1 Timing Constraints in Vivado-UCF to xdcVivado軟件相比于sE的一大轉變就是約束文件，5E軟件支持的是UcF（User Constraints file，而 Vivado軟件轉換到了XDc（Xilinx Design Constraints）。XDC主要基于SDc（Synopsys Design Constraints）標準，另外集成了Xinx的一些約束標準可以說這一轉變是xinx向業界標準的靠攏。Altera從 TimeQuest開始就一直使用SDc標準，這一改變，相信對于很多工程師來說是好事，兩個平臺之間的轉換會更加容易些。首先看一下業界標準SDc的原文介紹：Synopsys widely-used design constraints format, known as sDc, describes the design intent"and surrounding constraints for synthesis, clocking, timing, power, test and environmental and operating conditions. sDc has been in use and evolving for more than 20 years, making it the most popular and proven format for describing design constraints. Essentially all synthesized designs use SDc and numerous EDa companies have translators that can read and process sDc
標簽： vivado
上傳時間： 2022-03-26
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Sentaurus TCAD全面繼承了Tsuprem4，Medici和ISE-TCAD的特點和優勢，它可以用來模擬集成器件的工藝制程，器件物理特性和互連線特性等。Sentaurus TCAD提供全面的產品套件，其中包括Sentaurus Workbench, Ligament, Sentaurus Process, Sentaurus Structure Editor, Mesh Noffset3D, Sentaurus Device, Tecplot SV Inspect, Advanced Calibration等等。Sentaurus Process和Sentaurus Device可以支持的仿真器件類型非常廣泛，包括CMOS，功率器件，存儲器，圖像傳感器，太陽能電池，和模擬/射頻器件。sentaurus TCAD還提供互連建模和參數提取工具，為優化芯片性能提供關鍵的寄生參數信息。
上傳時間： 2022-06-30
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開關電源基本原理與設計介紹 ppt
標簽： 開關電源
上傳時間： 2013-07-24
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