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  • 基于FPGA的OQPSK調(diào)制解調(diào)器

    偏移正交相移鍵控(OQPSK:Offset Quadrature Phase Shift Keying)調(diào)制技術(shù)是一種恒包絡(luò)調(diào)制技術(shù),具有頻譜利用率高、頻譜特性好等特點,廣泛應(yīng)用于衛(wèi)星通信和移動通信領(lǐng)域。 論文以某型偵收設(shè)備中OQPSK解調(diào)器的全數(shù)字化為研究背景,設(shè)計并實現(xiàn)了基于FPGA的全數(shù)字OQPSK調(diào)制解調(diào)器,其中調(diào)制器主要用于仿真未知信號,作為測試信號源。論文研究了全數(shù)字OQPSK調(diào)制解調(diào)的基本算法,包括成形濾波器、NCO模型、載波恢復、定時恢復等;完成了整個調(diào)制解調(diào)算法的MATLAB仿真。在此基礎(chǔ)上,采用VHDL硬件描述語言在Xilinx公司ISE7.1開發(fā)環(huán)境下設(shè)計并實現(xiàn)了各個算法模塊,并在硬件平臺上加以實現(xiàn)。通過實際現(xiàn)場測試,實現(xiàn)了對所偵收信號的正確解調(diào)。論文還實現(xiàn)了解調(diào)器的百兆以太網(wǎng)接口,使得系統(tǒng)可以方便地將解調(diào)數(shù)據(jù)發(fā)送給計算機進行后續(xù)處理。

    標簽: OQPSK FPGA 調(diào)制解調(diào)器

    上傳時間: 2013-05-19

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  • 基于FPGA的Turbo碼編譯碼器研究與實現(xiàn)

    本文以Turbo碼編譯碼器的FPGA實現(xiàn)為目標,對Turbo碼的編譯碼算法和用硬件語言將其實現(xiàn)進行了深入的研究。 首先,在理論上對Turbo碼的編譯碼原理進行了介紹,確定了Max-log-MAF算法的譯碼算法,結(jié)合CCSDS標準,在實現(xiàn)編碼器時,針對標準中給定的幀長、碼率與交織算法,以及偽隨機序列模塊與幀同步模塊,提出了相應(yīng)解決方案;而在相應(yīng)的譯碼器設(shè)計中,采用了FPGA設(shè)計中“自上而下”的設(shè)計方法,權(quán)衡硬件實現(xiàn)復雜度與處理時延等因素,優(yōu)先考慮面積因素,提高元件的重復利用率和降低電路復雜度,來實現(xiàn)Turbo碼的Max-log-MAP算法譯碼。把整個系統(tǒng)分割成不同的功能模塊,分別闡述了實現(xiàn)過程。 然后,基于Verilog HDL 設(shè)計出12位固點數(shù)據(jù)的Turbo編譯碼器以及仿真驗證平臺,與用Matlab語言設(shè)計的相同指標的浮點數(shù)據(jù)譯碼器進行性能比較,得到該設(shè)計的功能驗證。 最后,研究了Tuxbo碼譯碼器幾項最新技術(shù),如滑動窗譯碼,歸一化處理,停止迭代技術(shù)結(jié)合流水線電路設(shè)計,將改進后的譯碼器與先前設(shè)計的譯碼器分別在ISE開發(fā)環(huán)境中針對目標器件xilinx Virtex-Ⅱ500進行電路綜合,證實了這些改進技術(shù)能有效地提高譯碼器的吞吐量,減少譯碼時延和存儲器面積從而降低功耗。

    標簽: Turbo FPGA 編譯碼器

    上傳時間: 2013-04-24

    上傳用戶:haohaoxuexi

  • 基于FPGA的出租車計費器設(shè)計

    本文介紹了一種采用單片F(xiàn)PGA 芯片進行出租車計費器的設(shè)計方法,主要闡述如何使用新興的EDA 器件取代傳統(tǒng)的電子設(shè)計方法,利用FPGA 的可編程性,簡潔而又多變的設(shè)計方法,縮短了研發(fā)周期,同時使出租車計費器體積更小功能更強大。本設(shè)計不僅實現(xiàn)了出租車計費器所需的一些基本功能,同時考慮到出租車行業(yè)的一些特殊性,更注重了把一些新的思路加入到設(shè)計中。主要包括采用了FPGA 芯片,使用VHDL 語言進行編程,使其具有了更強的移植性,更加利于產(chǎn)品升級;利用LCD 液晶顯示取代了傳統(tǒng)的LED顯示,使其在顯示時更靈活多變,可以按需要改變顯示內(nèi)容而不拘泥于硬件; 靈活的計價標準設(shè)定使得油價波動等成本因數(shù)和出租車價格聯(lián)動成為可能; 同時也增加了統(tǒng)計功能、密碼設(shè)定、超速警報、路橋費等新的功能使得本設(shè)計更加具有實用價值。

    標簽: FPGA 出租車計費器

    上傳時間: 2013-08-02

    上傳用戶:sardinescn

  • 干涉型光纖水聽器信號解調(diào)方法研究

    光纖水聽器自問世以來,在巨大的軍事價值和民用價值推動下得到了迅速發(fā)展,已逐漸從實驗室研究階段走向工程應(yīng)用。同時隨著光纖水聽器的不斷發(fā)展,對水聲信號的檢測技術(shù)以及數(shù)字處理能力也提出了新的要求。論文在此背景下開展了一系列研究工作,并提出了利用FPGA(Field ProgrammableGate Array,現(xiàn)場可編程門陣列)實現(xiàn)光纖3×3耦合器解調(diào)算法的新思路。 目前干涉型光纖水聽器的解調(diào)一般采用PGC(Phase Generated Carrier,相位生成載波技術(shù))技術(shù)和基于3×3光纖耦合器干涉的解調(diào)技術(shù)。PGC技術(shù)在解調(diào)過程中引入了載波信號,它對采樣率,激光器等的要求都較高,因此我們把目光投向3×3耦合器解調(diào)技術(shù),文中對其解調(diào)原理進行了闡述,對采樣率的確定進行了討論,并對3×3耦合器三路輸出不對稱的情況進行了分析,最后在本文的結(jié)論部分提出了基于3×3耦合器解調(diào)的改良方案。 目前,光纖信號數(shù)字化解調(diào)的硬件實現(xiàn)采用DSP(Digital Signal Process,可編程數(shù)字信號處理器)信號處理機,與之相比,F(xiàn)PGA解調(diào)具有速度快、資源占用少、易于擴展等優(yōu)勢。本文對FPGA與DSP、ASIC(application-specificintegrated circuit,專用集成電路)實現(xiàn)方案進行了對比,分析了適合利用FPGA實現(xiàn)的算法所應(yīng)具備的特征;介紹了3×3耦合器解調(diào)算法中各個模塊的設(shè)計情況;分析了系統(tǒng)的工作情況,硬件的構(gòu)造及芯片的選擇,最后驗證了利用FPGA可以實現(xiàn)3×3耦合器解調(diào)算法。

    標簽: 干涉型 光纖水聽器 信號解調(diào) 方法研究

    上傳時間: 2013-07-03

    上傳用戶:love1314

  • 基于FPGA的高分辨率圖像采集卡

    隨著計算機科學和視頻技術(shù)的廣泛發(fā)展,數(shù)字圖像采集在電子通信與信息處理領(lǐng)域得到了廣泛的應(yīng)用,例如廣播電視的數(shù)字化、網(wǎng)絡(luò)視頻、監(jiān)視監(jiān)控系統(tǒng)等. 視頻圖像采集卡作為計算機視頻應(yīng)用的前端設(shè)備,承擔著模擬視頻信號向數(shù)字視頻信號轉(zhuǎn)換的任務(wù),在多媒體時代占據(jù)著重要的位置.設(shè)計一種功能靈活,使用方便,便于嵌入到系統(tǒng)中的視頻信號采集電路具有重要的實用意義. 本文首先介紹數(shù)字圖像采集系統(tǒng)的發(fā)展現(xiàn)狀和前景,提出了本次設(shè)計的目標: 完成基于PCI總線的高分辨率圖像采集卡設(shè)計.然后簡單介紹了本次設(shè)計用到的基本理論:數(shù)據(jù)采集理論,特別說明了采樣和量化的定義與區(qū)別,以及量化的幾種方式和量化與AD技術(shù)之間的關(guān)系. 圖像采集系統(tǒng)的基本構(gòu)成,是以數(shù)字信號處理器為核心,控制外圍的A/D、D/A轉(zhuǎn)換器和外圍存儲器.本文對比了當下流行的DSP芯片和IFPGA芯片作為數(shù)字處理核心的優(yōu)缺點,并根據(jù)系統(tǒng)實際需要,選用FPGA作為數(shù)字信號處理器.然后列舉了幾款常用A/D視頻芯片,還介紹了SDRAM控制的基本流程,最后提出了系統(tǒng)的整體設(shè)計方案. 圖像采集卡的硬件設(shè)計分為A/D前端模擬通道設(shè)計和FPGA數(shù)字信號傳輸及外圍電路設(shè)計.本文重點介紹了A/D芯片外圍電路連接和使用方法,對PCI總線和它的控制電路也做了詳細闡述.對圖像采集卡的PCB布局布線也有詳細說明. 圖像采集卡FPGA內(nèi)部程序構(gòu)成也是本文的一個重點.本次的程序設(shè)計主要分為數(shù)據(jù)采集模塊,即與A/D接口模塊,數(shù)據(jù)暫存模塊,即SDRAM讀寫控制模塊,數(shù)據(jù)處理模塊和數(shù)據(jù)傳輸模塊,即PCI控制模塊.重點在于對的SDRAM的連續(xù)讀寫控制和各個模塊間的協(xié)調(diào)工作.說明了.A/D采集數(shù)據(jù)從接收到存儲詳細過程,以及對SDRAM讀寫狀態(tài)機和PCI總線的操控. 最后介紹了硬件調(diào)試和FPGA程序驗證結(jié)果.詳細說明了以Modelsim為平臺的前端功能仿真和后端時序仿真,以及以SignalTapⅡ為平臺,程序下載到FPGA中進行的實時驗證.結(jié)果表明整個圖像采集系統(tǒng)基本達到了系統(tǒng)設(shè)計中所給出的性能指標,證明了整個系統(tǒng)設(shè)計的正確性和合理性.

    標簽: FPGA 高分辨率 圖像采集卡

    上傳時間: 2013-04-24

    上傳用戶:amandacool

  • 基于FPGA的靜止圖像編碼器

    遙感圖像在人類生活和軍事領(lǐng)域的應(yīng)用日益廣泛,適合各種要求的遙感圖像編碼技術(shù)具有重要的現(xiàn)實意義。基于小波變換的內(nèi)嵌編碼技術(shù)已成為當前靜止圖像編碼領(lǐng)域的主流,其中就包括基于分層樹集合分割排序(Set Partitioning inHierarchical Trees,SPIHT)的內(nèi)嵌編碼算法。這種算法具有碼流可隨機獲取以及良好的恢復圖像質(zhì)量等特性,因此成為實際應(yīng)用中首選算法。隨著對圖像編碼技術(shù)需求的不斷增長,尤其是在軍事應(yīng)用領(lǐng)域如衛(wèi)星偵察等方面,這種編碼算法亟待轉(zhuǎn)換為可應(yīng)用的硬件編碼器。 在靜止圖像編碼領(lǐng)域,高性能的圖像編碼器設(shè)計一直是相關(guān)研究人員不懈追求的目標。本文針對靜止圖像編碼器的設(shè)計作了深入研究,并致力于高性能的圖像編碼算法實現(xiàn)結(jié)構(gòu)的研究,提出了具有創(chuàng)新性的降低計算量、存儲量,提高壓縮性能的算法實現(xiàn)結(jié)構(gòu),并成功應(yīng)用于圖像編碼硬件系統(tǒng)中。這個方案還支持壓縮比在線可調(diào),即在不改變硬件框架的條件下可按用戶要求實現(xiàn)16倍到2倍的壓縮,以適應(yīng)不同的應(yīng)用需求。本文所做的工作包括了兩個部分。 1.一種基于行的實時提升小波變換實現(xiàn)結(jié)構(gòu):該結(jié)構(gòu)同時處理行變換和列變換,并且在圖像邊界采用對稱擴展輸出邊界數(shù)據(jù),使得圖像小波變換時間與傳統(tǒng)的小波變換相比提高了將近2.6倍,提高了硬件系統(tǒng)的實時性。該結(jié)構(gòu)還合理地利用和調(diào)度內(nèi)部緩沖器,不需要外部緩沖器,大大降低了硬件系統(tǒng)對存儲器的要求。 2.一種采用左遍歷的比特平面并行SPIHT編碼結(jié)構(gòu):在該編碼結(jié)構(gòu)中,空間定位生成樹采用深度優(yōu)先遍歷方式,比特平面同時處理極大地提高了編碼速度。

    標簽: FPGA 圖像 編碼器

    上傳時間: 2013-06-17

    上傳用戶:abc123456.

  • 基于FPGA的視頻編碼器的設(shè)計

    未來的時代是信息時代,信息需要通過媒體來進行記錄、傳播和獲取。視頻數(shù)據(jù)的壓縮技術(shù)和解壓縮技術(shù)成了多媒體技術(shù)中的關(guān)鍵技術(shù)之一,本論文設(shè)計的芯片正是基于FPGA實現(xiàn)視頻編碼器的設(shè)計,主要面向于對音頻和視頻信號進行壓縮和解壓縮的廣泛場合。 本論文首先對FPGA技術(shù)做了介紹,主要從FPGA的結(jié)構(gòu)和特點,闡述了FPGA設(shè)計的輸入、綜合、仿真、實現(xiàn)等,其次介紹了當今主流的視頻編碼標準,如H.263、H.264。本論文基于FPGA來實現(xiàn)視頻編碼,提出了視頻編解碼器系統(tǒng)設(shè)計方案,包括系統(tǒng)設(shè)計和模塊設(shè)計,最后,文章又提出了圖像預處理部分和運動估計部分的設(shè)計思想和實現(xiàn)步驟,其中的運動估計設(shè)計部分是整個論文的關(guān)鍵,以及通過仿真得到理想的結(jié)果。

    標簽: FPGA 視頻編碼器

    上傳時間: 2013-06-28

    上傳用戶:aa17807091

  • 基于FPGA和PCI接口圖像采集壓縮卡

    隨著數(shù)字圖像處理的應(yīng)用領(lǐng)域不斷擴大,實時處理技術(shù)成為研究的熱點。VLSI技術(shù)的迅猛發(fā)展為數(shù)字圖像實時處理技術(shù)提供了硬件基礎(chǔ)。其中FPGA(現(xiàn)場可編程門陣列)的特點使其在圖像采集和處理方面的應(yīng)用顯得更加經(jīng)濟、靈活、方便。 本文設(shè)計了一種以FPGA為工作核心,并實現(xiàn)了PCI接口的圖像采集壓縮系統(tǒng)。整個系統(tǒng)采用了自頂向下的設(shè)計方案,先把系統(tǒng)分成了三大塊,即圖像采集、PCI接口和圖像壓縮,然后分別設(shè)計各個大模塊中的子模塊。 首先,利用FPGA對專用視頻轉(zhuǎn)換器SAA7111A進行控制,因為SAA7111A是采用IC總線模塊,從而完成了對SAA7111A的控制,并通過設(shè)計圖像采集模塊、讀/寫數(shù)據(jù)模塊、總線管理模塊等,實現(xiàn)把標準的模擬視頻信號轉(zhuǎn)換成數(shù)字視頻信號并采集的功能。 其次,在了解PCI規(guī)范的前提下,深入地分析了PCI時序和地址配置空間等,設(shè)計了簡化邏輯的狀態(tài)機,并用VHDL硬件描述語言設(shè)計了程序,完成了簡化邏輯的PCI接口設(shè)計在FPGA芯片內(nèi)部的實現(xiàn),達到了一33MHz、32位數(shù)據(jù)寬度、支持猝發(fā)傳輸?shù)腜CI從設(shè)備模塊的接口功能,與傳統(tǒng)的使用PCI專用接口芯片來實現(xiàn)的PCI接口比較來看,更加節(jié)約了系統(tǒng)的邏輯資源,降低了成本,增加了設(shè)計的靈活性。 再次,設(shè)計了WINDOWS下對PCI接口的驅(qū)動程序。驅(qū)動程序可以選擇不同的方法來完成,當然每個方法都有自己的特點,對幾種主要設(shè)計驅(qū)動程序的方法作以比較之后,本文選擇了使用DRIVER WORKS工具來完成。通過對配置空間的設(shè)計、系統(tǒng)端口和內(nèi)存映射的設(shè)計、中斷服務(wù)的設(shè)計等,用VC++語言編寫了驅(qū)動程序。 最后,考慮到增加系統(tǒng)的實用性和完備性,還填加設(shè)計了圖像的壓縮部分。這部分需要完成的工作是在上述系統(tǒng)完成后,再額外地把采集來的視頻數(shù)據(jù)通過另一路數(shù)據(jù)通道按照一定的格式壓縮后存儲到硬盤中。本系統(tǒng)中,這部分設(shè)計是利用Altera公司提供的IP核來完成壓縮的,同時還用VHDL語言在FPGA上設(shè)計了IDE硬盤接口,使壓縮后的數(shù)據(jù)存儲到硬盤中。

    標簽: FPGA PCI 接口 圖像采集

    上傳時間: 2013-06-01

    上傳用戶:程嬰sky

  • 24位AD轉(zhuǎn)換器LTC2400及其應(yīng)用

    LTC2400是凌特公司生產(chǎn)的一種微功耗、高精度24位A/D轉(zhuǎn)換器,該芯片內(nèi)部集成有振蕩器,工作電壓 2.7-5.5V,積分線性誤差為4ppm,RMS噪聲為0.3ppm,供電電流僅為200A,

    標簽: 2400 LTC 24位 AD轉(zhuǎn)換器

    上傳時間: 2013-07-07

    上傳用戶:dgann

  • DSP2407寄存器查詢器

    DSP2407寄存器查詢器軟件,方便查詢寄存器功能

    標簽: 2407 DSP 寄存器 查詢

    上傳時間: 2013-04-24

    上傳用戶:zuozuo1215

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