JPEG_D IP Core Verilog crypted source
標簽： Verilog crypted JPEG_D source
上傳時間： 2017-04-12
上傳用戶：evil
我用過的verilog hdl寫的SDRAM core源程序,經(jīng)過測試應用
標簽： verilog SDRAM core hdl
上傳時間： 2015-03-31
上傳用戶：15071087253
用verilog寫的很好的cpu core
標簽： verilog core cpu
上傳時間： 2015-04-17
上傳用戶：海陸空653
arm verilog hdl ip core
標簽： verilog core arm hdl
上傳時間： 2014-01-14
上傳用戶：wang0123456789
verilog VSIP core,用verilog語言編寫，希望對各位朋友有所幫助！
標簽： verilog VSIP core 語言
上傳時間： 2014-12-06
上傳用戶：894898248
Ethernet(以太網(wǎng))verilog ip core用verilogHDL語言寫的以太網(wǎng)軟核，對學習verilog語言和以太網(wǎng)有很大幫助。
標簽： verilogHDL Ethernet verilog core
上傳時間： 2016-04-25
上傳用戶：sclyutian
Verilog語言描述的Intel8255 IP Core，本人已經(jīng)在某項目中經(jīng)過了物理驗證的，可直接用于FPGA綜合或ASIC綜合。
標簽： Verilog Intel 8255 Core
上傳時間： 2013-12-18
上傳用戶：gonuiln
verilog RISC8 cpu CORE 8位RISC CPU 內(nèi)核源碼（VERILOG 版）
標簽： verilog VERILOG RISC8 CORE
上傳時間： 2017-02-18
上傳用戶：363186
I2C core 及testbench（verilog）
標簽： testbench verilog core I2C
上傳時間： 2017-03-14
上傳用戶：zhouli
Verilog 8051 IP Core for Cyclone II
標簽： Verilog Cyclone 8051 Core
上傳時間： 2017-04-28
上傳用戶：zaizaibang
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