利用XC9572-TQFP100(Xilinx CPLD)制作的多功能CPLD/FPGA的ISP下載線源代碼及線路圖。可用來燒錄Xilinx,Lattice,Altera等廠家的CPLD/FPGA.
標簽： CPLD Xilinx FPGA Lattice
上傳時間： 2017-07-16
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EDA技術與CPLD FPGA編程實驗指導書
標簽： eda cpld fpga
上傳時間： 2022-07-08
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本書詳細介紹了CPLD/FPGA常用模塊與綜合應用系統(tǒng)設計的方法與技巧。全書共分為3篇22章，第1篇為基礎知識篇，簡要介紹了CPLD/FPGA硬件結構知識、VHDL硬件編程語言、Verilog與SystemC編程、常用開發(fā)工具；第2篇為常用模塊設計實例篇，通過14個模塊設計實例，詳細介紹了CPLD/FPGA的各種開發(fā)技術和使用技巧，這些模塊實例幾乎涵蓋了所有的CPLD/FPGA開發(fā)技術；第3篇為綜合系統(tǒng)設計實例篇，通過4個綜合系統(tǒng)實例，對前面的CPLD/FPGA常用模塊進行了綜合應用設計。
標簽： CPLD 65.7 FPGA 452
上傳時間： 2013-06-02
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本文介紹了一個基于CPLD／FPGA的嵌入式IP核設計。論文在闡述可編程邏輯器件及其發(fā)展趨勢的基礎上，探討了知識產權復用理念，MCU的復雜化設計以及數字信號傳輸與處理的速度要求。結合國內外對CPLD／FPGA的使用現狀，引出了在CPLD／FPGA上開發(fā)嵌入式模塊程序的理念并提出了設計實現方法和設計實例。課題的設計目標為開發(fā)一個基于CPLD／FPGA的USBIP模塊，實現開發(fā)板與PC機之間的USB通信。設計過程首先進行硬件設計，在FPGA開發(fā)板上開發(fā)擴展板；其次用ISE開發(fā)軟件進行FPGA數字化設計；在軟件開發(fā)完成后，將配置生成的比特流文件通過JTAG電纜下載到FPGA開發(fā)板上，實現FPGA開發(fā)板與PC機之間的通信。 該設計具有很高的實用性，它進一步擴大了可編程芯片的領地，將復雜專有芯片擠向高端和超復雜應用；它使得IP資源復用理念得到更普遍的應用；為基于FPGA的嵌入式系統(tǒng)設計提供了廣闊的思路。
標簽： CPLD FPGA IP核
上傳時間： 2013-07-05
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this a book about cpld fpga developmen,it is very useful for eda development
標簽： FPGA 教程
上傳時間： 2013-08-30
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該文檔為FPGA_ASIC-基于CPLD、FPGA的半整數分頻器的設計講解文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………
標簽： fpga cpld
上傳時間： 2022-02-26
通信與信息技術行業(yè)飛速發(fā)展，已成為我國支柱產業(yè)之一。隨著該行業(yè)的迅速發(fā)展，社會對具備實際動手能力人才的需求也不斷增加，高校通信教學改革勢在必行。在最初的通信原理實驗設備中每個實驗獨立占用一塊硬件資源，隨著EDA技術的發(fā)展，實驗設備廠商將CPLD/FPGA技術作為獨立的一項實驗內容，加入到通信原理實驗設備中。FPGA技術具備集成度高、速度快和現場可編程的優(yōu)勢，適合高集成度和高速的時序運算。本文總結現有通信原理實驗設備的優(yōu)缺點，采用FPGA技術設計出集驗證性和設計性于一體，具備較高的綜合性和系統(tǒng)性的通信原理實驗系統(tǒng)。 本系統(tǒng)提供了一個開放性的硬件、軟件平臺，從培養(yǎng)學生實際動手能力出發(fā)，利用FPGA在通用的硬件上實現所有實驗內容。學生在本系統(tǒng)上除了能完成已固化的實驗內容，還可以實現電子設計開發(fā)和驗證。這對培養(yǎng)學生的實踐能力大有裨益。 本文結合數字通信系統(tǒng)基本模型，把基于FPGA的通信原理實驗系統(tǒng)劃分為信號源模塊、發(fā)送端模塊、信道仿真模塊、接收端模塊和同步模塊幾部分。其中，模擬信號源采用DDS技術，能夠生成非常高的頻率精度，可作為任意波形發(fā)生器。發(fā)送端和接收端模塊結合到一起組成多體制調制解調器，形成多頻段、多波形的軟件無線電系統(tǒng)。載波同步采用全數字COSTAS環(huán)提取技術，具備良好的載波跟蹤特性，利用對載波相位不敏感 的Gardner算法跟蹤位同步信號。 本文首先介紹了通信原理實驗系統(tǒng)的研究現狀和意義；然后根據通信系統(tǒng)模型從《通信原理》各個章節(jié)中提煉出各模塊的實驗內容，分別列出各實驗的數字化實現模型；繼而根據各模塊資源需求選取合適FPGA芯片，并給出硬件設計方案；最后，給出各模塊在FPGA上具體實現過程、系統(tǒng)測試結果及分析。測試和實際運行結果表明設計方法正確，且功能和技術指標滿足設計要求。 關鍵詞：通信原理，實驗系統(tǒng)，FPGA，DDS，多體制調制解調，全數字COSTAS環(huán)，位同步
標簽： FPGA 通信原理 實驗系統(tǒng)
上傳時間： 2013-07-07
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音頻管理組件(Audio Management Unit，AMU)是先進客艙娛樂與服務系統(tǒng)(Advanced Cabin Entertainment Service System，ACESS)的組成部分，應用于飛機上音頻資源的管理與控制。飛機運營對航空機載電子系統(tǒng)準確性、復雜性和安全性的高要求，使得其維修維護工作極大地依賴于自動測試設備(Automatic Testing Equipment，ATE)。本課題來源于實際工程項目， FPGA技術具備多種優(yōu)點，將其與民航測試設備結合研制一個用于檢測AMU故障的自動測試系統(tǒng)，該系統(tǒng)將對AMU自動完成部件維修手冊(Comvonent Maintenance Manual，CMM)所規(guī)定的全部功能、性能方面的綜合測試。 本文首先概述音頻管理組件、自動測試系統(tǒng)及其在民航領域的應用，并闡述了課題的背景、研究目標和相關技術要求；文章對可編程邏輯器件CPLD/FPGA的結構原理、硬件描述語言VHDL的特點以及MAXL+plusⅡ軟件的設計流程進行了說明，重點闡述了基于FPGA的DDS信號發(fā)生器以及數據采集卡的設計實現、并著重闡述了ARINC429總線的傳輸規(guī)范，和基于FPGA的ARINC429總線接口的設計與實現。在ARINC429接口設計中采用自頂向下，多層次系統(tǒng)設計的方法，用VHDL語言進行描述。在發(fā)送器中利用了FPGA內部的分布式RAM創(chuàng)建異步FIFO，節(jié)約了FPGA的內部資源和提高了數據傳輸速度；在接收器中采用了提高抗干擾性的優(yōu)化設計。測試結果表明基于FPGA的設計實現ARINC429總線數據通信的要求，使用方便，可靠性好，能夠克服HS-3282芯片中的數據格式固定，使用不夠靈活方便，價格昂貴的缺點。
標簽： FPGA 飛機 音頻 測試系統(tǒng)
上傳時間： 2013-08-06
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隨著半導體技術與數字集成電路(微處理器、存貯器以及標準邏輯門電路等)技術的迅速發(fā)展，特別是隨著計算機技術的發(fā)展，在工業(yè)生產和科學技術研究的各行各業(yè)中，人們利用PC機的強大處理功能代替?zhèn)鹘y(tǒng)儀器的某些部件，開發(fā)出各種測量儀器(虛擬儀器)，傳統(tǒng)儀器的數字邏輯部分多是采用分立集成電路(IC)組成，分立IC愈多，給系統(tǒng)的電路設計、調試及維護帶來諸多不便。而隨著EDA技術的飛速發(fā)展，大規(guī)模可編程邏輯芯片CPLD / FPGA應運而生。這類芯片可以替代幾十甚至上百塊通用IC芯片，而且，因其可用硬件描述語言進行芯片設計、支持在線編程和在系統(tǒng)編程等優(yōu)點而備受青睞。本課題主要是用FPGA實現一個驗證平臺。用于SOC及IPCore的驗證。用FPGA系統(tǒng)驗證板實現在實際硬件環(huán)境中的驗證可以彌補ASIC 設計流程中仿真的不足, 通過該驗證也可以加快ASIC設計且降低由于邏輯問題所造成ASIC 開發(fā)中的成本損耗。本文首先介紹了EDA技術的發(fā)展，然后介紹了FPGA，SOC,和IPCore的一些基本概念，分析了FPGA在現代集成電路設計領域的一些應用。最后，具體設計了一塊用設計驗證的開發(fā)板，并討論了其設計結構，流程及驗證方法。
標簽： IPCore FPGA SOC
上傳時間： 2013-05-16
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了解從SPLD到CPLD/FPGA的發(fā)展過程，跟深入認識流行數字芯片的原理和發(fā)展趨勢
標簽： 電子系統(tǒng)設計
上傳時間： 2013-10-16
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