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cyclone III

  • ETL-002 Altera cyclone III系列FPGA開(kāi)發(fā)板簡(jiǎn)介

    ETL-002 FPGA開(kāi)發(fā)板是以Altera公司的最新系列cyclone III中的3C10為主芯片，并提供了極為豐富的芯片外圍接口資源以及下載線，數(shù)據(jù)線以及資料光盤等。除了這些硬件外，我們還提供了十多個(gè)接口實(shí)驗(yàn)，并公開(kāi)了電路原理圖和實(shí)驗(yàn)的Verilog源代碼，以便于大家對(duì)照學(xué)習(xí)，并可以在該開(kāi)發(fā)板上進(jìn)行二次開(kāi)發(fā)。

    標(biāo)簽： Cyclone Altera FPGA ETL

    上傳時(shí)間： 2013-10-29

    上傳用戶：1477849018@qq.com

  • ETL-002 Altera cyclone III系列FPGA開(kāi)發(fā)板簡(jiǎn)介

    ETL-002 FPGA開(kāi)發(fā)板是以Altera公司的最新系列cyclone III中的3C10為主芯片，并提供了極為豐富的芯片外圍接口資源以及下載線，數(shù)據(jù)線以及資料光盤等。除了這些硬件外，我們還提供了十多個(gè)接口實(shí)驗(yàn)，并公開(kāi)了電路原理圖和實(shí)驗(yàn)的Verilog源代碼，以便于大家對(duì)照學(xué)習(xí)，并可以在該開(kāi)發(fā)板上進(jìn)行二次開(kāi)發(fā)。

    標(biāo)簽： Cyclone Altera FPGA ETL

    上傳時(shí)間： 2013-11-21

    上傳用戶：elinuxzj

  • Altera cyclone III 器件數(shù)據(jù)手冊(cè)

    Altera cyclone III 器件數(shù)據(jù)手冊(cè)

    標(biāo)簽： Cyclone Altera III 器件

    上傳時(shí)間： 2016-02-07

    上傳用戶：pkkkkp

  • cyclone III EP3C25 開(kāi)發(fā)板原理圖,包括flash, sdram, usb, ethernet 等接口電路

    cyclone III EP3C25 開(kāi)發(fā)板原理圖,包括flash, sdram, usb, ethernet 等接口電路，可作設(shè)計(jì)參考。

    標(biāo)簽： ethernet cyclone flash sdram

    上傳時(shí)間： 2016-11-26

    上傳用戶：bruce5996

  • ALtera FPGA cyclone III開(kāi)發(fā)電路圖

    ALtera FPGA cyclone III開(kāi)發(fā)電路圖，對(duì)初學(xué)者設(shè)計(jì)此類FPGA有重要參考價(jià)值

    標(biāo)簽： Cyclone ALtera FPGA III

    上傳時(shí)間： 2014-01-13

    上傳用戶：稀世之寶039

  • cyclone III -DDR2-USB3.0(CYUSB3014) 開(kāi)發(fā)板硬件原理圖+PCB文件

    Altera_cyclone III -DDR2-USB3.0(CYUSB3014) 開(kāi)發(fā)板cadence orcad硬件原理圖+PCB文件

    標(biāo)簽： cyclone pcb usb

    上傳時(shí)間： 2022-05-14

    上傳用戶：

  • AN522: Implementing Bus LVDS

    This application note describes how to implement the Bus LVDS (BLVDS) interface in the supported Altera ® device families for high-performance multipoint applications. This application note also shows the performance analysis of a multipoint application with the cyclone III BLVDS example.

    標(biāo)簽： Implementing LVDS 522 Bus

    上傳時(shí)間： 2013-11-10

    上傳用戶：frank1234

  • 基于CycloneIII構(gòu)成的RS編碼系統(tǒng)

    本文采用Altera公司的FPGA器件cyclone III系列EP3C10作為核心器件構(gòu)成了R-S（255，223）編碼系統(tǒng)；利用Quartus II 9.0作為硬件仿真平臺(tái)，用硬件描述語(yǔ)言Verilog_HDL實(shí)現(xiàn)編程，并且通過(guò)JTAG接口與EP3C10連接。R-S（Reed-Solomon）碼是一類糾錯(cuò)能力很強(qiáng)的特殊的非二進(jìn)制BCH碼，能應(yīng)對(duì)隨機(jī)性和突發(fā)性錯(cuò)誤，廣泛應(yīng)用于各種通信系統(tǒng)中和保密系統(tǒng)中。R-S（255，223）碼能夠檢測(cè)32字節(jié)長(zhǎng)度和糾錯(cuò)16字節(jié)長(zhǎng)度的連續(xù)數(shù)據(jù)錯(cuò)誤信息。

    標(biāo)簽： CycloneIII RS編碼

    上傳時(shí)間： 2013-11-07

    上傳用戶：exxxds

  • 基于FPGA 的低成本長(zhǎng)距離高速傳輸系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)

    為解決目前高速信號(hào)處理中的數(shù)據(jù)傳輸速度瓶頸以及傳輸距離的問(wèn)題，設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA 的高速數(shù)據(jù)傳輸系統(tǒng)，本系統(tǒng)借助Altera cyclone III FPGA 的LVDS I/O 通道產(chǎn)生LVDS 信號(hào)，穩(wěn)定地完成了數(shù)據(jù)的高速、遠(yuǎn)距離傳輸。系統(tǒng)所需的8B/10B 編解碼、數(shù)據(jù)時(shí)鐘恢復(fù)(CDR)、串/并行轉(zhuǎn)換電路、誤碼率計(jì)算模塊均在FPGA 內(nèi)利用VHDL 語(yǔ)言設(shè)計(jì)實(shí)現(xiàn)，大大降低了系統(tǒng)互聯(lián)的復(fù)雜度和成本，提高了系統(tǒng)集成度和穩(wěn)定性。

    標(biāo)簽： FPGA 高速傳輸

    上傳時(shí)間： 2013-10-30

    上傳用戶：zhishenglu

  • AN522: Implementing Bus LVDS

    This application note describes how to implement the Bus LVDS (BLVDS) interface in the supported Altera ® device families for high-performance multipoint applications. This application note also shows the performance analysis of a multipoint application with the cyclone III BLVDS example.

    標(biāo)簽： Implementing LVDS 522 Bus

    上傳時(shí)間： 2013-10-26

    上傳用戶：蘇蘇蘇蘇

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