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dspBuilder

  • 這是一個信號發(fā)生器

    這是一個信號發(fā)生器，相信對經(jīng)常從事測試信號處理的人士來說應(yīng)該不陌生，該信號發(fā)生器采用先進(jìn)的dspBuilder進(jìn)行建模，既簡潔又實用。

    標(biāo)簽： 信號發(fā)生器

    上傳時間： 2014-08-31

    上傳用戶：gxf2016

  • 在信息信號處理過程中

    在信息信號處理過程中，如對信號的過濾、檢測、預(yù)測等，都要使用濾波器，數(shù)字濾波器是數(shù)字信號處理（DSP，DigitalSignalProcessing）中使用最廣泛的一種器件。常用的濾波器有無限長單位脈沖響應(yīng)（ⅡR）濾波器和有限長單位脈沖響應(yīng)（FIR）濾波器兩種[1]，其中，F(xiàn)IR濾波器能提供理想的線性相位響應(yīng)，在整個頻帶上獲得常數(shù)群時延從而得到零失真輸出信號，同時它可以采用十分簡單的算法實現(xiàn)，這兩個優(yōu)點使FIR濾波器成為明智的設(shè)計工程師的首選，在采用VHDL或verilogHDL等硬件描述語言設(shè)計數(shù)字濾波器時，由于程序的編寫往往不能達(dá)到良好優(yōu)化而使濾波器性能表現(xiàn)一般。而采用調(diào)試好的IPCore需要向Altera公司購買。筆者采用了一種基于dspBuilder的FPGA設(shè)計方法，使FIR濾波器設(shè)計較為簡單易行，并能滿足設(shè)計要求

    標(biāo)簽： 信號處理 過程

    上傳時間： 2016-04-15

    上傳用戶：gut1234567

  • 借助于altera公司的IP核

    借助于altera公司的IP核，在FPGA中使用dspBuilder實現(xiàn)32位低通FIR濾波器功能，

    標(biāo)簽： altera IP核

    上傳時間： 2017-02-12

    上傳用戶：xiaodu1124

  • matlab下

    matlab下，用dspBuilder實現(xiàn)dds模塊產(chǎn)生正弦波的源碼

    標(biāo)簽： matlab

    上傳時間： 2017-07-17

    上傳用戶：李夢晗

  • 基于FPGA的DDS函數(shù)發(fā)生器的設(shè)計與實現(xiàn)

    摘要：論述了利用FPGA的系統(tǒng)級設(shè)計工具DSP Builder開發(fā)DDS函數(shù)發(fā)生器的總體設(shè)計思路，討論了改變輸出信號頻率、幅度、相位的設(shè)計方法。系統(tǒng)基于Ahera公司的Cyclone系列FPGA，配合Silicon Labs公司高性能C8051F340單片機實現(xiàn)，給出了系統(tǒng)的軟件仿真結(jié)果并完成了整個系統(tǒng)的硬件驗證。結(jié)果證明了設(shè)計的正確性，同時表明采用dspBuilder使DDS任意函數(shù)發(fā)生器的FPGA硬件實現(xiàn)更加簡單，速度更快。

    標(biāo)簽： fpga dds 函數(shù)發(fā)生器

    上傳時間： 2022-07-11

    上傳用戶：

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