為了實現(xiàn)網(wǎng)側(cè)風電變流器的控制目標，提出了一種基于DSP的網(wǎng)側(cè)風力發(fā)電變流器控制板的設(shè)計方案，并完成系統(tǒng)的軟硬件設(shè)計。該控制板的硬件部分主要是基于主控芯片TMS320LF2407A，軟件部分采用C語言進行編程，能夠完成模擬信號的采樣、處理、輸出。實際試驗表明，該控制板具有控制準確，反應(yīng)迅速的特點，達到設(shè)計要求。
上傳時間： 2013-11-06
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通過上位機（PC機）來對電流、轉(zhuǎn)速進行數(shù)值設(shè)置，DSP作為下位機來接受參數(shù)并且實時進行檢測，根據(jù)模糊PID控制算法對數(shù)據(jù)進行調(diào)整和處理，達到實時的處理效果，并且上位機采用VC++進行編程，友好的人機界面，操作方便簡單。整個控制系統(tǒng)性能高，而且易于控制算法的實現(xiàn)。
標簽： DSP 無刷直流電動機 控制系統(tǒng)
上傳時間： 2014-12-24
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描述了三相電壓源型PWM整流器的工作原理，基于整流器網(wǎng)側(cè)電流矢量推導(dǎo)出同步旋轉(zhuǎn)坐標系下系統(tǒng)的數(shù)學(xué)模型，給出了一種電流前饋解耦控制算法。同時詳細介紹了基于電流前饋解耦的PWM整流器雙環(huán)控制系統(tǒng)設(shè)計方法。并且應(yīng)用TMS320LF2407A建立了PWM整流器的DSP數(shù)字化實驗系統(tǒng)。實驗結(jié)果表明，該整流器能獲得單位功率因數(shù)的正弦輸入電流、穩(wěn)定的直流輸出電壓和快速的動態(tài)響應(yīng)。
上傳時間： 2013-10-11
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DSP的使用正呈爆炸式發(fā)展。OFDM、GPS相關(guān)器、FFT、FIR濾波器或H.264之類計算密集型算法在從移動電話到汽車的各種應(yīng)用中都很常見。設(shè)計人員實現(xiàn)DSP有三種選擇：他們可以使用DSP處理器、FPGA或掩膜ASIC。ASIC具有最高的吞吐量、最低的功耗和最低的成本，但其極大的NRE和較長研制周期使其對許多設(shè)計而言并不適用。定制ASIC的研制周期可達一年之久，比最終產(chǎn)品的使用壽命都長。FPGA已占居較大的市場份額，因為其能提供比DSP處理器更好的吞吐量，而且沒有ASIC的極大NRE和較長研制周期。 因此，常常將基于ARM的MCU和FPGA結(jié)合使用來實現(xiàn)這些設(shè)計，其中FPGA實現(xiàn)設(shè)計的DSP部分。然而，F(xiàn)PGA也有其自身的不足--最突出的是功耗很高(靜態(tài)功耗接近2W)，且性能比ASIC慢。FPGA時鐘用于邏輯執(zhí)行時通常限制為50MHz，而ASIC可以400MHz或更高頻率執(zhí)行邏輯。其他缺點還包括在IP載入基于SRAM的FPGA時安全性還不夠理想，成本也較高。盡管FPGA成本已迅速降低，但價格通常在10,000片左右就不再下降，因此仍比較昂貴。 新型可定制Atmel處理器（CAP）MCU具有的門密度、單元成本、性能和功耗接近基于單元的ASIC，而NRE較低且開發(fā)時間較快。與基于ARM的非可定制標準產(chǎn)品MCU一樣，不需要單獨的ARM許可。 可定制MCU利用新型金屬可編程單元結(jié)構(gòu)（MPCF）ASIC技術(shù)，其門密度介于170K門/mm2與210K門/mm2之間，與基于單元的ASIC相當。例如，實現(xiàn)D觸發(fā)器（DFF）的MPCF單元與標準的單元DFF都使用130nm的工藝，所用面積差不多相同。
上傳時間： 2013-10-29
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在開放式數(shù)控系統(tǒng)結(jié)構(gòu)模型的基礎(chǔ)上，研究了基于ISA總線的DSP通信控制原理。采用中斷方式完成了PC機和DSP之間的通信。介紹了以DriverWorks為工具開發(fā)ISA設(shè)備WDM驅(qū)動程序的方法，探討了中斷處理、驅(qū)動程序與應(yīng)用程序之間的通信,簡要說明了驅(qū)動程序的安裝與調(diào)試。通過調(diào)試,系統(tǒng)設(shè)計運行穩(wěn)定。 Abstract: The ISA bus and DSP correspondence control principle is investigated in the basis of the existing open architecture numerical control system.The interrupt method is used to realize the communication between PC and DSP based on the ISA bus.The methods of WDM driver exploitation for ISA device using Driver Works are introduced.The main process of driver program and the keys such as handle interrupt and the communication between the drivers and application are presented.And how to debug and install the drive is explained.
上傳時間： 2013-11-04
上傳用戶：kang1923
第一章 序論……………………………………………………………6 1- 1 研究動機…………………………………………………………..7 1- 2 專題目標…………………………………………………………..8 1- 3 工作流程…………………………………………………………..9 1- 4 開發(fā)環(huán)境與設(shè)備…………………………………………………10 第二章 德州儀器OMAP 開發(fā)套件…………………………………10 2- 1 OMAP介紹………………………………………………………10 2-1.1 OMAP是什麼?…….………………………………….…10 2-1.2 DSP的優(yōu)點……………………………………………....11 2- 2 OMAP Architecture介紹………………………………………...12 2-2-1 OMAP1510 硬體架構(gòu)………………………………….…12 2-2.2 OMAP1510軟體架構(gòu)……………………………………...12 2-2.3 DSP / BIOS Bridge簡述…………………………………...13 2- 3 TI Innovator套件 -- OMAP1510 ……………………………..14 2-2.1 General Purpose processor -- ARM925T………………...14 2-2.2 DSP processor -- TMS320C55x …………………………15 2-2.3 IDE Tool – CCS …………………………………………15 2-2.4 Peripheral ………………………………………………..16 第三章 在OMAP1510上建構(gòu)Embedded Linux System…………….17 3- 1 嵌入式工具………………………………………………………17 3-1.1 嵌入式程式開發(fā)與一般程式開發(fā)之不同………….….17 3-1.2 Cross Compiling的GNU工具程式……………………18 3-1.3 建立ARM-Linux Cross-Compiling 工具程式………...19 3-1.4 Serial Communication Program………………………...20 3- 2 Porting kernel………………………………………………….…21 3-2.1 Setup CCS ………………………………………….…..21 3-2.2 編譯及上傳Loader…………………………………..…23 3-2.3 編譯及上傳Kernel…………………………………..…24 3- 3 建構(gòu)Root File System………………………………………..…..26 3-3.1 Flash ROM……………………………………………...26 3-3.2 NFS mounting…………………………………………..27 3-3.3 支援NFS Mounting 的kernel…………………………..27 3-3.4 提供NFS Mounting Service……………………………29 3-3.5 DHCP Server……………………………………………31 3-3.6 Linux root 檔案系統(tǒng)……………………………….…..32 3- 4 啟動及測試Innovator音效裝置…………………………..…….33 3- 5 建構(gòu)支援DSP processor的環(huán)境…………………………...……34 3-5.1 Solution -- DSP Gateway簡介……………………..…34 3-5.2 DSP Gateway運作架構(gòu)…………………………..…..35 3- 6 架設(shè)DSP Gateway………………………………………….…36 3-6.1 重編kernel……………………………………………...36 3-6.2 DEVFS driver…………………………………….……..36 3-6.3 編譯DSP tool和API……………………………..…….37 3-6.4 測試……………………………………………….…….37 第四章 MP3 Player……………………………………………….…..38 4- 1 MP3 介紹………………………………………………….…….38 4- 2 MP3 壓縮原理……………………………………………….….39 4- 3 Linux MP3 player – splay………………………………….…….41 4.3-1 splay介紹…………………………………………….…..41 4.3-2 splay 編譯………………………………………….…….41 4.3-3 splay 的使用說明………………………………….……41 第五章 程式改寫………………………………………………...…...42 5-1 程式評估與改寫………………………………………………...…42 5-1.1 Inter-Processor Communication Scheme…………….....42 5-1.2 ARM part programming……………………………..…42 5-1.3 DSP part programming………………………………....42 5-2 程式碼………………………………………………………..……43 5-3 雙處理器程式開發(fā)注意事項…………………………………...…47 第六章 效能評估與討論……………………………………………48 6-1 速度……………………………………………………………...48 6-2 CPU負載………………………………………………………..49 6-3 討論……………………………………………………………...49 6-3.1分工處理的經(jīng)濟效益………………………………...49 6-3.2音質(zhì)v.s 浮點與定點運算………………………..…..49 6-3.3 DSP Gateway架構(gòu)的限制………………………….…50 6-3.4減少IO溝通……………….………………………….50 6-3.5網(wǎng)路掛載File System的Delay…………………..……51 第七章 結(jié)論心得…
上傳時間： 2013-10-14
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dsPIC30F數(shù)字信號控制器單片機和DSP領(lǐng)域的最佳選擇 什么是數(shù)字信號控制器 數(shù)字信號控制器（DSC）是單片機嵌入式控制器，它輕松集成了單片機（MCU）的控制功能以及數(shù)字信號處理器（DSP）的計算功能和數(shù)據(jù)吞吐能力。
上傳時間： 2013-12-23
上傳用戶：小儒尼尼奧
Virtex-5, Spartan-DSP FPGAs Application Note This application note demonstrates how efficient implementations of Digital Up Converters(DUC) and Digital Down Converters (DDC) can be done by leveraging the Xilinx DSP IPportfolio for increased productivity and reduced time to development. Step-by-step instruction is given on how to perform system-level trade off analysis and develop the most efficient FPGA implementation, thus allowing engineers a flexible, low-cost and low-power alternative to ASSP technologies.
標簽： Spartan-DSP Virtex FPGAs Ap
上傳時間： 2013-10-23
上傳用戶：raron1989
當今集成電路設(shè)計已經(jīng)進入 SOC 時代，于是各公司針對自己的設(shè)計需求挑選一款性價比較高的處理器作為內(nèi)核是一件非常重要的事情。下面將介紹一款集成了DSP 和MCU 功能的處理器ZSP neo 。ZSP neo 是一類新型的處理器，它在一個的內(nèi)核中集成了DSP 和MCU 的功能。對于那些需要比現(xiàn)有8 位微控制器更高的控制處理性能，而又無需32 位微控制器的對成本敏感的應(yīng)用來說，ZSP neo 是一個理想的選擇。ZSP neo 針對其性能要求采用了相應(yīng)的架構(gòu)：·采用基于 RISC 的架構(gòu)：處理器具有靜態(tài)分支預(yù)測功能；所以程序員設(shè)計程序時無需考慮跳轉(zhuǎn)延時。·采用了 Load-Store 架構(gòu)：處理器對存儲器的操作使用 load 和store 指令；操作不直接發(fā)生在存儲器中。所有其他指令均為寄存器-寄存器操作；使用寄存器節(jié)省了存儲器帶寬。采用多種load/store 指令，這樣優(yōu)化了存儲器操作；同時支持32 位和16 位的數(shù)據(jù)操作。處理器允許前推的靈活架構(gòu)；功能單元的結(jié)果能夠在下個周期無條件地被其他功能單元使用。
上傳時間： 2013-10-19
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TI DSP的發(fā)展同集成電路的發(fā)展一樣,新的DSP都是3.3V的,但目前還有許多外圍電路是5V的,因此在DSP系統(tǒng)中,經(jīng)常有5V和3.3V的DSP混接問題。在這些系統(tǒng)中,應(yīng)注意： 1)DSP輸出給5V的電路（如D/A）,無需加任何緩沖電路,可以直接連接。 2)DSP輸入5V的信號（如A/D）,由于輸入信號的電壓>4V,超過了DSP的電源電壓,DSP的外部信號沒有保護電路,需要加緩沖,如74LVC245等,將5V信號變換成3.3V的信號。 3)仿真器的JTAG口的信號也必須為3.3V,否則有可能損壞DSP。
上傳時間： 2013-10-16
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