針對(duì)嵌入式系統(tǒng)的底層網(wǎng)絡(luò)接口給出了一種由fpGA實(shí)現(xiàn)的以太網(wǎng)控制器的設(shè)計(jì)方法．該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式，同時(shí)可提供MII接口，可并通過外接以太網(wǎng)物理層（PHY）芯片來實(shí)現(xiàn)網(wǎng)絡(luò)接入\r\n
標(biāo)簽： fpGA 嵌入式系統(tǒng) 以太網(wǎng)控制器 底層
上傳時(shí)間： 2013-08-18
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基于fpGA的交通燈的設(shè)計(jì) 有Verilog HDL 源碼、仿真圖與引腳配置圖，已下載實(shí)現(xiàn)\r\n
標(biāo)簽： Verilog fpGA HDL 交通燈
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fpGA的經(jīng)典講義，很值得，電賽的培訓(xùn)資料
標(biāo)簽： fpGA 講義
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USB在fpGA上的實(shí)現(xiàn)，包括源碼測(cè)試平臺(tái)，測(cè)試向量，很實(shí)用。
標(biāo)簽： fpGA USB
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有關(guān)fpGA芯片的管腳的封裝的一些資料。
標(biāo)簽： fpGA 芯片 管腳 封裝
上傳用戶：dljwq
多款fpGA CPLD開發(fā)板的原理圖，很好的線路設(shè)計(jì)參考
標(biāo)簽： fpGA CPLD 開發(fā)板 原理圖
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CRC校驗(yàn)碼并行計(jì)算的fpGA實(shí)現(xiàn),PDF打開
標(biāo)簽： fpGA CRC 校驗(yàn)碼
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基于fpGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的Verilog HDL源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等
標(biāo)簽： Verilog fpGA HDL 多功能
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fpGA/CPLD 初級(jí)教程 適合與初學(xué)者
標(biāo)簽： fpGA CPLD 教程 與初學(xué)者
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fpGA設(shè)計(jì)流程，相當(dāng)經(jīng)典，好東西大家分享
標(biāo)簽： fpGA 設(shè)計(jì)流程
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