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fpga應(yīng)用開發(fā)入門與典型實例

FPGA應(yīng)用源代碼實例，有USB、I2C等經(jīng)常用的程序

是FPGA應(yīng)用的好列子，本人經(jīng)過測試的，有USB的I2C的，還有一些經(jīng)常用的程序，是初學(xué)和參考的好幫手

標(biāo)簽： FPGA USB I2C 源代碼

上傳時間： 2013-08-14

上傳用戶：ommshaggar
用fpga設(shè)計uart的案例

用fpga設(shè)計uart的案例,word格式

標(biāo)簽： fpga uart 案例

上傳時間： 2013-08-15

上傳用戶：zhangxin
用Verilog語言編寫的FPGA控制PWM的程序

用Verilog語言編寫的FPGA控制PWM的程序.利用碼盤脈沖進行調(diào)速,進行過簡單試驗,可用.沒有經(jīng)過長期驗證.做簡單修改即可應(yīng)用!

標(biāo)簽： Verilog FPGA PWM 語言

上傳時間： 2013-08-16

上傳用戶：梧桐
用FPGA設(shè)計數(shù)字系統(tǒng)

用FPGA設(shè)計數(shù)字系統(tǒng)，2007年上海FPGA研修班王巍老師講義

標(biāo)簽： FPGA 數(shù)字系統(tǒng)

上傳時間： 2013-08-16

上傳用戶：duoshen1989
用FPGA實現(xiàn)RS232通信,此代碼是用VHDL語言編寫

用FPGA實現(xiàn)RS232通信,此代碼是用VHDL語言編寫，非常有用的好東東啊

標(biāo)簽： FPGA VHDL 232 RS

上傳時間： 2013-08-21

上傳用戶：爺?shù)臍赓|(zhì)
用NiosII軟核配置FPGA的C語言源程序

用NiosII軟核配置FPGA的C語言源程序，比較經(jīng)典，我用一年了，時序不需更改

標(biāo)簽： NiosII FPGA C語言軟核

上傳時間： 2013-08-21

上傳用戶：qq521
FPGA RSIC CPU設(shè)計文檔和源碼是EDA中對CPU設(shè)計非常好用的程序

FPGA RSIC CPU設(shè)計文檔和源碼是EDA中對CPU設(shè)計非常好用的程序

標(biāo)簽： CPU FPGA RSIC EDA

上傳時間： 2013-08-21

上傳用戶：cppersonal
用fpga實現(xiàn)dsp 的fft算法其中有幾個文檔文件和用vhdl寫的1024點的fft代碼

用fpga實現(xiàn)dsp 的fft算法其中有幾個文檔文件和用vhdl寫的1024點的fft代碼

標(biāo)簽： fft fpga 1024 vhdl

上傳時間： 2013-08-22

上傳用戶：ukuk
用fpga實現(xiàn)的DA轉(zhuǎn)換器

用fpga實現(xiàn)的DA轉(zhuǎn)換器，有說明和源碼，VDHL文件。\\r\\nA PLD Based Delta-Sigma DAC\\r\\nDelta-Sigma modulation is the simple, yet powerful,\\r\\ntechnique responsible for the extraordinary\\r\\nperformance and low cost of today s audio CD\\r\\nplayers. The simplest Delta-Sigm

標(biāo)簽： fpga DA轉(zhuǎn)換器

上傳時間： 2013-08-22

上傳用戶：dudu1210004
用FPGA實現(xiàn)大型設(shè)計時

用FPGA實現(xiàn)大型設(shè)計時，可能需要FPGA具有以多個時鐘運行的多重數(shù)據(jù)通路，這種多時鐘FPGA設(shè)計必須特別小心，需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要用多少個不同的時鐘，以及如何進行布線

標(biāo)簽： FPGA 大型計時

上傳時間： 2013-08-23

上傳用戶：q986086481

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