用FPGA實現(xiàn)大型設(shè)計時,可能需要FPGA具有以多個時鐘運行的多重數(shù)據(jù)通路,這種多時鐘FPGA設(shè)計必須特別小心,需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要用多少個不同的時鐘,以及如何進行布線
資源簡介:用FPGA實現(xiàn)大型設(shè)計時,可能需要FPGA具有以多個時鐘運行的多重數(shù)據(jù)通路,這種多時鐘FPGA設(shè)計必須特別小心,需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要用多少個不同的時鐘,以及如何進行布線
上傳時間: 2013-08-23
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資源簡介:用FPGA實現(xiàn)大型設(shè)計時,可能需要FPGA具有以多個時鐘運行的多重數(shù)據(jù)通路,這種多時鐘FPGA設(shè)計必須特別小心,需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要用多少個不同的時鐘,以及如何進行布線
上傳時間: 2016-04-03
上傳用戶:ma1301115706
資源簡介:用FPGA實現(xiàn)FFT的算法分析,硬件介紹!
上傳時間: 2013-08-05
上傳用戶:qq1604324866
資源簡介:用FPGA實現(xiàn)三電平PWM發(fā)生器的完整資料
上傳時間: 2013-08-06
上傳用戶:DXM35
資源簡介:這是用FPGA實現(xiàn)的設(shè)計兩人擲骰子比較點大小的游戲,里面有詳細的程序源碼及分析,希望有些幫助
上傳時間: 2013-08-06
上傳用戶:lili123
資源簡介:針對高速數(shù)字信號處理的要求,提出用FPGA 實現(xiàn)基- 4FFT 算法,并對其整體結(jié)構(gòu)、蝶形單\\\\\\\\r\\\\\\\\n元進行了分析. 采用蝶算單元輸入并行結(jié)構(gòu)和同址運算,能同時提供蝶形運算所需的4 個操作\\\\\\\\r\\\\\\\\n數(shù),具有最大的數(shù)據(jù)并行性,能提高處理速度 按照旋...
上傳時間: 2013-08-08
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資源簡介:用FPGA實現(xiàn)RS232通信,此代碼是用VHDL語言編寫,非常有用的好東東啊
上傳時間: 2013-08-21
上傳用戶:爺?shù)臍赓|(zhì)
資源簡介:用FPGA實現(xiàn)dsp 的fft算法 其中有幾個文檔文件和用vhdl寫的1024點的fft代碼
上傳時間: 2013-08-22
上傳用戶:ukuk
資源簡介:用FPGA實現(xiàn)的DA轉(zhuǎn)換器,有說明和源碼,VDHL文件。\\r\\nA PLD Based Delta-Sigma DAC\\r\\nDelta-Sigma modulation is the simple, yet powerful,\\r\\ntechnique responsible for the extraordinary\\r\\nperformance and low cost of today s audio CD\\r\\...
上傳時間: 2013-08-22
上傳用戶:dudu1210004
資源簡介:用FPGA實現(xiàn)任意波形發(fā)生器的源代碼,另外還包括FPGA實現(xiàn)UART,從而與MCU實現(xiàn)串行通信。
上傳時間: 2013-08-27
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資源簡介:用FPGA實現(xiàn)fft
上傳時間: 2013-09-06
上傳用戶:菁菁聆聽
資源簡介:用FPGA實現(xiàn)SDRAM的操作,具體操作見內(nèi)部說明文件
上傳時間: 2014-01-05
上傳用戶:ecooo
資源簡介:用FPGA實現(xiàn)IIC通訊的主控端,最簡化的代碼,占用最小FPGA資源
上傳時間: 2015-03-24
上傳用戶:Ants
資源簡介:用FPGA實現(xiàn)fft
上傳時間: 2014-01-20
上傳用戶:fanboynet
資源簡介:在公司做的一個用FPGA實現(xiàn)的數(shù)字電視系統(tǒng)中 ASI轉(zhuǎn)TS流的程序
上傳時間: 2015-05-14
上傳用戶:xhz1993
資源簡介:用FPGA實現(xiàn)數(shù)字復(fù)接?肍PGA實現(xiàn)數(shù)字復(fù)接
上傳時間: 2015-06-08
上傳用戶:wendy15
資源簡介:鍵盤鼠標的原代碼,用FPGA實現(xiàn),使用Verilog HDL編寫,已經(jīng)使用FPGA驗正過了,完全可以用
上傳時間: 2013-12-12
上傳用戶:athjac
資源簡介:一個用FPGA實現(xiàn)的16FFT,僅供參考不作為工程文件
上傳時間: 2015-07-01
上傳用戶:lo25643
資源簡介:用FPGA 實現(xiàn)全雙工異步串口(UART),與PC 機通信。1 位起始位;8 位數(shù)據(jù)位;一個停止位;無校驗位;波特率為2400、4800、9600、11520 任選或可變(可用按鍵控制波特率模式)。
上傳時間: 2013-12-23
上傳用戶:無聊來刷下
資源簡介:1、 用FPGA實現(xiàn)PS/2鼠標接口。 2、 鼠標左鍵按下時十字形鼠標圖象的中間方塊改變顏色,右按下時箭頭改變顏色。 3、 Reset按鍵:總復(fù)位。
上傳時間: 2015-09-06
上傳用戶:love_stanford
資源簡介:用FPGA實現(xiàn)DDS,可變頻,幅值由硬件完成
上傳時間: 2015-12-03
上傳用戶:plsee
資源簡介:用FPGA實現(xiàn)的VGA/LCD顯示的相關(guān)知識,包含了程序的主要結(jié)構(gòu)和主要功能模塊的實現(xiàn)過程
上傳時間: 2014-11-15
上傳用戶:xymbian
資源簡介:用FPGA實現(xiàn)DDS的原理圖,結(jié)構(gòu)清晰,采用總線方式與外部單片機通信
上傳時間: 2015-12-16
上傳用戶:qq521
資源簡介:用FPGA實現(xiàn)任意波形發(fā)生器的源代碼,另外還包括FPGA實現(xiàn)UART,從而與MCU實現(xiàn)串行通信。
上傳時間: 2016-01-06
上傳用戶:jkhjkh1982
資源簡介:該文檔是QUICKLOGIC的一篇關(guān)于用FPGA實現(xiàn)DDS的設(shè)計指導(dǎo)。
上傳時間: 2013-12-20
上傳用戶:123啊
資源簡介:研究用FPGA實現(xiàn)對LCD顯示驅(qū)動的控制,通過一個數(shù)字時鐘作為演示,具體論證用FPGA驅(qū)動字符型液晶顯示器的方法,其核心是控制液晶顯示控制器的時序,經(jīng)測試,該方法切實可行,可以代替用單片機驅(qū)動LCD。
上傳時間: 2016-03-04
上傳用戶:jeffery
資源簡介:用FPGA實現(xiàn)帶馬表日歷的電子表,verilog代碼。
上傳時間: 2016-05-08
上傳用戶:wanghui2438
資源簡介:用FPGA實現(xiàn)dsp 的fft算法 其中有幾個文檔文件和用vhdl寫的1024點的fft代碼
上傳時間: 2014-01-18
上傳用戶:三人用菜
資源簡介:用FPGA實現(xiàn)的DA轉(zhuǎn)換器,有說明和源碼,VDHL文件。 A PLD Based Delta-Sigma DAC Delta-Sigma modulation is the simple, yet powerful, technique responsible for the extraordinary performance and low cost of today s audio CD players. The simple...
上傳時間: 2016-06-10
上傳用戶:bjgaofei
資源簡介:用FPGA實現(xiàn)的ADC采樣器,用VHDL編寫,8個模擬信號通道地址,8位數(shù)據(jù)輸出
上傳時間: 2014-01-10
上傳用戶:星仔