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  • 計(jì)算全息close all clc clear A=zeros(64) A(15:20,20:40)=1 A(15:50,20:25)=1 A(45:50,20:40)=1 A(30:34,

    計(jì)算全息close all clc clear A=zeros(64) A(15:20,20:40)=1 A(15:50,20:25)=1 A(45:50,20:40)=1 A(30:34,20:35)=1 % ppp=exp(rand(64)*pi*2*i) A=A.*ppp % Author s email: zjliu2001@163.com figure imshow(abs(A),[]) Fa=fft2(fftshift(A)) Fs=fftshift(Fa) Am=abs(Fs) % amplitude Ph=angle(Fs) % phase s=11 % 這表示邊長嗎? cgh=zeros(64*s) th=max(max(abs(Fs)))

    標(biāo)簽: 20 close clear zeros

    上傳時(shí)間: 2014-10-13

    上傳用戶:wweqas

  • VHDL語言編寫

    VHDL語言編寫,實(shí)現(xiàn)雙向移位寄存器功能,在MAX+plus軟件下實(shí)現(xiàn)

    標(biāo)簽: VHDL 語言 編寫

    上傳時(shí)間: 2014-07-13

    上傳用戶:宋桃子

  • 采用VHDL語言編寫的二-十進(jìn)制編碼器

    采用VHDL語言編寫的二-十進(jìn)制編碼器,在MAX+plus軟件上實(shí)現(xiàn),其中包括演示截圖。

    標(biāo)簽: VHDL 語言 編寫 十進(jìn)制

    上傳時(shí)間: 2017-01-11

    上傳用戶:sssl

  • 采用VHDL語言編寫8線-3線優(yōu)先編碼器

    采用VHDL語言編寫8線-3線優(yōu)先編碼器,在MAX+plus軟件下實(shí)現(xiàn)。

    標(biāo)簽: VHDL 語言 編寫 編碼器

    上傳時(shí)間: 2017-01-11

    上傳用戶:yan2267246

  • 在256個(gè)帶符號的數(shù)中找出絕對值最大的數(shù)

    在256個(gè)帶符號的數(shù)中找出絕對值最大的數(shù),并存放倒MAX中

    標(biāo)簽: 256 符號 絕對值

    上傳時(shí)間: 2014-11-05

    上傳用戶:aig85

  • 1. 設(shè)計(jì)要求: 1.彩色界面

    1. 設(shè)計(jì)要求: 1.彩色界面,界面清晰美觀,色彩協(xié)調(diào)。 2.使用DOS系統(tǒng)的0AH號子功能接受用戶鍵入的字符串。 3.建議按下圖設(shè)計(jì)用戶界面,顏色自選。 注:雙線框由若干CRT顯示符組成,相應(yīng)的CRT顯示符(十進(jìn)制數(shù))已經(jīng)標(biāo)注在右圖中。1. 設(shè)計(jì)要求: 1. 轉(zhuǎn)化內(nèi)容選擇下列一項(xiàng):二進(jìn)制數(shù)→十六進(jìn)制數(shù)顯示,二進(jìn)制數(shù)→十進(jìn)制數(shù)顯示,十進(jìn)制數(shù)→二進(jìn)制數(shù)顯示,十進(jìn)制數(shù)→十六進(jìn)制數(shù)顯示,十六進(jìn)制數(shù)→二進(jìn)制數(shù)顯示。 2. 給出適當(dāng)?shù)奈淖痔崾? 3. 程序要求保護(hù)措施,對于非法鍵入不受理,但回顯,顯示錯(cuò)誤信息。 4.具體顯示格式,例如:0111100010011010=789AH1. 設(shè)計(jì)要求: 1.統(tǒng)計(jì)并且顯示負(fù)數(shù)的個(gè)數(shù)。 2.找出真值最大的數(shù),并以十六進(jìn)制的形式,顯示在屏幕上,顯示格式為:MAX= H 3.數(shù)據(jù)自己在數(shù)據(jù)段進(jìn)行定義,個(gè)數(shù)至少為8個(gè)。1. 設(shè)計(jì)要求: 1.動(dòng)態(tài)畫一個(gè)實(shí)心圓球 2.位置在屏幕中央,變化情況是:逐漸“膨脹”的或者逐漸“收縮”的。

    標(biāo)簽: 彩色

    上傳時(shí)間: 2014-01-08

    上傳用戶:Divine

  • SQL 合計(jì)函數(shù) 使用 SQL 合計(jì)函數(shù) 你可以確定數(shù)據(jù)組的各種統(tǒng)計(jì)。你可以把這些函數(shù)用于查詢和合計(jì)表達(dá)式

    SQL 合計(jì)函數(shù) 使用 SQL 合計(jì)函數(shù) 你可以確定數(shù)據(jù)組的各種統(tǒng)計(jì)。你可以把這些函數(shù)用于查詢和合計(jì)表達(dá)式,條件是在具備 SQL特性的 QueryDef對象中或在創(chuàng)建基于SQL查詢的 Recordset對象時(shí)。 Avg 函數(shù) Count 函數(shù) First, Last 函數(shù) Min, Max 函數(shù) StDev, StDevP 函數(shù) Sum 函數(shù) Var 和 VarP 函數(shù)

    標(biāo)簽: SQL 函數(shù) 數(shù)據(jù) 查詢

    上傳時(shí)間: 2017-01-27

    上傳用戶:1583060504

  • 設(shè)計(jì)一個(gè)能進(jìn)行時(shí)、分、秒計(jì)時(shí)的十二小時(shí)制或二十四小時(shí)制的數(shù)字鐘

    設(shè)計(jì)一個(gè)能進(jìn)行時(shí)、分、秒計(jì)時(shí)的十二小時(shí)制或二十四小時(shí)制的數(shù)字鐘,并具有定時(shí)與鬧鐘功能,能在設(shè)定的時(shí)間發(fā)出鬧鈴音,能非常方便地對小時(shí)、分鐘和秒進(jìn)行手動(dòng)調(diào)節(jié)以校準(zhǔn)時(shí)間,每逢整點(diǎn),產(chǎn)生報(bào)時(shí)音報(bào)時(shí)。實(shí)驗(yàn)平臺: 1. 一臺PC機(jī); 2. MAX+PLUSII10.1。 Verilog HDL語言實(shí)現(xiàn)

    標(biāo)簽: 計(jì)時(shí) 數(shù)字

    上傳時(shí)間: 2017-01-30

    上傳用戶:dreamboy36

  • 自己做的vhdl課程設(shè)計(jì)

    自己做的vhdl課程設(shè)計(jì),交通燈:實(shí)現(xiàn)主干道倒計(jì)時(shí),分別為30,20,5秒,分情況:當(dāng)主干道有車時(shí),紅黃綠交替,當(dāng)只一個(gè)道路上有車時(shí),那個(gè)道的交通燈變綠色,利用max+plus2做成,使用flex8000,epf8282alc84_4只用加一個(gè)38譯碼器模塊即可,使用別的板子也可以運(yùn)行

    標(biāo)簽: vhdl

    上傳時(shí)間: 2017-02-03

    上傳用戶:努力努力再努力

  • c++語言程序設(shè)計(jì)超級簡單了解

    c++語言程序設(shè)計(jì)超級簡單了解,你會(huì)驚喜地發(fā)現(xiàn)你可以后人乘涼:max是C++標(biāo)準(zhǔn)庫的一部分。

    標(biāo)簽: 語言程序設(shè)計(jì) 超級

    上傳時(shí)間: 2013-12-15

    上傳用戶:啊颯颯大師的

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