為了使計算機能更好的識別人臉表情,對基于Gabor小波變換的人臉表情識別方法進行了研究。首先對包含表情區(qū)域的靜態(tài)灰度圖像進行預(yù)處理,包括對確定的人臉表情區(qū)域進行尺寸和灰度歸一化,然后利用二維Gabor小波變換提取臉部表情特征,使用快速PCA方法對提取的Gabor小波特征初步降維。再在低維的空間中,利用Fisher準(zhǔn)則提取那些有利于分類的特征,最后用SVM分類器進行分類。實驗結(jié)果表明,上述提出的方法比傳統(tǒng)的方法識別速度更快,能達到實時性的要求,并且具有很好的魯棒性,識別率高。
上傳時間: 2013-11-08
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現(xiàn)代信息處理應(yīng)用中,對模數(shù)轉(zhuǎn)換器的速度、精度、功耗和動態(tài)性能等關(guān)鍵性能指標(biāo)不斷提出更高的要求。針對模數(shù)轉(zhuǎn)換的實際應(yīng)用,提出并設(shè)計了一種基于TI公司生產(chǎn)的雙通道14 位 250MSPS 低功耗A / D轉(zhuǎn)換器 ADS4249的RGB視頻編碼器電路設(shè)計。這款A(yù) / D轉(zhuǎn)換器的技術(shù)創(chuàng)新點在于其完美的實現(xiàn)高動態(tài)性能的同時又能擁有1.8 V超低功耗。這一特性使得ADS4249非常適合多載波,寬帶通信的信號處理應(yīng)用。
上傳時間: 2013-10-28
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基于遺傳算法的組合邏輯電路的自動設(shè)計,依據(jù)給出的真值表,利用遺傳算法自動生成符合要求的組合邏輯電路。由于遺傳算法本身固有的并行性,采用軟件實現(xiàn)的方法在速度上往往受到本質(zhì)是串行計算的計算機制約,因此采用硬件化設(shè)計具有重要的意義。為了證明基于FPGA的遺傳算法的高效性,設(shè)計了遺傳算法的各個模塊,實現(xiàn)了基于FPGA的遺傳算法。
標(biāo)簽: FPGA 算法 電路設(shè)計 組合邏輯
上傳時間: 2014-01-08
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以某高速實時頻譜儀為應(yīng)用背景,論述了5 Gsps采樣率的高速數(shù)據(jù)采集系統(tǒng)的構(gòu)成和設(shè)計要點,著重分析了采集系統(tǒng)的關(guān)鍵部分高速ADC(analog to digital,模數(shù)轉(zhuǎn)換器)的設(shè)計、系統(tǒng)采樣時鐘設(shè)計、模數(shù)混合信號完整性設(shè)計、電磁兼容性設(shè)計和基于總線和接口標(biāo)準(zhǔn)(PCI Express)的數(shù)據(jù)傳輸和處理軟件設(shè)計。在實現(xiàn)了系統(tǒng)硬件的基礎(chǔ)上,采用Xilinx公司ISE軟件的在線邏輯分析儀(ChipScope Pro)測試了ADC和采樣時鐘的性能,實測表明整體指標(biāo)達到設(shè)計要求。給出上位機對采集數(shù)據(jù)進行處理的結(jié)果,表明系統(tǒng)實現(xiàn)了數(shù)據(jù)的實時采集存儲功能。
標(biāo)簽: Gsps 高速數(shù)據(jù) 采集系統(tǒng)
上傳時間: 2014-11-26
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The LT®6552 is a specialized dual-differencing 75MHzoperational amplifier ideal for rejecting common modenoise as a video line receiver. The input pairs are designedto operate with equal but opposite large-signal differencesand provide exceptional high frequency commonmode rejection (CMRR of 65dB at 10MHz), therebyforming an extremely versatile gain block structure thatminimizes component count in most situations. The dualinput pairs are free to take on independent common modelevels, while the two voltage differentials are summedinternally to form a net input signal.
上傳時間: 2014-12-23
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故障樣本數(shù)據(jù)的獲取是模擬電路故障診斷中最基本的步驟。為了實現(xiàn)短時間內(nèi)多次進行故障注入、獲取大量樣本數(shù)據(jù),提出了基于SLPS的樣本數(shù)據(jù)自動獲取技術(shù)。利用SLPS將PSpice與Matlab結(jié)合,采用Matlab編程,實現(xiàn)故障模擬電路仿真數(shù)據(jù)獲取的自動化。實際應(yīng)用表明該方法操作簡便,自動化程度高。
上傳時間: 2013-10-23
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基于探索 RLC串聯(lián)電路諧振特性仿真實驗技術(shù)的目的,采用Multisim10仿真軟件對RLC串聯(lián)電路諧振特性進行了仿真實驗測試,給出了幾種Multisim仿真實驗方案,介紹了諧振頻率、上限頻率、下限頻率及品質(zhì)因數(shù)的測試和計算方法,討論了電阻大小對品質(zhì)因數(shù)的影響。結(jié)論是仿真實驗可直觀形象地描述RLC串聯(lián)電路的諧振特性,將電路的硬件實驗方式向多元化方式轉(zhuǎn)移,利于培養(yǎng)知識綜合、知識應(yīng)用、知識遷移的能力,使電路分析更加靈活和直觀。
標(biāo)簽: Multisim RLC 串聯(lián)電路 諧振
上傳時間: 2013-10-12
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由于CMOS器件靜電損傷90%是延遲失效,對整機應(yīng)用的可靠性影響太大,因而有必要對CMOS器件進行抗靜電措施。本文描述了CMOS器件受靜電損傷的機理,從而對設(shè)計人員提出了幾種在線路設(shè)計中如何抗靜電,以保護CMOS器件不受損傷。
上傳時間: 2013-11-05
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This note describes some of the unique IC design techniques incorporated into a fast, monolithic power buffer, the LT1010. Also, some application ideas are described such as capacitive load driving, boosting fast op amp output current and power supply circuits.
標(biāo)簽: BUFFER 運算 放大器設(shè)計
上傳時間: 2013-11-12
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A complete design for a data acquisition card for the IBM PC is detailed in this application note. Additionally, C language code is provided to allow sampling of data at speed of more than 20kHz. The speed limitation is strictly based on the execution speed of the "C" data acquisition loop. A "Turbo" XT can acquire data at speeds greater than 20kHz. Machines with 80286 and 80386 processors can go faster than 20kHz. The computer that was used as a test bed in this application was an XT running at 4.77MHz and therefore all system timing and acquisition time measurements are based on a 4.77MHz clock speed.
標(biāo)簽: 1099 LTC 數(shù)據(jù) 采集板
上傳時間: 2013-10-29
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