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nc-VHDL

  • 基于VHDL的FPGA和Nios II實(shí)例精煉（劉福奇）

    　　基于VHDL的FPGA和Nios II 實(shí)例精煉【作者：劉福奇；出版社：北京航空航天大學(xué)出版社】（本書(shū)優(yōu)酷視頻地址：http://www.youku.com/playlist_show/id_5882081.html） 　　內(nèi)容簡(jiǎn)介：本書(shū)分為4個(gè)部分：Quartus Ⅱ軟件的基本操作、VHDL語(yǔ)法介紹、FPGA設(shè)計(jì)實(shí)例和Nios Ⅱ設(shè)計(jì)實(shí)例；總結(jié)了編者幾年來(lái)的FPGA設(shè)計(jì)經(jīng)驗(yàn)，力求給初學(xué)者或是想接觸這方面知識(shí)的讀者提供一種快速入門(mén)的方法；適合電子相關(guān)專業(yè)的大學(xué)生、FPGA的初學(xué)者以及對(duì)FPGA有興趣的電子工程師。初學(xué)者可以按照步驟學(xué)習(xí)。本書(shū)中提及到時(shí)間計(jì)算問(wèn)題，不光提出有時(shí)間戳的方法， 還介紹了一種通過(guò)讀取定時(shí)器的寄存器來(lái)計(jì)算時(shí)間的方法。其實(shí)，有人認(rèn)為，本書(shū)最好的部分是：DMA的實(shí)現(xiàn)說(shuō)明（本書(shū)從3個(gè)方面講述了DMA的使用）。現(xiàn)在學(xué)習(xí)Verilog HDL的人或許比較多，但是用VHDL的人可以學(xué)習(xí)下，這本書(shū)還是很不錯(cuò)的。

    標(biāo)簽： VHDL FPGA Nios

    上傳時(shí)間： 2014-07-10

    上傳用戶：米米陽(yáng)123

  • altera FPGA/CPLD高級(jí)篇(VHDL源代碼)

          altera FPGA/CPLD高級(jí)篇(VHDL源代碼)

    標(biāo)簽： altera FPGA CPLD VHDL

    上傳時(shí)間： 2015-01-01

    上傳用戶：wangyi39

  • 基于Quartus II FPGA/CPLD數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例（VHDL源代碼文件）

    　　本資料是關(guān)于基于Quartus II FPGA/CPLD數(shù)字系統(tǒng)設(shè)計(jì)實(shí)例（VHDL源代碼文件），需要的可以自己下載。

    標(biāo)簽： Quartus FPGA CPLD VHDL

    上傳時(shí)間： 2013-11-12

    上傳用戶：VRMMO

  • EDA技術(shù)實(shí)用教程VHDL版本課件

    EDA技術(shù)實(shí)用教程VHDL版本課件

    標(biāo)簽： VHDL EDA 實(shí)用教程 版本

    上傳時(shí)間： 2013-10-10

    上傳用戶：ruan2570406

  • VHDl實(shí)用教程(潘松/王國(guó)棟編著)

    VHDL語(yǔ)言

    標(biāo)簽： VHDl 實(shí)用教程

    上傳時(shí)間： 2013-10-08

    上傳用戶：松毓336

  • vhdl版的LCD1602程序

    vhdl版的1602程序。

    標(biāo)簽： vhdl 1602 LCD 程序

    上傳時(shí)間： 2013-11-24

    上傳用戶：a3318966

  • vhdl設(shè)計(jì)實(shí)例(修正版)

    有用的vhdl設(shè)計(jì)實(shí)例(修正版)。

    標(biāo)簽： vhdl 設(shè)計(jì)實(shí)例 正

    上傳時(shí)間： 2013-11-11

    上傳用戶：yanyangtian

  • FPGA VHDL程序35個(gè)實(shí)例

    FPGA VHDL程序35個(gè)實(shí)例

    標(biāo)簽： FPGA VHDL 程序

    上傳時(shí)間： 2013-10-19

    上傳用戶：pei5

  • EDA原理及VHDL實(shí)現(xiàn)（何賓教授）

    　　第1章 數(shù)字系統(tǒng)EDA設(shè)計(jì)概論 　　第2章 可編程邏輯器件設(shè)計(jì)方法 　　第3章 VHDL語(yǔ)言基礎(chǔ) 　　第4章 數(shù)字邏輯單元設(shè)計(jì) 　　第5章 數(shù)字系統(tǒng)高級(jí)設(shè)計(jì)技術(shù)（*） 　　第6章 基于HDL設(shè)計(jì)輸入 　　第7章 基于原理圖設(shè)計(jì)輸入 　　第8章 設(shè)計(jì)綜合和行為仿真 　　第9章 設(shè)計(jì)實(shí)現(xiàn)和時(shí)序仿真 　　第10章 設(shè)計(jì)下載和調(diào)試 　　第11章 數(shù)字時(shí)鐘設(shè)計(jì)及實(shí)現(xiàn)（*） 　　第12章 通用異步接收發(fā)送器設(shè)計(jì)及實(shí)現(xiàn)（*） 　　第13章 數(shù)字電壓表設(shè)計(jì)及實(shí)現(xiàn)（*） 　　第14章 軟核處理器PicoBlaze原理及應(yīng)用（*） 　　注：帶*的內(nèi)容可根據(jù)課時(shí)的安排選講

    標(biāo)簽： VHDL EDA

    上傳時(shí)間： 2013-11-01

    上傳用戶：atdawn

  • 自己的VHDL總結(jié)

    一些VHDL的語(yǔ)法

    標(biāo)簽： VHDL

    上傳時(shí)間： 2013-12-25

    上傳用戶：panjialaodi

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